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基于MAX7000系列CPLD的數(shù)據(jù)采集系統(tǒng)
- CPLD是復(fù)雜的PLD，專指那些集成規(guī)模大于1000門以上的可編程邏輯器件。它由與陣列、或陣列、輸入緩沖電路...
- 關(guān)鍵字： CPLD MAX7000 數(shù)據(jù)采集 FPGA
FPGA設(shè)計(jì)中的時(shí)序管理
- FPGA設(shè)計(jì)中的時(shí)序管理, 當(dāng)FPGA設(shè)計(jì)面臨高級(jí)接口的設(shè)計(jì)問題時(shí)，該采取什么辦法來解決呢?美國(guó)EMA公司的TimingDesigner軟件可以簡(jiǎn)化這些設(shè)計(jì)問題，并提供對(duì)幾乎所有接口的預(yù)先精確控制。下問文將向你娓娓道來?！ ∫?、摘要 從簡(jiǎn)單SRAM接
- 關(guān)鍵字： 管理 時(shí)序 設(shè)計(jì) FPGA
一種基于FPGA的復(fù)數(shù)浮點(diǎn)協(xié)方差矩陣實(shí)現(xiàn)
- O引言協(xié)方差矩陣的計(jì)算是信號(hào)處理領(lǐng)域的典型運(yùn)算，是實(shí)現(xiàn)多級(jí)嵌套維納濾波器、空間譜估計(jì)、相干源...
- 關(guān)鍵字： FPGA 協(xié)方差矩陣 復(fù)數(shù)浮點(diǎn) FIFO 信號(hào)處理
超越摩爾定律 賽靈思全球首發(fā)堆疊硅片互聯(lián)技術(shù)
- 日前，全球可編程平臺(tái)領(lǐng)導(dǎo)廠商賽靈思公司 (Xilinx, Inc.)宣布推出業(yè)界首項(xiàng)堆疊硅片互聯(lián)技術(shù)，即通過在單個(gè)封裝中集成多個(gè) FPGA 芯片，實(shí)現(xiàn)突破性的容量、帶寬和功耗優(yōu)勢(shì)，以滿足那些需要高密度晶體管和邏輯，以及需要極大的處理能力和帶寬性能的市場(chǎng)應(yīng)用。通過采用3D封裝技術(shù)和硅通孔 (TSV) 技術(shù)，賽靈思28nm 7系列FPGA目標(biāo)設(shè)計(jì)平臺(tái)所能滿足的的資源需求，是最大單芯片 FPGA 所能達(dá)到的兩倍。這種創(chuàng)新的平臺(tái)方法不僅使賽靈思突破了摩爾定律的界限，而且也為電子產(chǎn)品制造商系統(tǒng)的大規(guī)模集成提供了
- 關(guān)鍵字： Xilinx FPGA 堆疊硅片互聯(lián)技術(shù)
3G／4G時(shí)代FPGA將扮演重要角色
- 26年前賽靈思發(fā)明了可編程邏輯器件，現(xiàn)在，賽靈思的產(chǎn)品已經(jīng)遍布無線基礎(chǔ)設(shè)施當(dāng)中，特別是在國(guó)內(nèi)TD-SCDMA的部署中，無處不在。FPGA的一個(gè)重要價(jià)值在于為運(yùn)營(yíng)商快速將產(chǎn)品推向市場(chǎng)提供了時(shí)間保證，并且FPGA的可編程性使其即使在3G網(wǎng)絡(luò)部署完成后，仍然能以低成本進(jìn)行下一代產(chǎn)品升級(jí)，提供差異化增值服務(wù)。高度集成帶有并行DSP處理能力的FPGA還可以以極具成本及功耗優(yōu)勢(shì)在BBU、RRU、PTN、GPON/EPON，以及40G/100G以太網(wǎng)中取代ASIC/ASSP。
- 關(guān)鍵字： FPGA 3G
如何在LED恒流驅(qū)動(dòng)器上加入PWM亮度調(diào)節(jié)
- 引言 Maxim Integrated Products為很多應(yīng)用領(lǐng)域提供PWM (脈寬調(diào)制)亮度調(diào)節(jié)LED (發(fā)光二極管)驅(qū)動(dòng)器。典型應(yīng)用中，通過串口向LED驅(qū)動(dòng)器發(fā)送指令改變相應(yīng)LED的寄存器值進(jìn)行亮度調(diào)節(jié)。用于亮度控制的數(shù)據(jù)通常為4
- 關(guān)鍵字： 亮度 調(diào)節(jié) PWM 加入 LED 驅(qū)動(dòng)器 如何
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