引言在各型雷達導引頭的研制開發(fā)中,經常需要多次試驗以檢驗雷達對目標回波信號的分析處理性能。然而...
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雷達 中頻模擬器 FPGA DSP
摘要:作為高傳輸速率和低設計成本的傳輸技術,串行傳輸技術被廣泛應用于高速通信領域,并已成為業(yè)界首選。在此基...
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FPGA 高速串行傳輸
隨著軟件無線電的發(fā)展,對于濾波器的處理速度要求越來越高。傳統的FIR濾波器一般采用通用DSP處理器,但是DSP...
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線性相位 濾波器 FPGA
2011年8月25號,北京——Altera公司(NASDAQ: ALTR)今天宣布開始發(fā)售世界上第一款具有28-Gbps收發(fā)器的FPGA。Stratix V GT器件是業(yè)界目前為止帶寬最大、性能最好的FPGA。這一業(yè)界領先的創(chuàng)新Stratix V GT FPGA技術為前沿通信系統設計人員量身定做,幫助他們盡快實現市場解決方案,以滿足越來越高的網絡帶寬要求。
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Altera FPGA
NEC公司推出了基于其C - CyberWorkBench設計平臺,專用FPGA設計平臺版本為商業(yè)銷售。
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NEC FPGA
基于CY7C68013A和FPGA的ADSP-TS101擴展USB接口設計,ADI公司的DSP器件(ADSP-TS101)具有浮點實時處理能力強、并行性好等優(yōu)點,從而廣泛被彈載信號處理系統選用。其作為彈載主處理器,在導彈的系統試驗中,需要利用上位機對其中的大數據量的軟件變量進行實時監(jiān)控和記錄,
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USB 接口 設計 擴展 ADSP-TS101 CY7C68013A FPGA 基于
基于Spartan-6 FPGA的可擴展驅動控制系統,許多情況下驅動器只是大規(guī)模工藝的一個組件,因此互操作性也是一項關鍵的設計要求。而影響這種要求的關鍵因素是工業(yè)網絡協議的寬度(即現場總線)和相關器件特性,因為它們用來標準化驅動器在網絡中的表達?,F場總線(比
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驅動 控制系統 擴展 FPGA Spartan-6 基于
基于雙FPGA+ARM架構的圖像壓縮系統,目前的圖像壓縮存儲方案大都無法支持高分辨率圖像。另外,在一些DSP解決方案中,因為DSP接口不靈活以及DSP本身處理能力的限制,很難支持高分辨圖像壓縮?! ”驹O計開發(fā)出了一套基于雙FPGA+ARM架構的高速計算機屏幕圖
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壓縮 系統 圖像 架構 FPGA ARM 基于
基于FPGA PCI的并行計算平臺實,本文介紹的基于PCI總線的FPGA計算平臺的系統實現:通過在PC機上插入擴展PCI卡,對算法進行針對并行運算的設計,提升普通PC機對大計算量數字信號的處理速度。本設計采用5片FPGA芯片及相關周邊芯片設計實現這一并行高速
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計算 平臺 并行 PCI FPGA 基于
近日,NEC 推出了半導體設計高階綜合工具CyberWorkBench的FPGA專用版。CyberWorkBench是NEC開發(fā)的以C語言為基礎的LSI(注1)設計工具。該工具以ANSI-C、SystemC等C語言程序作為輸入,以自動生成高性能和高質量的電路的合成工具為中心,具備與軟件協調的高速驗證環(huán)境、源碼調試功能、形式屬性驗證等豐富的驗證功能,從而實現 All-in-C 。通常在設計LSI時,要使用硬件專用的描述語言HDL(注2),而使用CyberWorkBench,由于可以輸入C語言,從而使設計描述
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NEC FPGA
基于FPGA的二次群數字信號分接部分功能實現,1.引言 為了提高傳輸速率,擴大通信容量,減少信道數量,通常把多路信號復用成一路信號進行傳輸。在多種復用方式中,時分復用是一種常用的方式。時分復用是多路信號按照時間間隔共享一路信道進行傳輸。復接是把多
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功能 實現 部分 信號 FPGA 數字 基于
摘要 針對一般無線通信系統抗干擾、抗噪聲以及抗多徑性能力差的缺點,提出了一種基于FPGA的直接序列擴頻系統設計。該設計采用63位的pn碼作為擴頻調制的碼序列,在發(fā)送端,對信息碼進行擴頻調制;在接收端,對收到的擴
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FPGA 直接序列 擴頻系統
介紹如何從比RTL更高層次的抽象層分析資源共享,讓資源占用率比依賴RTL設計中的互斥任務的方法更低。
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FPGA SAD 算法 資源利用率
摘要:作為高傳輸速率和低設計成本的傳輸技術,串行傳輸技術被廣泛應用于高速通信領域,并已成為業(yè)界首選。在此基于對高速串行傳輸系統的分析,對實例進行了總體設計驗證,最終達到高速傳輸的目的。 關鍵詞:FPGA;
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FPGA 高速串行 傳輸系統
摘要:采用Verilog HDL語言作為硬件功能的描述,運用模塊化設計方法分別設計了通用異步收發(fā)器(UART)的發(fā)送模塊、接收模塊和波特率發(fā)生器,并結合現場可編程門陣列(FPGA)的特點,實現了一個可移植的UART模塊。該設計不
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FPGA 異步收發(fā)器
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