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rf-fpga 文章進(jìn)入rf-fpga技術(shù)社區(qū)

基于C/C++的大規(guī)模FPGA設(shè)計

背景可編程邏輯器件的設(shè)計方法經(jīng)歷了布爾等式，原理圖輸入，硬件描語言這樣一個發(fā)展過程。隨著設(shè)計的日益復(fù)雜和可編程邏輯器件規(guī)模的不斷擴(kuò)大，人們不停地尋求更加抽象的行為級設(shè)計方法，以便在盡可能短時間內(nèi)完成自
關(guān)鍵字： FPGA 大規(guī)模

多節(jié)點大容量FPGA系統(tǒng)的遠(yuǎn)程升級方法

引言　　多節(jié)點系統(tǒng)，在目前的很多電子系統(tǒng)應(yīng)用場合都可以看到。這種多節(jié)點系統(tǒng)由于具有結(jié)構(gòu)可擴(kuò)展性、功能配置的靈活性以及便于查找故障節(jié)點等良好的可維護(hù)性得到了越來越廣泛的應(yīng)用。通常，多節(jié)點系統(tǒng)各個節(jié)點的主
關(guān)鍵字： FPGA 節(jié)點大容量方法

基于FPGA的嵌入式系統(tǒng)USB接口設(shè)計

基于FPGA的嵌入式系統(tǒng)USB接口設(shè)計,摘要：設(shè)計基于FPGA的IP-BX電話應(yīng)用系統(tǒng)，用于傳統(tǒng)的電話網(wǎng)絡(luò)(PSTN)與PC機(jī)之間的接口連接。USB2．0接口器件EZ-USB FX2 CY7C68013A-56工作在slave FIFO模式，為基于FPGA的嵌入式系統(tǒng)與PC機(jī)之間提供數(shù)據(jù)和命令通道，從
關(guān)鍵字：接口設(shè)計 USB 系統(tǒng) FPGA 嵌入式基于

裝入CPLD/FPGA的步進(jìn)電機(jī)運(yùn)動控制器與驅(qū)動器

本設(shè)計實例進(jìn)一步拓展了以前將步進(jìn)電機(jī)驅(qū)動器集成到CPLD中的設(shè)計（參考文獻(xiàn)1）。本實例不僅集成了驅(qū)動器，而且還集成了一個簡單的單軸步進(jìn)電機(jī)運(yùn)動控制器。根據(jù)CPLD大小，可以將多個運(yùn)動控制器設(shè)計到單一設(shè)備中。例如
關(guān)鍵字：控制器驅(qū)動器運(yùn)動電機(jī) CPLD/FPGA 步進(jìn) 裝入

利用FPGA解決TMS320C54K與SDRAM的接口問題

在DSP應(yīng)用系統(tǒng)中，需要大量外擴(kuò)存儲器的情況經(jīng)常遇到。例如，在數(shù)碼相機(jī)和攝像機(jī)中，為了將現(xiàn)場拍攝的諸多圖...
關(guān)鍵字： FPGA TMS320C54K SDRAM

基于FPGA與外部SRAM的大容量數(shù)據(jù)存儲

1引言我們將針對FPGA中內(nèi)部BlockRAM有限的缺點，提出了將FPGA與外部SRAM相結(jié)合來改進(jìn)設(shè)計的方法，并給出...
關(guān)鍵字： FPGA SRAM

MELP語音編碼的FPGA實現(xiàn)的系統(tǒng)框架

NiosII處理器是Intel公司為Altera公司推出的32位精簡指令處理器軟核。在Altera公司推出的軟件SOPC中加載...
關(guān)鍵字： MELP FPGA

基于AXI總線的MicroBlaze雙核SoPC系統(tǒng)設(shè)計

目的是利用嵌入在Xilinx FPGA中的MicroBlaze核實現(xiàn)基于AXI總線的雙核嵌入式系統(tǒng)設(shè)計以及共享實現(xiàn)LED燈的時控。對于共享實現(xiàn)LED燈時控的方法是通過在兩個低速總線之間加入一個axi2axi_connector實現(xiàn)axilite總線上的slave共享。對于實現(xiàn)雙核之間的通信主要方法是利用mailbox和mutex完成核間通信。硬件平臺采用的是Xilinx FPGA Spartan -6 Atlys板，軟件平臺是Xilinx EDK，主要使用的是XPS(硬件設(shè)計)和SDK(軟件設(shè)計)，開發(fā)出
關(guān)鍵字： Xilinx FPGA AXI 201201

基于FPGA技術(shù)的智能導(dǎo)盲犬方案設(shè)計

基于FPGA技術(shù)的智能導(dǎo)盲犬方案設(shè)計,眾所周知眼晴是“心靈之窗”，而對于突然失去或從未擁有過“心靈之窗”的盲人來說，生活上的困難與心理上的痛苦是可想而知的。他們的衣食住行存在諸多不便，而在出行與人際交往中遇到的困難更加
關(guān)鍵字：方案設(shè)計智能技術(shù) FPGA 基于

低成本四運(yùn)放驅(qū)動RF調(diào)制器

本文介紹的視頻電路組合了音頻副載波

圖1. 用于NTSC制式的陷波器和延遲均衡器

為了獲得最佳性能，輸入應(yīng)該由低阻信號源驅(qū)動，例如運(yùn)算放大器或有源濾波器。兩個二階全通濾波環(huán)節(jié)(U1a、R1、C1、L1)和(U1c、R13、
關(guān)鍵字：調(diào)制器 RF 驅(qū)動成本

基于CPLD/FPGA的VHDL電路優(yōu)化設(shè)計

基于CPLD/FPGA的VHDL電路優(yōu)化設(shè)計,VHDL(Very High Speed Integrated Circuit Hardware Description Language)是IEEE工業(yè)標(biāo)準(zhǔn)硬件描述語言，是隨著可編程邏輯器件(PLD)的發(fā)展而發(fā)展起來的。它是一種面向設(shè)計、多層次的硬件描述語言，是集行為描述、RTL
關(guān)鍵字：優(yōu)化設(shè)計電路 VHDL CPLD/FPGA 基于

Cyclone III FPGA技術(shù)在高清晰LCD HDTV中的應(yīng)用

Cyclone III FPGA技術(shù)在高清晰LCD HDTV中的應(yīng)用,當(dāng)今的液晶顯示(LCD) 技術(shù)在高清晰電視(HDTV) 領(lǐng)域得到了廣泛應(yīng)用，其挑戰(zhàn)在于如何獲得更高的分辨率，實現(xiàn)更快的數(shù)據(jù)速率。提高數(shù)據(jù)速率需要專業(yè)圖像處理算法來支持快速移動的視頻。業(yè)界遇到的主要問題是：怎樣實現(xiàn)這
關(guān)鍵字： LCD HDTV 應(yīng)用高清晰技術(shù) III FPGA Cyclone

在FPGA上實現(xiàn)H.264/AVC視頻編碼標(biāo)準(zhǔn)

盡管H.264/AVC承諾將此已有視頻編碼標(biāo)準(zhǔn)具有更高的編碼效率，它仍為系統(tǒng)架構(gòu)師、DSP工程師和硬件設(shè)計人員帶來了巨大的工程設(shè)計挑戰(zhàn)。H.264/AVC 標(biāo)準(zhǔn)引入了自 1990 年推出 H.261 之后視頻編碼標(biāo)準(zhǔn)演進(jìn)過程中出現(xiàn)的大部
關(guān)鍵字： FPGA 264 AVC 視頻編碼

通用的集成電路RF噪聲抑制能力測量技術(shù)

GSM手機(jī)的隨處可見正導(dǎo)致不需要的RF信號的持續(xù)增加，如果電子電路沒有足夠的RF抑制能力，這些RF信號會導(dǎo)致電路產(chǎn)生的結(jié)果失真。為了確保電子電路可靠工作，對于電子電路RF抑制能力的測量已經(jīng)成為產(chǎn)品設(shè)計必不可少的一
關(guān)鍵字：能力測量技術(shù) 抑制噪聲集成電路 RF 通用

賽靈思發(fā)布嵌入式FPGA程序員雙認(rèn)證

可編程平臺領(lǐng)導(dǎo)廠商賽靈思(Xilinx, Inc.; NASDAQ: XLNX)在上海市職業(yè)技能鑒定中心的支持下，針對雙方聯(lián)合打造的計算機(jī)程序員(嵌入式FPGA方向)(三級)雙認(rèn)證項目，在市北高新技術(shù)服務(wù)業(yè)園區(qū)舉行了主題為“FPGA加速中國‘智’造，擁抱嵌入式計算新紀(jì)元”的新聞發(fā)布會。該項目將國家證書的權(quán)威性與FPGA發(fā)明者美國賽靈思公司的嵌入式計算平臺的前瞻性完美結(jié)合，開辟了嵌入式計算創(chuàng)新型人才培訓(xùn)的嶄新模式。
關(guān)鍵字： Xilinx FPGA

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利用FPGA資源和最小模擬電路發(fā)電進(jìn)行開關(guān)電源設(shè)計的方法
基于FPGA的機(jī)載顯示系統(tǒng)架構(gòu)設(shè)計與優(yōu)化
基于FPGA+DSP遠(yuǎn)程監(jiān)控器設(shè)計與實現(xiàn)
基于FPGA的LCD顯示遠(yuǎn)程更新

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