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          一種基于FPGA的雷達(dá)波束控制系統(tǒng)設(shè)計(jì)

          • 為了達(dá)到波束控制高效、低成本和小型化的目標(biāo)。在此介紹一種基于FPGA的相控陣?yán)走_(dá)波束控制系統(tǒng)硬件平臺及其軟件設(shè)計(jì)。系統(tǒng)采用FPGA作為波束控制算法實(shí)現(xiàn)的核心,選用單片機(jī)實(shí)現(xiàn)陣面組件驅(qū)動部分的控制調(diào)試,在此硬件平臺上,開發(fā)一種用硬件描述語言和單片機(jī)匯編語言與VB語言設(shè)計(jì)相結(jié)合實(shí)現(xiàn)的波束控制系統(tǒng)。設(shè)計(jì)的系統(tǒng)設(shè)備量少,控制和調(diào)試功能完善,適宜于推廣到集中式運(yùn)算、分布式驅(qū)動的波束控制體系。
          • 關(guān)鍵字: 設(shè)計(jì)  控制系統(tǒng)  雷達(dá)  FPGA  基于  

          一種基于FPGA的語音密碼鎖系統(tǒng)的研究與設(shè)計(jì)

          • 引言電子密碼鎖系統(tǒng)主要由電子鎖體、電子密匙等部分組成,一把電子密匙里能存放多組開鎖密碼,用戶在...
          • 關(guān)鍵字: FPGA  語音密碼鎖  EP1C3T144  

          發(fā)揮 FPGA 設(shè)計(jì)的無限潛力

          •   盡管 FPGA 為嵌入式設(shè)計(jì)帶來了強(qiáng)大的功能與靈活性,但額外的開發(fā)流程也給設(shè)計(jì)工作增加了新的復(fù)雜性和限制問題。整合傳統(tǒng)的硬件-FPGA-軟件設(shè)計(jì)流程并充分利用 FPGA 的可再編程功能是我們的一個(gè)解決之道。   隨著 FPGA 技術(shù)逐步延伸至軍事電子系統(tǒng)以及嵌入式電子產(chǎn)業(yè)的幾乎全部領(lǐng)域,能發(fā)揮可編程邏輯優(yōu)勢的應(yīng)用已經(jīng)占據(jù)主流地位。通信、機(jī)載和控制系統(tǒng)尤其受益于 FPGA 的設(shè)計(jì)靈活性、現(xiàn)場重構(gòu)和并行處理功能。同時(shí),較短的設(shè)計(jì)周期和更加簡化的驗(yàn)證過程則有助于加快應(yīng)用投入現(xiàn)場的進(jìn)程。   盡管 FPG
          • 關(guān)鍵字: Altium  FPGA  

          FPGA設(shè)計(jì)的高速FIFO電路技術(shù)

          • FPGA設(shè)計(jì)的高速FIFO電路技術(shù),本文主要介紹高速FIFO電路在數(shù)據(jù)采集系統(tǒng)中的應(yīng)用,相關(guān)電路主要有高速A/D轉(zhuǎn)換器、FPGA、SDRAM存儲器等。圖1為本方案的結(jié)構(gòu)框圖。在大容量高速采集系統(tǒng)項(xiàng)目的開發(fā)過程中,F(xiàn)PGA作為可編程邏輯器件,設(shè)計(jì)靈活、可操作性
          • 關(guān)鍵字: 電路  技術(shù)  FIFO  高速  設(shè)計(jì)  FPGA  

          多種EDA工具的FPGA設(shè)計(jì)方案

          • 概述:介紹了利用多種EDA工具進(jìn)行FPGA設(shè)計(jì)的實(shí)現(xiàn)原理及方法,其中包括設(shè)計(jì)輸入、綜合、功能仿真、實(shí)現(xiàn)、時(shí)序仿真、配置下載等具體內(nèi)容。并以實(shí)際操作介紹了整個(gè)FPGA的設(shè)計(jì)流程。 關(guān)鍵詞: FPGA 仿真 綜合 EDA在數(shù)字
          • 關(guān)鍵字: FPGA  EDA  設(shè)計(jì)方案    

          對勾形復(fù)蘇 新需求引領(lǐng)半導(dǎo)體業(yè)革新

          •   今年4月的Globalpress電子峰會如期在美國舊金山舉行,30多家公司的密集講演折射出半導(dǎo)體業(yè)的回暖態(tài)勢,而從與會公司的發(fā)展策略和分享的熱點(diǎn)技術(shù)中,或可一窺半導(dǎo)體業(yè)下一波的發(fā)展方向。本報(bào)記者特就其中的熱點(diǎn)技術(shù)進(jìn)行探討,并就幾家公司的發(fā)展策略進(jìn)行介紹,以饗讀者。   ASIC與FPGA發(fā)力低功耗   年參加Globalpress電子峰會的企業(yè)代表中,與FPGA相關(guān)的公司數(shù)量眾多,包括Altera、Lattice(萊迪思)、QuickLogic等。而與其呈此消彼長之勢的ASIC陣營也不甘示弱,Op
          • 關(guān)鍵字: ASIC  FPGA  

          基于FPGA視頻采集中的I2C總線設(shè)計(jì)與實(shí)現(xiàn)

          • 隨著編碼理論和多媒體網(wǎng)絡(luò)應(yīng)用的發(fā)展,圖像和視頻壓縮編碼JPEG2000系統(tǒng)應(yīng)用得到逐步推廣。在此從視頻采集中I2C總線的特點(diǎn)、協(xié)議入手,著重對I2C總線設(shè)計(jì)及實(shí)現(xiàn)方法進(jìn)行介紹。基于視頻采集芯片SAA7111,提出采用VHDL語言來模擬實(shí)現(xiàn)I2C總線接口的方法,并將其嵌入到FPGA中。實(shí)驗(yàn)仿真結(jié)果證明數(shù)據(jù)是正確、穩(wěn)定、可靠的,具有一定的可借鑒性。
          • 關(guān)鍵字: 總線  設(shè)計(jì)  實(shí)現(xiàn)  I2C  集中  FPGA  視頻  基于  通信協(xié)議  

          基于BLF888設(shè)計(jì)的500W RF廣播發(fā)射方案

          • BLF888是500W LDMOS RF功率晶體管,用于廣播發(fā)射和工業(yè)應(yīng)用。在UHF頻帶470 MHz 到860 MHz可提供平均功率110W,峰值包絡(luò)功率500W,功率增益19dB,漏極效率46%,VDS 電壓50 V,漏極靜態(tài)電流1.3A。本文主要介紹了BLF888
          • 關(guān)鍵字: 廣播  發(fā)射  方案  RF  500W  BLF888  設(shè)計(jì)  基于  

          基于MAX19994A設(shè)計(jì)的雙路RF下變換方案

          • MAX19994A是雙路RF下變換器,RF范圍從1200MHz到2000MHz,LO范圍從1450MHz 到 2050MHz,IF范圍從50MHz到500MHz,典型的轉(zhuǎn)換增益為8.4dB,典型的噪音為9.8dB,輸入IP3典型值為+25dBm,輸入1dB壓縮點(diǎn)為+14dBm,單電源5.0V 或3.3
          • 關(guān)鍵字: 變換  方案  RF  雙路  MAX19994A  設(shè)計(jì)  基于  

          FPGA+DSP導(dǎo)引頭信號處理中FPGA設(shè)計(jì)的關(guān)鍵技術(shù)

          • 1引言隨著同防工業(yè)對精確制導(dǎo)武器要求的不斷提高,武器系統(tǒng)總體設(shè)計(jì)方案的日趨復(fù)雜,以及電子元器件水...
          • 關(guān)鍵字: FPGA+DSP  導(dǎo)引頭  信號處理  設(shè)計(jì)  

          利用VHDL語言進(jìn)行可變速彩燈控制器的設(shè)計(jì)

          • 0引言硬件描述語言(HDL)是相對于一般的計(jì)算機(jī)軟件語言如C,Pascal而言的。HDL是用于設(shè)計(jì)硬件電子系...
          • 關(guān)鍵字: VHDL  FPGA  CPLD  可變速  彩燈控制器  

          使用RapidIO技術(shù)搭建可重構(gòu)信號處理平臺

          • 摘要:軍事領(lǐng)域常選擇ADI公司的TS201芯片用于信號處理平臺,但由于其采用基于電路交換的LINK口進(jìn)行連接,...
          • 關(guān)鍵字: FPGA  RapidIO  可重構(gòu)  信號處理  DSP  LINK口  

          智能化電能計(jì)量技術(shù)提升能效,讓世界變得更環(huán)保

          • 引言我們都很熟悉那些隱藏在車庫、地下室或其它隱蔽之處的電表了。我們甚至可能每月會檢查它一次或...
          • 關(guān)鍵字: AMR  AMI  ADI  RF  

          Altium在Altium Designer軟件內(nèi)新增Aldec FPGA仿真技術(shù)

          •   Altium和Aldec日前簽署的OEM協(xié)議中決定將Aldec的FPGA仿真功能添加到Altium Designer軟件中去。   該協(xié)議的簽署使進(jìn)行FPGA(現(xiàn)場可編程門陣列)設(shè)計(jì)的電子產(chǎn)品設(shè)計(jì)師們?nèi)缁⑻硪?,業(yè)內(nèi)領(lǐng)先的Aldec VHDL及Verilog仿真功能實(shí)現(xiàn)了無縫集成,與Altium Designer軟件融為一體。電子產(chǎn)品設(shè)計(jì)師們可以在Altium電子產(chǎn)品設(shè)計(jì)統(tǒng)一架構(gòu)中使用久經(jīng)考驗(yàn)的Aldec仿真技術(shù)。   Altium首席執(zhí)行官Nick Martin表示:“多年來,Alti
          • 關(guān)鍵字: Altium  FPGA  Designer  

          基于FPGA實(shí)現(xiàn)多路模擬信號自適應(yīng)采集系統(tǒng)

          • 主要介紹基于FPGA實(shí)現(xiàn)多路模擬信號自適應(yīng)采集系統(tǒng)的設(shè)計(jì)。該系統(tǒng)主要包括軟件和硬件兩部分:硬件主要采用FPGA芯片,AD7982-1,ADG406和運(yùn)放AD824來搭建硬件平臺;軟件包括FPGA程序和事后數(shù)據(jù)處理程序。系統(tǒng)采用動態(tài)8位量化方式克服了固定8位量化對信號采集精度的影響,目前已成功用于產(chǎn)品中。
          • 關(guān)鍵字: FPGA  多路  采集系統(tǒng)  模擬信號    
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