使用新SRAM工藝實現(xiàn)嵌入式ASIC和SoC的存儲器設計,基于傳統(tǒng)六晶體管(6T)存儲單元的靜態(tài)RAM存儲器塊一直是許多嵌入式設計中使用ASIC/SoC實現(xiàn)的開發(fā)人員所采用的利器，因為這種存儲器結(jié)構非常適合主流的CMOS工藝流程，不需要增添任何額外的工藝步驟。如圖1a中所示的那樣
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SoC 存儲器 設計 ASIC 嵌入式 SRAM 工藝 實現(xiàn) 使用
FPGA入門知識，什么是FPGA？FPGA是英文Field Programmable Gate Array的縮寫，即現(xiàn)場可編程門陣列，它是在PAL、GAL、EPLD等可編程器件的基礎上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領域中的一種半定制電路
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fpga ASIC 什么意思
摘要：介紹了一種用于高級型數(shù)碼相機的彩色TFT液晶顯示控制電路的設計。文中首先簡單給出了控制電路的設計要求，然后重點介紹電路中各模塊的設計以及FPGA驗證。整個電路作為數(shù)碼相機專用集成電路芯片的一部分采用TSM
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ASIC 實現(xiàn) 電路設計 控制 TFT 液晶顯示 彩色
基于ARM9的SD/MMC卡控制器的ASIC設計,摘 要：文章闡述了基于TD-SCDMA手機數(shù)字基帶芯片中SD/MMC卡控制器的工作原理與應用，利用Verilog硬件描述語言對其實現(xiàn)。運用ModelSim進行了功能仿真，利用SMIC0.13微米工藝庫和SYNOPSYS的EDA工具對其綜合。經(jīng)過FPGA驗
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ASIC 設計 控制器 SD/MMC ARM9 基于
ASIC 和 FPGA 具有不同的價值主張，在作出選擇前必須仔細評估。兩種種技術對比。這里介紹了 ASIC 和 FPGA 的優(yōu)勢與劣勢:
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賽靈思 ASIC FPGA
現(xiàn)場可編程門陣列 (FPGA) 是由通過可編程互連連接的可配置邏輯塊 (CLB) 矩陣構成的可編程半導體器件。相對于專為特定設計定制構建的專用集成電路 (ASIC) 而言，F(xiàn)PGA 能通過編程來滿足應用和功能要求。
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賽靈思 FPGA ASIC
時鐘芯片廣泛地應用于各種需要記錄特定時間的設備中。對于便攜式設備，時鐘芯片的功耗對維持整個系統(tǒng)的正...
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時鐘芯片 低功耗 振蕩電路 ASIC
全球示波器市場的領導廠商—泰克公司日前宣布，榮獲了 ARM TechCon 軟件類“最佳產(chǎn)品獎“(Best in Show Award)。在最近收購了Veridae Systems后成立的泰克嵌入式儀器事業(yè)部憑借其針對ASIC和FPGA驗證與調(diào)試的 Clarus 和 Certus 工具而獲得了該獎項。
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泰克 示波器 ASIC
本文的研究目標是設計H．264標準中的Exp-Golomb解碼器，在對其算法進行深入探討的基礎上，提出了一種高效且低成本的ASIC實現(xiàn)方案。
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ASIC 設計 解碼器 Exp-Golomb H.264 基于
Analog Devices, Inc. (NYSE:ADI)，全球領先的高性能信號處理解決方案供應商及汽車行業(yè)的長期合作伙伴，近日榮獲2009-2010年度“博世最佳供應商大獎”。此項殊榮源于 ADI 在電子產(chǎn)品領域（ASIC 和 ASSP）的杰出服務，尤其是其所提供的模擬和混合信號產(chǎn)品專門針對具體應用而設計，完全符合汽車工業(yè)極高的質(zhì)量和可靠性標準。
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ADI ASIC
摘要：WCDMA基帶處理器上行方向采用QPSK調(diào)制方式與根升余弦脈沖成型濾波器產(chǎn)生3GPP WCDMA協(xié)議25．213 Release6中規(guī)定的基帶信號。文章介紹了QPSK調(diào)制與此同時脈沖成型的基本原理，并給出了該調(diào)制方式與成型濾波器的A
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濾波器 ASIC 實現(xiàn) 成型 脈沖 信號 QPSK 調(diào)制 基帶
一種ASIC硬件圖像匹配最大互相關算法的設計和實現(xiàn),圖像匹配是指通過一定的匹配算法在兩幅或多幅圖像之間識別同名點，如二維圖像匹配中通過比較目標區(qū)和搜索區(qū)中相同大小的窗口的相關系數(shù)，取搜索區(qū)中相關系數(shù)最大所對應的窗口中心點作為同名點。其實質(zhì)是在基元相似性
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相關 算法 設計 實現(xiàn) 最大 匹配 ASIC 硬件 圖像 一種
數(shù)字下變頻(DDC)中坐標變換模塊的ASIC實現(xiàn),數(shù)字下變頻器中坐標變換模塊的ASIC實現(xiàn)1．引言
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模塊 ASIC 實現(xiàn) 變換 坐標 變頻 DDC 數(shù)字
摘要：時鐘樹綜合是當今集成電路設計中的重要環(huán)節(jié)，因此在FFT處理器芯片的版圖設計過程中，為了達到良好的布局效果，采用時序驅(qū)動布局，同時限制了布局密度；為了使時鐘偏移盡可能少，采用了時鐘樹自動綜合和手動修改
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ASIC 后端設計 時鐘樹
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