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基于FPGA的數(shù)字濾波器設(shè)計(jì)
- 利用VHDL語(yǔ)言設(shè)計(jì)數(shù)字濾波器，主要在于如何實(shí)現(xiàn)乘法。乘法常用的實(shí)現(xiàn)方法有位串行乘法、分布式算法和并行乘法等。位串行乘法能節(jié)省大量硬件資源，但運(yùn)算周期過(guò)長(zhǎng)，對(duì)于數(shù)字濾波器這種高速率要求不宜采取。分布式算法是現(xiàn)在比較流行的一種乘法實(shí)現(xiàn)方式，所用硬件資源較少，運(yùn)算速率也較快，但這只是針對(duì)小位寬乘法來(lái)說(shuō)。對(duì)于數(shù)字濾波器的較大位寬的乘法，不宜采取。并行乘法，算法實(shí)現(xiàn)簡(jiǎn)單直觀，對(duì)于現(xiàn)在資源豐富的FPGA，很好實(shí)現(xiàn)
- 關(guān)鍵字： 濾波器 數(shù)字 FPGA VHDL
基于FPGA的多功能電子密碼鎖設(shè)計(jì)
- 0 引言 傳統(tǒng)機(jī)械鎖的防盜功能差，在現(xiàn)代高科技安防系統(tǒng)中無(wú)法起到作用，已逐步被更可靠、更智能的電子數(shù)字密碼鎖代替。目前市場(chǎng)上的大部分密碼鎖產(chǎn)品是以單片機(jī)為核心的，利用軟件進(jìn)行控制，實(shí)際應(yīng)用中系統(tǒng)穩(wěn)定性較差且成本高。本文研究的是電子密碼鎖的一種純硬件實(shí)現(xiàn)方案，為彌補(bǔ)傳統(tǒng)技術(shù)的不足，采用EDA技術(shù)在可編程芯片上實(shí)現(xiàn)密碼的存儲(chǔ)、運(yùn)算等操作，使產(chǎn)品既具有硬件的安全性和高速性，又具有軟件開(kāi)發(fā)的靈活性和易維護(hù)性。 1 主要技術(shù)與開(kāi)發(fā)環(huán)境 1.1 EDA技術(shù)及特點(diǎn) EDA(Electronic Design A
- 關(guān)鍵字： FPGA VHDL
基于FPGA的自動(dòng)加載系統(tǒng)設(shè)計(jì)實(shí)現(xiàn)
- 摘要：針對(duì)FPGA可以在每次上電時(shí)自動(dòng)獲取配置文件的需求，提出了一種由USB芯片和FLASH芯片、CPLD組成的可對(duì)FPGA上電后自動(dòng)加載的系統(tǒng)。該系統(tǒng)可以通過(guò)USB芯片和CPLD將PC中的FPGA配置文件寫(xiě)入FLASH芯片，并且在CPLD的控制下將配置文件以PS模式配置給FPGA。測(cè)試表明，該系統(tǒng)可以在上電時(shí)自動(dòng)對(duì)FPGA進(jìn)行加載，彌補(bǔ)了FPGA掉電后數(shù)據(jù)消失的不足。 0 引言 FPGA(Field Programmable Gate Array)即現(xiàn)場(chǎng)可編程門(mén)陣列，隨著微電子技術(shù)的發(fā)展，F(xiàn)PGA的
- 關(guān)鍵字： FPGA CPLD
基于FPGA的ARM并行總線設(shè)計(jì)與仿真分析
- 在數(shù)字系統(tǒng)的設(shè)計(jì)中，F(xiàn)PGA+ARM的系統(tǒng)架構(gòu)得到了越來(lái)越廣泛的應(yīng)用，F(xiàn)PGA主要實(shí)現(xiàn)高速數(shù)據(jù)的處理;ARM主要實(shí)現(xiàn)系統(tǒng)的流程控制。人機(jī)交互。外部通信以及FPGA控制等功能。I2C、SPI等串行總線接口只能實(shí)現(xiàn)FPGA和ARM之間的低速通信; 當(dāng)傳輸?shù)臄?shù)據(jù)量較大。要求高速傳輸時(shí)，就需要用并行總線來(lái)進(jìn)行兩者之間的高速數(shù)據(jù)傳輸。
- 關(guān)鍵字： FPGA ARM DATA VHDL 數(shù)據(jù)總線
基于FPGA的采集卡的圖像增強(qiáng)算法應(yīng)用研究
- 圖像在采集過(guò)程中不可避免地會(huì)受到傳感器靈敏度、噪聲干擾以及模數(shù)轉(zhuǎn)化時(shí)量化問(wèn)題等因素影響而導(dǎo)致圖像無(wú)法達(dá)到人眼的視覺(jué)效果，為了實(shí)現(xiàn)人眼觀察或者機(jī)器自動(dòng)分析的目的，對(duì)原始圖像所做的改善行為，就被稱(chēng)作圖像增強(qiáng)技術(shù)。
- 關(guān)鍵字： 傳感器 圖像增強(qiáng) FPGA PCI VHDL
基于VHDL的QPSK調(diào)制解調(diào)系統(tǒng)設(shè)計(jì)與仿真
- 文中詳細(xì)介紹了QPSK技術(shù)的工作原理和QPSK調(diào)制、解調(diào)的系統(tǒng)設(shè)計(jì)方案，并通過(guò)VHDL語(yǔ)言編寫(xiě)調(diào)制解調(diào)程序和QuaitusII軟件建模對(duì)程序進(jìn)行仿真，通過(guò)引腳鎖定，下載程序到FPGA芯片EP1K30TC144-3中驗(yàn)證。軟件仿真和硬件驗(yàn)證結(jié)果表明了該設(shè)計(jì)的正確性和可行性，由于采用FPGA芯片，減小了硬件設(shè)計(jì)的復(fù)雜性，該設(shè)計(jì)具有便于移植維護(hù)和升級(jí)的特點(diǎn)。
- 關(guān)鍵字： VHDL QPSK 調(diào)制解調(diào)系統(tǒng) 設(shè)計(jì)與仿真
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