(hdl)_技術(shù)資訊

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Verilog HDL基礎(chǔ)知識9之代碼規(guī)范示例

嵌入式系統(tǒng) FPGA verilog HDL 代碼規(guī)范 |2024-02-26
Verilog HDL基礎(chǔ)知識9之代碼規(guī)范

嵌入式系統(tǒng) FPGA verilog HDL 代碼規(guī)范 |2024-02-26
Verilog HDL基礎(chǔ)知識8之綜合語句

嵌入式系統(tǒng) FPGA verilog HDL 綜合語句 |2024-02-22
Verilog HDL基礎(chǔ)知識7之模塊例化

嵌入式系統(tǒng) FPGA verilog HDL 模塊例化 |2024-02-21
Verilog HDL基礎(chǔ)知識6之語法結(jié)構(gòu)

嵌入式系統(tǒng) FPGA verilog HDL 語法結(jié)構(gòu) |2024-02-21
Verilog HDL基礎(chǔ)知識4之阻塞賦值 & 非阻塞賦值

嵌入式系統(tǒng) FPGA verilog HDL 阻塞賦值非阻塞賦值 |2024-02-20
Verilog HDL基礎(chǔ)知識4之wire & reg

嵌入式系統(tǒng) FPGA verilog HDL wire reg |2024-02-20
Verilog HDL基礎(chǔ)知識3之抽象級別

嵌入式系統(tǒng) FPGA verilog HDL 抽象級別 |2024-02-19
Verilog HDL基礎(chǔ)知識2之運(yùn)算符

嵌入式系統(tǒng) FPGA verilog HDL 運(yùn)算符 |2024-02-19
Verilog HDL簡介&基礎(chǔ)知識1

嵌入式系統(tǒng) FPGA verilog HDL EDA |2024-01-29
實(shí)驗(yàn)22 4位串行累加器

嵌入式系統(tǒng) 累加器 FPGA Lattice Diamond Verilog HDL |2023-10-16
實(shí)驗(yàn)21：智力競賽搶答器

嵌入式系統(tǒng) 搶答器 FPGA Lattice Diamond Verilog HDL |2023-10-13
實(shí)驗(yàn)20：步進(jìn)電機(jī)2

工控自動化步進(jìn)電機(jī) FPGA Lattice Diamond Verilog HDL |2023-10-13
實(shí)驗(yàn)19：步進(jìn)電機(jī)1

工控自動化步進(jìn)電機(jī) FPGA Lattice Diamond Verilog HDL |2023-10-13
實(shí)驗(yàn)18：秒表計(jì)數(shù)器

模擬技術(shù) 秒表計(jì)數(shù)器 FPGA Lattice Diamond Verilog HDL |2023-10-12
實(shí)驗(yàn)17：分頻器

模擬技術(shù) 分頻器 FPGA Lattice Diamond Verilog HDL |2023-10-12
實(shí)驗(yàn)16：扭環(huán)形計(jì)數(shù)器

消費(fèi)電子扭環(huán)形計(jì)數(shù)器 FPGA Lattice Diamond Verilog HDL |2023-10-12
實(shí)驗(yàn)15：環(huán)形計(jì)數(shù)器

模擬技術(shù) 環(huán)形計(jì)數(shù)器 FPGA Lattice Diamond Verilog HDL |2023-10-11
實(shí)驗(yàn)14：移位寄存器

模擬技術(shù) 移位寄存器 FPGA Lattice Diamond Verilog HDL |2023-10-11
實(shí)驗(yàn)13：JK觸發(fā)器

消費(fèi)電子 JK觸發(fā)器 FPGA Lattice Diamond Verilog HDL |2023-10-11
實(shí)驗(yàn)12：邊沿觸發(fā)的D觸發(fā)器

模擬技術(shù) D觸發(fā)器 FPGA Lattice Diamond Verilog HDL |2023-10-10
實(shí)驗(yàn)11：RS觸發(fā)器

模擬技術(shù) RS觸發(fā)器 FPGA Lattice Diamond Verilog HDL |2023-10-10
實(shí)驗(yàn)10：七段數(shù)碼管

模擬技術(shù) 七段數(shù)碼管 FPGA Lattice Diamond Verilog HDL |2023-10-10
HDL仿真器基于事件的仿真算法

嵌入式系統(tǒng) HDL 仿真器 |2018-06-15
哈夫曼編碼的HDL實(shí)現(xiàn)

嵌入式系統(tǒng) 哈夫曼編碼 HDL |2018-02-06
智能家居多媒體聲光電同步演示系統(tǒng)方案

物聯(lián)網(wǎng)與傳感器 HDL 智能家居 |2017-10-27
新手福音：概述學(xué)習(xí)FPGA的一些常見誤區(qū)

嵌入式系統(tǒng) 可編程邏輯器件 FPGA HDL FPGA教程 |2017-10-21
把HDL模塊用NGC格式加密并在其他項(xiàng)目中調(diào)用

嵌入式系統(tǒng) NGC HDL |2017-10-13
Verilog HDL簡明教程(2)

嵌入式系統(tǒng) Verilog HDL |2017-10-11
Verilog HDL 設(shè)計(jì)模擬

嵌入式系統(tǒng) Verilog HDL 設(shè)計(jì)模擬 |2017-06-06
用硬件描述語言設(shè)計(jì)復(fù)雜數(shù)字電路的優(yōu)點(diǎn)

嵌入式系統(tǒng) Verilog HDL 虛擬接口聯(lián)盟 |2017-06-06
HDL語言種類

嵌入式系統(tǒng) HDL VHDL 種類 |2017-06-06
Verilog HDL和VHDL的比較

嵌入式系統(tǒng) Verilog VHDL HDL |2017-06-06
CPLD/FPGA在數(shù)字通信系統(tǒng)的應(yīng)用

嵌入式系統(tǒng) Verilog CPLD FPGA HDL 漢明碼 |2017-06-05
FPGA協(xié)處理器實(shí)現(xiàn)代碼加速的設(shè)計(jì)

嵌入式系統(tǒng) 協(xié)處理器代碼加速 HDL |2017-06-05
基于FPGA的自適應(yīng)均衡器的研究與設(shè)計(jì)

EDA/PCB 自適應(yīng)均衡器寬帶數(shù)字接收機(jī) FPGA Verilog HDL |2016-10-18
Verilog HDL設(shè)計(jì)進(jìn)階：有限狀態(tài)機(jī)的設(shè)計(jì)原理及其代碼風(fēng)格

EDA/PCB Verilog HDL 進(jìn)階代碼 |2016-10-18
Verilog HDL硬件描述語言：task和function說明語句的區(qū)別

EDA/PCB function Verilog task HDL |2016-10-18
基于FPGA的高速長線陣CCD驅(qū)動電路

EDA/PCB CCD 線陣 FPGA verilog HDL |2016-10-16
基于Verilog HDL的SVPWM算法的設(shè)計(jì)與仿真

模擬技術(shù) 同步電動機(jī) 電壓型逆變器 Verilog HDL |2016-10-16

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