基于FPGA的實(shí)驗(yàn)室可重構(gòu)信號(hào)源的設(shè)計(jì)
3.3 D/A轉(zhuǎn)換及調(diào)幅電路
如圖5所示,將波形存儲(chǔ)ROM的輸出通過(guò)D/A轉(zhuǎn)換電路轉(zhuǎn)換為模擬信號(hào),通過(guò)算法實(shí)現(xiàn)幅度控制并設(shè)置獨(dú)立按鍵執(zhí)行微調(diào),再通過(guò)濾波電路濾波,即可得到所需的波形。本文引用地址:http://www.ex-cimer.com/article/189605.htm
3.4 功率放大模塊
由于輸出信號(hào)的功率較小,輸出有負(fù)載時(shí),會(huì)有較大失真,帶負(fù)載能力差,要考慮到功率放大,對(duì)輸出的信號(hào)進(jìn)行放大。設(shè)計(jì)中功率放大采用功率放大芯片TDA2030A實(shí)現(xiàn),TDA2030A是意法半導(dǎo)體公司生產(chǎn)的單聲道功放IC,該IC體積小巧、輸出功率大、靜態(tài)電流小、動(dòng)態(tài)電流大、負(fù)載能力強(qiáng),既可帶動(dòng)4~16 Ω的負(fù)載,某些場(chǎng)合又可帶動(dòng)2 Ω甚至1.6 Ω的低阻負(fù)載,且性價(jià)比高,具體電路如圖6所示。
3.2 DDS的FPGA實(shí)現(xiàn)電路設(shè)計(jì)
DDS系統(tǒng)包括相位增量寄存器、相位累加器、地址寄存器、波形存儲(chǔ)器、時(shí)鐘倍頻器及地址發(fā)生部分等模塊,內(nèi)部所有模塊用Verilog語(yǔ)言編寫或調(diào)用QuartusⅡ中的已有l(wèi)pm庫(kù)文件。系統(tǒng)頂層設(shè)計(jì)用原理圖的方式進(jìn)行模塊間的連接,具體電路如圖4所示。當(dāng)改變波形存儲(chǔ)器中波形數(shù)據(jù)時(shí),也就改變了輸出波形,可以通過(guò)波形選擇按鈕分別輸出正弦波、方波、三角波3種波形。
3.3 D/A轉(zhuǎn)換及調(diào)幅電路
如圖5所示,將波形存儲(chǔ)ROM的輸出通過(guò)D/A轉(zhuǎn)換電路轉(zhuǎn)換為模擬信號(hào),通過(guò)算法實(shí)現(xiàn)幅度控制并設(shè)置獨(dú)立按鍵執(zhí)行微調(diào),再通過(guò)濾波電路濾波,即可得到所需的波形。
3.4 功率放大模塊
由于輸出信號(hào)的功率較小,輸出有負(fù)載時(shí),會(huì)有較大失真,帶負(fù)載能力差,要考慮到功率放大,對(duì)輸出的信號(hào)進(jìn)行放大。設(shè)計(jì)中功率放大采用功率放大芯片TDA2030A實(shí)現(xiàn),TDA2030A是意法半導(dǎo)體公司生產(chǎn)的單聲道功放IC,該IC體積小巧、輸出功率大、靜態(tài)電流小、動(dòng)態(tài)電流大、負(fù)載能力強(qiáng),既可帶動(dòng)4~16 Ω的負(fù)載,某些場(chǎng)合又可帶動(dòng)2 Ω甚至1.6 Ω的低阻負(fù)載,且性價(jià)比高,具體電路如圖6所示。
4 軟件設(shè)計(jì)
軟件設(shè)計(jì)采用C語(yǔ)言編寫。軟件主要由主程序、液晶子程序和按鍵子程序等組成。軟件主流程如圖7所示。系統(tǒng)加電后,主程序的功能主要是完成系統(tǒng)初始化,包括液晶、頻率幅度等參數(shù)的初始化,更新顯示數(shù)字,循環(huán)掃描按鍵,根據(jù)按鍵輸入分別進(jìn)行頻率幅度的設(shè)定,通過(guò)幅度控制字的設(shè)定向DAC輸出幅度控制字,通過(guò)頻率控制字的輸入向FPGA寫頻率控制字,從而達(dá)到改變輸出波形頻率和幅值的目的,并在液晶顯示器上顯示出來(lái)。顯示效果如圖8所示。
5 結(jié)束語(yǔ)
系統(tǒng)采用FPGA實(shí)現(xiàn)DDS電路,以AT89C51為主控制器,實(shí)現(xiàn)了輸出頻率范圍為1 Hz~10 MHz的正弦波、方波、三角波的信號(hào)發(fā)生器,并且幅值和頻率均可調(diào)節(jié),其最小步進(jìn)頻率可達(dá)1 Hz。測(cè)試結(jié)果表明,該設(shè)計(jì)具有頻帶寬、精度高、性能穩(wěn)定、成本低和操作界面友好等特點(diǎn)。用這種方法設(shè)計(jì)的波形發(fā)生器只要改變FPGA中ROM的數(shù)據(jù),DDS就可以產(chǎn)生任意波形,提高了設(shè)計(jì)的靈活性,降低了電路的復(fù)雜度,減少了電路設(shè)計(jì)時(shí)間和可能發(fā)生的錯(cuò)誤,具有較高的性價(jià)比。
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