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	 > EDA/PCB > 設(shè)計應(yīng)用 > 基于FPGA快速A 律壓縮編碼的設(shè)計與實(shí)現(xiàn)
          
    
          

          

          


	
	
	

          
	
          
		
          
			
          基于FPGA快速A 律壓縮編碼的設(shè)計與實(shí)現(xiàn)
          
						
          
				作者：
				時間：2010-03-29
				來源：網(wǎng)絡(luò)
				
				
				
				
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          4.1狀態(tài)機(jī)（state）
          為了使comp模塊間有序進(jìn)行工作，確保之間數(shù)據(jù)正確穩(wěn)定的傳輸，特引入狀態(tài)機(jī)對各模塊進(jìn)行數(shù)據(jù)讀、寫控制。 
          4.2比較單元（compare）

          圖3 comp單元流程圖（段內(nèi)碼單元）

           圖4 comp單元流程圖（段落碼單元）
          
				
            
          
                
			
							
          
                
			            
                            
              
            
          
		
          
		
          
		
          
		
          
		
          
			
            
				
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          關(guān)鍵詞：
            			            FPGA
                        壓縮編碼
                        
                        
            
          
            
			
          
		
          	
		

	

          
	
	
          
		
          
			
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