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cpld-jtag接口
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基于DSP和MAX1420的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)
- 基于DSP和MAX1420的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì),1 引言 數(shù)據(jù)采集系統(tǒng)是通信與信息技術(shù)領(lǐng)域中重要的功能模塊，應(yīng)用廣泛。而傳統(tǒng)的數(shù)據(jù)采集系統(tǒng)大多以單片機(jī)或中規(guī)模數(shù)字電路為核心，其模數(shù)轉(zhuǎn)換器(A／D轉(zhuǎn)換器)采樣速率較低。顯然傳統(tǒng)數(shù)據(jù)采集系統(tǒng)不能完全滿足高速
- 關(guān)鍵字： DSP 數(shù)據(jù) 采集 CPLD USB
在嵌入式設(shè)計(jì)中降低CPLD的功耗
- 在嵌入式設(shè)計(jì)中降低CPLD的功耗,從事便攜式或手持產(chǎn)品設(shè)計(jì)的工程師都明白對(duì)于如今的設(shè)計(jì)，最大限度地降低功耗是必不可少的要求。但是，只有經(jīng)驗(yàn)豐富的工程師理解盡可能地延長(zhǎng)系統(tǒng)的電池壽命的那些微妙但又重要的細(xì)節(jié)。本文中我們將重點(diǎn)放在這些經(jīng)驗(yàn)
- 關(guān)鍵字： 功耗 CPLD 降低 設(shè)計(jì) 嵌入式
基于CPLD和嵌入式系統(tǒng)的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)
- 基于CPLD和嵌入式系統(tǒng)的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn),介紹一種基于CPLD和嵌入式系統(tǒng)的高速數(shù)據(jù)采集系統(tǒng)，并詳細(xì)闡述了系統(tǒng)的結(jié)構(gòu)和軟硬件的實(shí)現(xiàn)方案。
關(guān)鍵詞：高速數(shù)據(jù)采集；CPLD；嵌入式系統(tǒng)Design and Implementation of Highspeed Data Sampling System Ba s - 關(guān)鍵字： 系統(tǒng) 設(shè)計(jì) 實(shí)現(xiàn) 數(shù)據(jù)采集 高速 嵌入式 基于 CPLD
基于CPLD的矩陣鍵盤掃描模塊設(shè)計(jì)
- 為了在不增加CPU工作負(fù)擔(dān)的前提下，實(shí)現(xiàn)標(biāo)準(zhǔn)鍵盤和矩陣鍵盤雙鍵盤同時(shí)工作，提出了一種基于復(fù)雜可編邏輯器件(CPLD)的矩陣鍵盤掃描方案，實(shí)現(xiàn)了在矩陣鍵盤狀態(tài)控制下CPLD自動(dòng)完成鍵盤掃描、編碼、輸出的功能，CPU通過(guò)定時(shí)器中斷服務(wù)程序定時(shí)查詢矩陣鍵盤狀態(tài)，并將按鍵值直接送入鍵盤緩沖區(qū)，供其他程序使用。給出了CPLD部分模塊的VHDL語(yǔ)言實(shí)現(xiàn)和仿真波形。在矩陣鍵盤的掃描、編碼、輸出完全不需CPU控制的前提下，實(shí)現(xiàn)標(biāo)準(zhǔn)鍵盤和矩陣鍵盤雙鍵盤同時(shí)使用。
- 關(guān)鍵字： CPLD 矩陣 鍵盤掃描 模塊設(shè)計(jì)
Altera發(fā)售新的MAX V CPLD系列
- 擴(kuò)展其最受歡迎的CPLD產(chǎn)品的供應(yīng)，Altera公司今天宣布推出MAX? V器件系列。與競(jìng)爭(zhēng)CPLD相比，MAX V系列總功耗降低了一半，同時(shí)保持了最初MAX系列獨(dú)特的瞬時(shí)接通、單芯片和非易失特性。 新的MAX V CPLD密度范圍在40到2,210個(gè)邏輯單元(LE)之間，具有低功耗和高性能特性，非常適合各類市場(chǎng)領(lǐng)域中的通用和便攜式設(shè)計(jì)，包括，固網(wǎng)、無(wú)線、消費(fèi)類、計(jì)算機(jī)/存儲(chǔ)、汽車電子和廣播等。
- 關(guān)鍵字： Altera CPLD
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