<meter id="pryje"><nav id="pryje"><delect id="pryje"></delect></nav></meter>
          <label id="pryje"></label>

          首頁(yè)  資訊  商機(jī)   下載  拆解   高校  招聘   雜志  會(huì)展  EETV  百科   問(wèn)答  電路圖  工程師手冊(cè)   Datasheet  100例   活動(dòng)中心  E周刊閱讀   樣片申請(qǐng)
          EEPW首頁(yè) >> 主題列表 >> dp-cpld

          基于CPLD及鎢錸熱電偶溫度傳感器的爆炸場(chǎng)溫度動(dòng)態(tài)測(cè)試

          • 為了測(cè)量爆炸場(chǎng)等惡劣環(huán)境下溫度的動(dòng)態(tài)變化,分析炸藥或相關(guān)彈藥的爆炸參數(shù),設(shè)計(jì)了基于CPLD的低功耗溫度存儲(chǔ)式測(cè)試系統(tǒng);運(yùn)用鎢錸熱電偶溫度傳感器匹配先進(jìn)的電源管理模塊,并結(jié)合動(dòng)態(tài)存儲(chǔ)測(cè)試技術(shù),能夠應(yīng)用于環(huán)境條件比較差的惡劣環(huán)境中,在可靠可信、微功耗的基礎(chǔ)上能得到較好的實(shí)驗(yàn)數(shù)據(jù)。
          • 關(guān)鍵字: 時(shí)序仿真  溫度測(cè)試  CPLD  

          基于ARM和CPLD的橫機(jī)機(jī)頭電路測(cè)試系統(tǒng)

          • 為解決電腦橫機(jī)機(jī)頭控制系統(tǒng)信號(hào)的測(cè)試可靠性問(wèn)題,基于低成本、高效率的考慮,研究設(shè)計(jì)了機(jī)頭控制系統(tǒng)電路板的批量測(cè)試系統(tǒng)。該系統(tǒng)采用TI公司的LM 3S5R31芯片作為系統(tǒng)的核心部分,通過(guò)CPLD進(jìn)行I/O擴(kuò)展及輔助控制,使得系統(tǒng)功能靈活強(qiáng)大。將同一信號(hào)通路中的前后級(jí)元件信號(hào)進(jìn)行編碼,向待測(cè)板發(fā)送握手信號(hào)并使之發(fā)送反饋信號(hào),該系統(tǒng)將反饋信號(hào)進(jìn)行采樣并在程序中比較計(jì)算,制作了實(shí)物并進(jìn)行了大量實(shí)驗(yàn)。
          • 關(guān)鍵字: 故障測(cè)試  I/O擴(kuò)展  CPLD  

          基于Verilog狀態(tài)機(jī)的PLC背板總線協(xié)議接口芯片設(shè)計(jì)

          • 設(shè)計(jì)了一組基于CPLD的PLC背板總線協(xié)議接口芯片,協(xié)議芯片可以區(qū)分PLC的背板總線的周期性數(shù)據(jù)和非周期性數(shù)據(jù)。詳細(xì)介紹了通過(guò)Verilog HDL語(yǔ)言設(shè)計(jì)狀態(tài)機(jī)、協(xié)議幀控制器、FIFO控制器的過(guò)程,25MHz下背板總線工作穩(wěn)定的試驗(yàn)結(jié)果驗(yàn)證了協(xié)議芯片設(shè)計(jì)的可行性。
          • 關(guān)鍵字: VerilogHDL  PLC背板  CPLD  

          基于DSP+CPLD的嵌入式車(chē)牌識(shí)別系統(tǒng)硬件電路設(shè)計(jì)

          • 基于數(shù)字信號(hào)處理器(DSP)TMS320VC5416和復(fù)雜可編程邏輯器件(CPLD)的嵌入式車(chē)牌識(shí)別系統(tǒng)的硬件設(shè)計(jì),利用視頻處理芯片SAA7111作為視頻A/D,在CPLD的控制下將采集到的圖像數(shù)據(jù)寫(xiě)入幀存儲(chǔ)器中,DSP對(duì)圖像數(shù)據(jù)進(jìn)行實(shí)時(shí)分析處理。采用“乒乓”存儲(chǔ)結(jié)構(gòu),實(shí)現(xiàn)了圖像數(shù)據(jù)的采集和處理的并行運(yùn)行。識(shí)別結(jié)果通過(guò)串口傳到上位機(jī)或者保存在E2PROM中,實(shí)現(xiàn)了車(chē)牌識(shí)別系統(tǒng)脫機(jī)、聯(lián)機(jī)工作,在實(shí)時(shí)高速圖像處理系統(tǒng)中有廣泛的工程技術(shù)應(yīng)用前景。
          • 關(guān)鍵字: 車(chē)牌識(shí)別系統(tǒng)  嵌入式  CPLD  

          基于CPLD的USB總線讀寫(xiě)控制功能的實(shí)現(xiàn)

          • 以CPLD作為主控芯片,設(shè)計(jì)了一種針對(duì)USB總線的數(shù)據(jù)讀寫(xiě)控制器。u盤(pán)通過(guò)該控制器轉(zhuǎn)接到Pc機(jī)的USB接口,利用控制器對(duì)usB總線上的數(shù)據(jù)進(jìn)行實(shí)時(shí)監(jiān)測(cè)分析,自動(dòng)禁止Pc機(jī)上的文件數(shù)據(jù)輸出到U盤(pán),同時(shí)不影響Pc機(jī)對(duì)u盤(pán)中文件的正常讀取。
          • 關(guān)鍵字: USB接口  讀寫(xiě)控制器  CPLD  

          可編程邏輯器件與單片機(jī)在雙控制器中的設(shè)計(jì)

          • 可編程邏輯器件的D觸發(fā)器資源非常有限,而且可編程邏輯器件在控制時(shí)序方面不如單片機(jī)那樣方便,很多不熟悉的應(yīng)用者往往感到應(yīng)用起來(lái)非常的困難。利用可編程邏輯器件和單片機(jī)構(gòu)成的雙向通信控制器克服了兩者的缺點(diǎn),且把二者的長(zhǎng)處最大限度地發(fā)揮出來(lái)。
          • 關(guān)鍵字: 可編程邏輯器件  雙控制器  AT89C51  CPLD  單片機(jī)  

          基于ARM和CPLD的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)(圖)

          • 數(shù)據(jù)采集系統(tǒng)是通過(guò)采樣電路將輸入的模擬信號(hào)轉(zhuǎn)換成離散信號(hào),并送入CPU、MCU或DSP進(jìn)行處理?,F(xiàn)在流行的基于PCI總線設(shè)計(jì)的采集卡是數(shù)據(jù)采集系統(tǒng)的主流,其優(yōu)點(diǎn)是可以利用PCI總線的研究成果快速的開(kāi)發(fā)系統(tǒng)軟件,整體運(yùn)行速度快,能夠?qū)崿F(xiàn)實(shí)時(shí)采集實(shí)時(shí)處理。但在一些工業(yè)測(cè)控現(xiàn)場(chǎng)檢測(cè)大型設(shè)備時(shí),從現(xiàn)場(chǎng)到機(jī)房有一定的距離,模擬信號(hào)傳到安裝在PC內(nèi)的PCI數(shù)據(jù)采集卡會(huì)有不同程度的衰減,且易受工業(yè)環(huán)境的干擾。而單純用由微控制器(MCU)為核心的數(shù)據(jù)采集系統(tǒng)時(shí),把數(shù)據(jù)采集器置于被監(jiān)測(cè)的設(shè)備處,雖然可以避免模擬信號(hào)的衰減和
          • 關(guān)鍵字: 數(shù)據(jù)采集  ARM  μC/OS-II  CPLD  

          在選用FPGA進(jìn)行設(shè)計(jì)時(shí)如何降低功耗

          • 傳統(tǒng)意義上,ASIC和CPLD是低功耗競(jìng)爭(zhēng)中當(dāng)仁不讓的贏家。但是由于相對(duì)成本較高,且用戶(hù)對(duì)高端性能和額外邏輯的要求也越來(lái)越多,在低功耗應(yīng)用中使用CPLD正在失去優(yōu)勢(shì)。ASIC也面臨相同的風(fēng)險(xiǎn)。而例如FPGA這樣日益增長(zhǎng)的可編程半導(dǎo)體器件正逐步成為備受青睞的解決方案。
          • 關(guān)鍵字: 低功耗  ASIC  CPLD  可編程半導(dǎo)體器件  

          基于AD7892SQ和CPLD的數(shù)據(jù)采集系統(tǒng)

          • 0 引 言  本系統(tǒng)以AD7892SQ和CPLD(復(fù)雜可編程邏輯器件)為核心設(shè)計(jì)了一個(gè)多路信號(hào)采集電路,包括模擬多路復(fù)用、集成放大、A/D轉(zhuǎn)換,CPLD控制等。采用硬件描述語(yǔ)言V
          • 關(guān)鍵字: EDA  CPLD  FPGA  

          分布式錄波器高精度同步時(shí)鐘信號(hào)的實(shí)現(xiàn)

          • 同步時(shí)鐘信號(hào)是分布式錄波器系統(tǒng)任務(wù)順利完成的關(guān)鍵。介紹一種利用可編程CPLD器件實(shí)現(xiàn)性能優(yōu)良的分布式同步信號(hào)源。通過(guò)高度集成,將IRIG-B(DC)解碼器以及系統(tǒng)的各種同步邏輯電路集成在一個(gè)MAXII570芯片中,構(gòu)成一個(gè)高精度同步系統(tǒng),從而達(dá)到最佳同步效果。
          • 關(guān)鍵字: 分布式同步邏輯  IRIG-B  CPLD  

          雙通道邏輯控制高速實(shí)時(shí)數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)

          • 設(shè)計(jì)了一種全新構(gòu)架的高性能數(shù)據(jù)采集系統(tǒng)。采用平衡式雙通道對(duì)稱(chēng)結(jié)構(gòu),可對(duì)32路輸入信號(hào)進(jìn)行靈活控制。系統(tǒng)中采用了高速A/D轉(zhuǎn)換器、大容量的FIFO SRAM、CPLD技術(shù)和PCI數(shù)據(jù)通信接口,實(shí)現(xiàn)了實(shí)時(shí)、高速的數(shù)據(jù)采集和處理。
          • 關(guān)鍵字: 高速實(shí)時(shí)數(shù)據(jù)采集  平衡式雙通道  CPLD  

          7種LED點(diǎn)陣顯示屏及其控制系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

          • LED點(diǎn)陣顯示屏是集微電子技術(shù)、計(jì)算機(jī)技術(shù)、信息處理技術(shù)于一體的大型顯示屏系統(tǒng)。它以其色彩鮮艷,動(dòng)態(tài)范圍廣,亮度高,壽命長(zhǎng),工作穩(wěn)定可靠等優(yōu)點(diǎn)而成為眾多顯示媒體以及戶(hù)外作業(yè)顯示的理想選擇。目前,已經(jīng)被廣泛應(yīng)用到軍事、車(chē)站、賓館、體育、新聞、金融、證券、廣告以及交通運(yùn)輸?shù)仍S多行業(yè)。
          • 關(guān)鍵字: LED點(diǎn)陣  控制系統(tǒng)  發(fā)光管  FPGA  CPLD  

          基于CPLD的ST-BUS總線收發(fā)模塊設(shè)計(jì)與實(shí)現(xiàn)

          •   引言  現(xiàn)代電信系統(tǒng)已發(fā)展為一個(gè)龐大的綜合化數(shù)字網(wǎng)絡(luò),除了提供傳統(tǒng)電話(huà)服務(wù)外,也提供多種數(shù)據(jù)接入服務(wù),其典型應(yīng)用是為其它專(zhuān)用通信系統(tǒng)提供數(shù)據(jù)中繼服務(wù)。因E1信號(hào)接入方式簡(jiǎn)單,一般電信交換機(jī)都會(huì)預(yù)留部分E1接入端口以供專(zhuān)用通信系統(tǒng)使用。為滿(mǎn)足電信網(wǎng)接入要求并充分利用線路資源,E1終端子系統(tǒng)內(nèi)部常采用ST-BUS總線對(duì)各路用戶(hù)數(shù)據(jù)進(jìn)行復(fù)接或解復(fù)接,并實(shí)現(xiàn)與E1信號(hào)的轉(zhuǎn)換??紤]到專(zhuān)用接口芯片針對(duì)某一種或幾種標(biāo)準(zhǔn)接口而設(shè)計(jì),已無(wú)法滿(mǎn)足所有接口標(biāo)準(zhǔn)(尤其是新型接口標(biāo)準(zhǔn))要求。為使各種接口都能與電信線路進(jìn)行數(shù)據(jù)交
          • 關(guān)鍵字: CPLD  ST-BUS  

          模塊化應(yīng)變監(jiān)測(cè)光纖組件的設(shè)計(jì)

          • 摘要 介紹了一種多通道應(yīng)變信號(hào)采集系統(tǒng)的模塊化設(shè)計(jì),解決了飛機(jī)強(qiáng)度監(jiān)測(cè)中應(yīng)用大批量電阻式應(yīng)變片數(shù)據(jù)采集和傳輸?shù)膯?wèn)題。該設(shè)計(jì)采用3級(jí)模塊級(jí)聯(lián)而成,可同時(shí)采集4096路應(yīng)變信號(hào)。利用CPLD實(shí)現(xiàn)對(duì)4096路模擬信號(hào)的數(shù)
          • 關(guān)鍵字: 飛機(jī)強(qiáng)度  應(yīng)變片  CPLD  

          FPGA雙雄公布季度財(cái)報(bào)數(shù)據(jù)顯示一片光明

          • FPGA供應(yīng)商Altera和賽靈思近日陸續(xù)公布了健康的財(cái)務(wù)數(shù)據(jù)。Altera公司四季度銷(xiāo)售額為4.544億美元,環(huán)比增長(zhǎng)2%同比增長(zhǎng)3%。賽靈思則為5.87億美元,環(huán)比下降了2%,但是同比激增15%。“受益于Kintex 7系列產(chǎn)品的熱
          • 關(guān)鍵字: FPGA  IP  嵌入式  PLD  CPLD  SoC  數(shù)字信號(hào)處理  消費(fèi)電子  FPGA  
          共775條 6/52 |‹ « 4 5 6 7 8 9 10 11 12 13 » ›|

          dp-cpld介紹

          您好,目前還沒(méi)有人創(chuàng)建詞條dp-cpld!
          歡迎您創(chuàng)建該詞條,闡述對(duì)dp-cpld的理解,并與今后在此搜索dp-cpld的朋友們分享。    創(chuàng)建詞條

          熱門(mén)主題

          DP-CPLD    樹(shù)莓派    linux   
          關(guān)于我們 - 廣告服務(wù) - 企業(yè)會(huì)員服務(wù) - 網(wǎng)站地圖 - 聯(lián)系我們 - 征稿 - 友情鏈接 - 手機(jī)EEPW
          Copyright ?2000-2015 ELECTRONIC ENGINEERING & PRODUCT WORLD. All rights reserved.
          《電子產(chǎn)品世界》雜志社 版權(quán)所有 北京東曉國(guó)際技術(shù)信息咨詢(xún)有限公司
          備案 京ICP備12027778號(hào)-2 北京市公安局備案:1101082052    京公網(wǎng)安備11010802012473
          看屁屁www成人影院,亚洲人妻成人图片,亚洲精品成人午夜在线,日韩在线 欧美成人 (function(){ var bp = document.createElement('script'); var curProtocol = window.location.protocol.split(':')[0]; if (curProtocol === 'https') { bp.src = 'https://zz.bdstatic.com/linksubmit/push.js'; } else { bp.src = 'http://push.zhanzhang.baidu.com/push.js'; } var s = document.getElementsByTagName("script")[0]; s.parentNode.insertBefore(bp, s); })();