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利用多目標建模技術(shù)降低ECU軟件成本
- 多目標建模是一種電子控制單元(ECU)開發(fā)技術(shù)，它采用了基于模型的設(shè)計方法和自動嵌入式代碼生成技術(shù)。利用多目標建模技術(shù)可以為各種嵌入式DSP、微處理器和微控制器建立算術(shù)模型，并實現(xiàn)代碼的自動生成。軟件開發(fā)人員也因此可以節(jié)省許多時間和精力，因為他們不再需要為每個嵌入式目標器件編寫、測試和重編代碼。 在這方面，Visteon公司正在使用多目標建模技術(shù)開發(fā)動力控制系統(tǒng)。他們的方法以數(shù)據(jù)字典的創(chuàng)建為基礎(chǔ)，而數(shù)據(jù)字典用來控制模型仿真和嵌入式代碼生成時使用的數(shù)據(jù)類型。利用這種方法可以仿真設(shè)計思路
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基于Nios II的多生理參數(shù)處理系統(tǒng)的設(shè)計
- 隨著醫(yī)療儀器設(shè)備向智能化、微型化、系列化、數(shù)字化和多功能方向的發(fā)展，醫(yī)療設(shè)備中邏輯控制器件也由采用中、小規(guī)模的集成芯片發(fā)展到應(yīng)用現(xiàn)場可編程門陣列FPGA(Field Programmable Gate Array)。使用FPGA器件可以大大縮短醫(yī)療設(shè)備的研制周期，減少開發(fā)成本，同時還可以很方便地對設(shè)計進行在線修改，因此FPGA在醫(yī)療設(shè)備中有很廣泛的應(yīng)用[1]。 本文主要搭建一個多生理參數(shù)測量系統(tǒng)的數(shù)據(jù)處理平臺，在FPGA中嵌入一個32位Nios II軟核處理器，用于控制數(shù)據(jù)的傳輸、存儲及顯示。主
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基于DSP的下一代車載娛樂系統(tǒng)
- 車載娛樂系統(tǒng)的技術(shù)發(fā)展趨勢正在變得日益復(fù)雜，通過銅纜發(fā)送音頻數(shù)據(jù)的簡單音頻系統(tǒng)已經(jīng)成為過去。為了滿足多通道音頻處理和分布式視頻的要求，復(fù)雜的網(wǎng)絡(luò)處理變得越來越流行。特別是與數(shù)字傳輸內(nèi)容保護(DTCP)加密和解密方法相關(guān)的面向媒體的系統(tǒng)傳輸(MOST)光網(wǎng)絡(luò)正在被許多高擋和中檔汽車采用，這種趨勢以及車載音頻系統(tǒng)通常必須以變化的采樣頻率適應(yīng)多種輸入源(調(diào)幅和調(diào)頻、CD、DVD、蜂窩電話和導(dǎo)航系統(tǒng)輸入)這個事實給數(shù)字信號處理器(DSP)供應(yīng)商增加了壓力，要求他們提供增強性能和更高集成度的處理器。 基于
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Xilinx推出全球性能最高的可配置DSP解決方案
- 全球可編程邏輯解決方案領(lǐng)導(dǎo)廠商賽靈思公司（ Xilinx, Inc. (NASDAQ: XLNX) ）今天宣布其屢獲殊榮的65nm Virtex-5 SXT FPGA平臺新增針對高性能數(shù)字信號處理（DSP）而優(yōu)化的Virtex™-5 SXT240T器件。該器件高達528GMACs的乘法累加性能和超過190 GFLOPS的單精度浮點DSP性能，為廣播視頻、醫(yī)療成像、無線通信、國防和高性能計算等應(yīng)用的開發(fā)人員提供了全球性能最高的可配置DSP解決方案。 “支持高分辨率（HD）視
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SVPWM信號發(fā)生器的VHDL實現(xiàn)
- 近年來，DSP在SVPWM(空間矢量脈寬調(diào)制)控制領(lǐng)域得到了廣泛應(yīng)用。 但是使用DSP單核心的控制方法仍然存在一些缺陷：基于軟件的：DSP在實現(xiàn)SVPWM觸發(fā)信號時需要較長的時鐘周期；微處理器中不確定的中斷響應(yīng)會導(dǎo)致PWM脈沖的相位抖動。針對以上問題，本文提出了一種利用FPGA實現(xiàn)的SVPWM信號發(fā)生器，系統(tǒng)結(jié)構(gòu)如圖1所示。作為DSP的外圍接口電路，該信號發(fā)生器能夠屏蔽DSP內(nèi)部錯誤中斷對輸入時間信號的影響，保證輸出完整的SVPWM觸發(fā)信號波形，其三相并行處理結(jié)構(gòu)還能夠有效提升系統(tǒng)的動態(tài)響應(yīng)速度
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Altera Quartus II軟件8.0開創(chuàng)高端FPGA的性能和效能最高水平
- 2008年5月20號，北京——Altera公司(NASDAQ: ALTR)今天發(fā)布Quartus® II軟件8.0，支持公司的40-nm Stratix® IV FPGA和HardCopy® ASIC，延續(xù)了公司在設(shè)計軟件性能和效能上的領(lǐng)先優(yōu)勢。和最相近的競爭軟件相比，這一版本的Quartus II軟件在高端FPGA上平均快出兩個速率等級，編譯時間縮短了3倍。8.0版增加了新的效能特性，支持業(yè)界最先進的FPGA，進一步印證了Altera幫助FPGA設(shè)計人
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ACTEL推出基于IGLOO FPGA的便攜控制解決方案
- ACTEL公司宣布推出兩款實現(xiàn)人機接口 (HMI) 和微型電機控制功能的插入式子卡，進一步擴展其基于業(yè)界最低功耗現(xiàn)場可編程門陣列 (FPGA) 的便攜式市場產(chǎn)品系列。新的HMI子卡和電機控制子卡將以Actel備受歡迎的IGLOO Icicle開發(fā)工具包的插件形式推出。Actel相信，這兩款產(chǎn)品與公司先前推出的IGLOO存儲及顯示開發(fā)板、設(shè)計樣例和IP核相結(jié)合，將構(gòu)成新的控制解決方案，可以提高Actel的5µW低功耗IGLOO FPGA在快速增長的便攜式市場上的份額。 Actel副總裁
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DSP技術(shù)協(xié)助進行高速串行數(shù)據(jù)分析
- 串行總線技術(shù)上的信號完整性測量已經(jīng)成為設(shè)計人員測量工作的重要組成部分，如PCI Express 2.0、串行ATA III和HDMI 1.3。一致性測試中遇到的許多問題源于波形上的不理想特點，如噪聲、抖動和定時畸變。串行標準縮窄了定時容限，要求測量工具中提供更多的帶寬和更高的精度。與此同時，還要求使測量本身的影響達到最小化。
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基于DSP的數(shù)字助聽器開拓
- 1、數(shù)字助聽器開拓是必然的技術(shù)支持 助聽器的設(shè)計具有嚴格的技術(shù)要求。助聽器必須足夠小的體積(以便置于人耳之中或其后部)、極低的運行功耗且不得引入噪聲或失真。為滿足這些要求，現(xiàn)有的助聽器件消耗的電流低于1mA，工作電壓為1V，并占用不到 的硅片面積(通常這意味著兩個或三個元件需要彼此堆疊放置)。 典型的模擬助聽器由具有非線性輸入/輸出功能以及頻率相關(guān)增益的放大器所組成。但是，與數(shù)字處理相比，這種模擬處理的缺點在于其依賴定制電路、不具備可編程性且成本較高。相比于同類模擬
- 關(guān)鍵字： DSP 數(shù)字助聽器 傳導(dǎo)型聽力損失 感覺神經(jīng)型聽力損失 集成電路
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