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賽靈思宣布SPARTAN-3A I/O優(yōu)化FPGA全線產(chǎn)品實現(xiàn)量產(chǎn)
- 賽靈思公司（Xilinx, Inc. ）今天宣布90nm I/O優(yōu)化的Spartan™-3A平臺全線產(chǎn)品實現(xiàn)量產(chǎn)。這些產(chǎn)品包括Spartan-3A平臺的全部五款器件：XC3S50A、XC3S200A、XC3S400A、XC3S700A和XC3S1400A。 隨著產(chǎn)品架構(gòu)的不斷演進和成本的迅速降低，賽靈思Spartan系列FPGA自從1998年推出以來，應(yīng)用范圍不斷擴展，目前已經(jīng)成為全球消費電子和汽車應(yīng)用設(shè)計人員的首選器件平臺。其主要應(yīng)用包括數(shù)字顯示、手機、PDA、汽車后座娛樂系統(tǒng)和
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DSP/BIOS環(huán)境下的數(shù)據(jù)通信
- 引 言 對于數(shù)字信號處理應(yīng)用來說，數(shù)據(jù)的通信很關(guān)鍵。在TI公司的DSP/BIOS環(huán)境下有3種通信方式，即基于管道（PIP，pipe）的通信、基于流（SIO，stream I/O）通道的通信以及基于主機（HST，host）通道的通信。每一種通信方式都是通過調(diào)度其相應(yīng)的內(nèi)核對象來完成的。DSP/BIOS提供了管理每一種通信方式的模塊及相應(yīng)地API調(diào)用，通過這些模塊及調(diào)用，可以完成DSP環(huán)境下的輸入/輸出 （I/O）。本文在對各種通信方式進行簡要介紹的基礎(chǔ)上,對各種通信方式進行比較，并給出利用PIP對象進行數(shù)
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采用靈活的汽車FPGA來提高片上系統(tǒng)級集成和降低物料成本
- 汽車制造商們堅持不懈地改進車內(nèi)舒適性、安全性、便利性、工作效能和娛樂性，反過來，這些努力又推動了各種車內(nèi)數(shù)字技術(shù)的應(yīng)用。然而，汽車業(yè)較長的開發(fā)周期卻很難跟上最新技術(shù)的發(fā)展，尤其是一直處于不斷變化中的車內(nèi)聯(lián)網(wǎng)規(guī)范，以及那些來自消費市場的快速興起和消失的技術(shù)，從而造成了較高的工程設(shè)計成本和大量過時。向這些組合因素中增加低成本目標(biāo)、擴展溫度范圍、高可靠性與質(zhì)量目標(biāo)和有限的物理板空間，以及汽車設(shè)計中存在的挑戰(zhàn)，最多使人進一步感到沮喪?？删幊踢壿嬈骷?nbsp;(PLD)，如現(xiàn)場可編程門陣列 (FPGA)
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Actel推出業(yè)界最低功耗的FPGA系列——IGLOO
- Actel 公司宣布推出業(yè)界最低功耗的現(xiàn)場可編程門陣列 (FPGA) -- IGLOO™ 系列。這個以 Flash 為基礎(chǔ)的產(chǎn)品系列的靜態(tài)功耗為5µW，是最接近競爭產(chǎn)品功耗的四分之一；與目前領(lǐng)先的PLD產(chǎn)品比較，更可延長便攜式應(yīng)用的電池壽命達5倍，因而奠定了低功耗的新標(biāo)準(zhǔn)。 由于便攜式產(chǎn)品的生命周期短及市場競爭激烈，設(shè)計人員必需不斷增加新的功能和復(fù)雜性，但卻不能耗用更多的電池能量。這個需求使到可重編程及全功能的Actel IGLOO 方案別具吸引力，足以取代ASIC和 C
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TMS320VC5402 DSP并行8bit EPROM引導(dǎo)裝載方法研究
- TMS320VC5402（以下簡稱C5402）是德州儀器公司（TI）推出的性價比極高的16bit定點數(shù)字信號處理器（DSP），操作速率可達100MIPS，它的內(nèi)部資源配置為用戶構(gòu)造系統(tǒng)提供了很大便利。 C5402芯片配置有4K
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基于 FPGA 的 MPEG-4 編解碼器
- 您是否曾想在您的FPGA設(shè)計中使用先進的視頻壓縮技術(shù)，卻發(fā)現(xiàn)實現(xiàn)起來太過復(fù)雜？現(xiàn)在您無需成為一名視頻專家就能在您的系統(tǒng)中使用視頻壓縮。賽靈思新推出的 MPEG-4 編碼器/解碼器核可以幫助您滿足視頻壓縮需求。 視頻和多媒體系統(tǒng)正變得日益復(fù)雜，因此能否獲得適用于您的系統(tǒng)的低成本的可靠 IP 核對您的產(chǎn)品上市極為關(guān)鍵。特別是，視頻壓縮算法與標(biāo)準(zhǔn)已變成極為復(fù)雜的電路，需要花費很長時間來設(shè)計，并且常常成為系統(tǒng)測試和發(fā)貨的瓶頸。這些 MPEG-4 簡易 (simple profile) 編碼器/解碼器核也許正好
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Altera推出低成本Arria GX FPGA系列
- Altera公司(NASDAQ: ALTR)今天宣布推出低成本Arria™ GX系列，繼續(xù)擴大了公司在收發(fā)器FPGA市場上的領(lǐng)先優(yōu)勢。Arria GX FPGA經(jīng)過優(yōu)化，支持速率高達2.5Gbps的PCI Express (PCIe)、千兆以太網(wǎng)(GbE)和Serial RapidIO™ (SRIO)標(biāo)準(zhǔn)；這些標(biāo)準(zhǔn)迅速成為很多市場和應(yīng)用領(lǐng)域的主流協(xié)議。Arria GX系列的特性包括成熟的Str
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2007年德州儀器公司大陸-臺灣兩岸高校DSP大獎賽
- 德州儀器（TI）在中國從2003年至今己成功舉辦了兩屆TI DSP大獎賽，有超過千名相關(guān)專業(yè)的大學(xué)生和研究生參加了大獎賽，展示出了當(dāng)代大學(xué)生和研究生的高超的數(shù)字信號處理的理論和實踐水平。為了進一步提升DSP在高校中的應(yīng)用開發(fā)水平，德州儀器決定舉辦2007年TI DSP大獎賽。 1、競賽宗旨： ----鼓勵中國的大學(xué)生熟練掌握先進的數(shù)字信號處理系統(tǒng)設(shè)計技術(shù)，激勵理工專業(yè)的學(xué)生使用TI的DSP產(chǎn)品，對算法和系統(tǒng)進行創(chuàng)新性的設(shè)計，培養(yǎng)大學(xué)生的創(chuàng)新能力、協(xié)作精神和理論聯(lián)系實際的學(xué)風(fēng)，促進校際之間在DSP系統(tǒng)科
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DSP的聲控電子記事本的設(shè)計與實現(xiàn)
- 語音識別及語音編解碼技術(shù)經(jīng)過幾十年的發(fā)展，已經(jīng)日趨成熟，步入實用化階段。語音識別技術(shù)已開始應(yīng)用于電話查詢服務(wù)、智能玩具、PDA、家用電器、通信、工業(yè)控制、語言學(xué)習(xí)等應(yīng)用領(lǐng)域；其于碼激勵線性預(yù)測（CELP）技術(shù)的語音編解碼算法也因其音質(zhì)好，壓縮比大而在通信和數(shù)字錄音設(shè)備中獲得了廣泛應(yīng)用。 語音輸入方式與手寫輸入方式相比，具有操作簡便、查找方便、識別準(zhǔn)確率高等優(yōu)點。省去了大量的輸入時間，降低了信息檢索的復(fù)雜度。本文所介紹的聲控電子記事本系統(tǒng)將語音識別和語音編解碼在同一片DSP芯片上實現(xiàn)，用語音方式代替
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亞科鴻禹發(fā)布新版FPGA原型驗證板StarFire6S-DARM
- 亞科鴻禹科技有限公司（HyperSilicon）于近日在北京推出了名為StarFire6S-DARM的系列新型FPGA原型驗證系統(tǒng)。該公司原有的StarFire5S-V系列主要針對各類視音頻SOC的設(shè)計驗證，被國內(nèi)設(shè)計公司廣泛采用累計達20多套。這款新的StarFire6S-DARM系列繼承了StarFire5S-V系列的大部分優(yōu)點，在容量、靈活性和性能指標(biāo)方面有了進一步提高，同時支持采用各類型ARMTM處理器的SOC驗證，從而適應(yīng)更廣泛的SOC/ASIC/IP/FPGA的原型驗證和算法實現(xiàn)的要求。
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利用以太網(wǎng)硬件在環(huán)路實現(xiàn)高帶寬DSP仿真
- 通常情況下，在設(shè)計基于FPGA的大型信號處理系統(tǒng)的時候，設(shè)計人員往往需要進行費時費力的仿真。以Xilinx System Generator for DSP為代表的FPGA設(shè)計工具，通過提供可靠的硬件在環(huán)接口（該接口可以直接將FPGA硬件置入設(shè)計仿真），來解決這種問題。 通過在硬件上模擬部分設(shè)計，這些接口可以大大提高仿真的速度——通?？梢蕴岣咭粋€甚至多個數(shù)量級。使用硬件在環(huán)還可以讓設(shè)計人員實時進行FPGA硬件調(diào)試和驗證。 System Generator for DSP 可以為多類FPGA開發(fā)平臺提供
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基于CPCI總線架構(gòu)設(shè)計的實時圖像信號處理平臺
- 摘要: 本文主要介紹了基于CPCI 總線設(shè)計的實時信號處理業(yè)務(wù)所需的一種專用設(shè)備平臺。關(guān)鍵詞： CPCI BUS；平臺；實時信號處理；DSP+FPGA 系統(tǒng)設(shè)計DSP+FPGA混用設(shè)計為了提高算法效率，實時處理圖像信息，本處理系統(tǒng)是基于DSP+FPGA混用結(jié)構(gòu)設(shè)計的。業(yè)務(wù)板以FPGA為處理核心，實現(xiàn)數(shù)字視頻信號的實時圖像處理，DSP實現(xiàn)了部分的圖像處理算法和FPGA的控制邏輯，并響應(yīng)中斷，實現(xiàn)數(shù)據(jù)通信和存儲實時信號。首先，本系統(tǒng)要求DSP可以滿足算法控制結(jié)構(gòu)復(fù)雜、運算速度高、尋址靈
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DSP程序構(gòu)造的加密體制
- 目前，DSP以其卓越的性能、獨有的特點，已經(jīng)成為通信、計算機、消費類電子產(chǎn)品等領(lǐng)域的基礎(chǔ)器件。同時，隨著對知識產(chǎn)權(quán)的重視，在利用DSP進行產(chǎn)品設(shè)計時，如何保護自己的成果，防止破譯者竊取，也成為設(shè)計者工作在一個重要方面[1,2]。如果產(chǎn)品大批量生產(chǎn)，那么可以利用掩膜技術(shù)等工藝將操作程序及數(shù)據(jù)寫入芯片，使它們不能被讀出，達到保護的效果。對于還沒有形成規(guī)模的產(chǎn)品，使用這樣的方法就會使成本大大增加。因此，本文提出一種方法，利用3DES、Geffe發(fā)生器和MD5等算法，構(gòu)造一種加密體制，來保護DSP程序。 1
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