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FPGA所需的電源供應(yīng)：深入分析
- 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
- 關(guān)鍵字： 美國國家半導(dǎo)體公司 FPGA DC/DC
Xilinx向DSP又邁一步，Spartan-DSP出臺
- 4月16日，Xilinx宣布首次推出低成本 Spartan-DSP 系列產(chǎn)品以及相應(yīng)的開發(fā)板和增強設(shè)計軟件。該芯片提供了高達20GMACS(每秒十億次乘法累計)的DSP功能，而價格不到30美元。與同類高性能可配置DSP器件相比，該系列產(chǎn)品的動態(tài)功耗降低多達50%。新推出Spartan-DSP系列之后，Xilinx的XtremeDSP產(chǎn)品線就有了三個針對DSP優(yōu)化的平臺，這樣，工程師能夠選擇滿意的器件性能組合來滿足其應(yīng)用要求，并可方便地實現(xiàn)不同平臺間的設(shè)計移植。作為Spartan-DSP系列中的第一個平臺，
- 關(guān)鍵字： 0705_A DSP Xilinx 單片機 嵌入式系統(tǒng) 雜志_業(yè)界風(fēng)云
基于FPGA的IDE硬盤接口卡的實現(xiàn)
- 引言 本文采用FPGA實現(xiàn)了IDE硬盤接口協(xié)議。系統(tǒng)提供兩套符合ATA-6規(guī)范的IDE接口，一個與普通IDE硬盤連接，另一個與計算機主板上的IDE接口相連。系統(tǒng)采用FPGA實現(xiàn)接口協(xié)議，完成接口數(shù)據(jù)的截獲、處理（在本文中主要是數(shù)據(jù)加密）和轉(zhuǎn)發(fā)，支持PIO和Ultra DMA兩種數(shù)據(jù)傳輸模式。下面重點介紹用FPGA實現(xiàn)接口協(xié)議的方法。 1 IDE接口協(xié)議簡介 1.1 IDE接口引腳定義 IDE（Integrated Drive Electronics）即“電子集成驅(qū)動器”，又稱為ATA接口。表1列
- 關(guān)鍵字： FPGA IDE硬盤 單片機 嵌入式系統(tǒng) 存儲器
視頻監(jiān)控的數(shù)字革命
- 視頻監(jiān)控的歷史可以追溯到上個世紀(jì)的60年代。1965年，美國有媒體建議政府在公共場所安裝監(jiān)控攝像頭，對犯罪進行預(yù)防和監(jiān)控，到1969年第一個警用攝像頭出現(xiàn)在紐約市政大廳的周邊高樓上。到今天，監(jiān)控攝像頭在全球任意一個大都市的公共場所都是隨處可見。 在這40年里，監(jiān)控系統(tǒng)經(jīng)歷了可錄像、CCD傳感器和數(shù)字多路技術(shù)三次革新，如今隨著數(shù)字技術(shù)的發(fā)展和網(wǎng)絡(luò)的普及，傳統(tǒng)的閉路電視（CCTV）和錄像系統(tǒng)的弊端日漸明顯，更加智能的IP數(shù)字視頻監(jiān)控成為大勢所趨。
- 關(guān)鍵字： ASIC DSP 工業(yè)控制 視頻監(jiān)控 工業(yè)控制
賽靈思推出新型完整FPGA解決方案
- 賽靈思公司宣布推出支持DDR2 SDRAM接口的低成本Spartan™-3A FPGA開發(fā)套件、支持多種高性能存儲器接口（I/Fs）的Virtex™-5 FPGA 開發(fā)平臺(ML-561) ，以及存儲器接口生成器（MIG）軟件1.7版本。這些完整的解決方案使FPGA用戶能夠快速實施并驗證在不同數(shù)據(jù)速率和總線寬度下的專用存儲器接口設(shè)計，從而加快產(chǎn)品的上市時間。 這些包括器件特性描述、數(shù)據(jù)輸入電路以及存儲器控制器的解決方案，均已在使用了美光科技公司（Micron Techn
- 關(guān)鍵字： FPGA 單片機 嵌入式系統(tǒng) 賽靈思
賽靈思推出65nm FPGA一周年：VIRTEX-5 FPGA率先實現(xiàn)量產(chǎn)
- 賽靈思公司日前隆重宣布，其屢獲殊榮的65nm Virtex-5 FPGA系列兩款器件LX50 和 LX50T最先實現(xiàn)量產(chǎn)。自2006年5月15日推出65nm Virtex-5 FPGA平臺以來，賽靈思目前已向市場發(fā)售了三款平臺（LX、LXT和SXT）的13種器件，它們?yōu)榭蛻籼峁┝藷o需任何折衷的業(yè)界最高的性能、最低的功耗， 并擁有業(yè)界唯一內(nèi)建的PCI Express®™ 端點和千兆以太網(wǎng)模塊，以及業(yè)界最高的DSP性能。 賽靈思公司高級產(chǎn)品部執(zhí)行副總裁Iain Morris 表示
- 關(guān)鍵字： 65nm FPGA VIRTEX-5 單片機 嵌入式系統(tǒng) 賽靈思
CEVA推出新一代CEVA-TeakLite-III DSP架構(gòu)
- CEVA公司宣布推出以廣泛應(yīng)用的DSP內(nèi)核TeakLite系列為基礎(chǔ)的第三代DSP架構(gòu) -- CEVA-TeakLite-III™。這個功能豐富的32位本地架構(gòu)與先前的CEVA-TeakLite™內(nèi)核版本后向兼容，可為3G手機、高清 (HD) 音頻、互聯(lián)網(wǎng)語音 (VoIP) 和便攜式音頻設(shè)備等要求嚴(yán)苛的應(yīng)用提供更高的性能和更低的功耗。 與CEVA-TeakLite架構(gòu)兼容的DSP首次能夠提供32位的本地處理能力，當(dāng)中包括32 x 32 MAC單元，可為先進的音
- 關(guān)鍵字： CEVA CEVA-TeakLite-III DSP 單片機 嵌入式系統(tǒng)
32位DSP設(shè)計中的流水線數(shù)據(jù)相關(guān)問題及解決辦法
- 引言 在航空微電子中心的某預(yù)研項目中，需要開發(fā)設(shè)計某32位浮點通用數(shù)字信號處理器(DSP)。本系統(tǒng)控制通路部分的設(shè)計采用超級哈佛及五級流水線結(jié)構(gòu)。本文分析了該流水線的設(shè)計過程，并對遇到的數(shù)據(jù)相關(guān)問題提出了一種新的解決方法。 1 流水線結(jié)構(gòu) 流水線處理器一般把一條指令的執(zhí)行分成幾個步驟，或稱為級(stages)。每一級在一個時鐘周期內(nèi)完成，也就是說在每個時鐘周期，處理器啟動并執(zhí)行一條指令。如果處理器的流水線有m級，則同時可重疊執(zhí)行的指令總條數(shù)為m。由于每條指令處在不同的執(zhí)行階段，因此，如果分級分得
- 關(guān)鍵字： DSP 單片機 嵌入式系統(tǒng) 數(shù)據(jù)
TI針對視頻監(jiān)控應(yīng)用推出兩款達芬奇DSP
- 日前，德州儀器(TI)針對視頻安全監(jiān)控應(yīng)用推出了TMS320DM647與TMS320DM648兩款全新達芬奇(DaVinci)技術(shù)數(shù)字信號處理器（DSPs）。TI致力于通過領(lǐng)先的軟硬件技術(shù)、工具與支持不斷推動數(shù)字視頻市場創(chuàng)新，以滿足包括數(shù)碼錄像機(DVR)、IP視頻服務(wù)器、機器視覺系統(tǒng)與高性能成像應(yīng)用等在內(nèi)的多通道視頻安全與基礎(chǔ)局端應(yīng)用的要求。兩款新品建立在TI最新TMS320C64x+TMDSP內(nèi)核基礎(chǔ)上，為基于TMS320DM642的現(xiàn)有視頻處理應(yīng)用提供了無縫移植路徑，在降低整體成本的同時實現(xiàn)性能雙倍
- 關(guān)鍵字： DSP TI 電子
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