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fpga+dsp 文章進(jìn)入fpga+dsp技術(shù)社區(qū)

系統(tǒng)級芯片設(shè)計語言和驗證語言的發(fā)展

作者：韓俊剛時間：2006-02-1117:08:15來自：西安郵電學(xué)院ASIC設(shè)計中心簡介：由于微電子技術(shù)的迅速發(fā)...
關(guān)鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

FPGA設(shè)計中關(guān)鍵問題的研究

隨著FPGA(FieldProgrammableGateArray)容量、功能以及可靠性的提高，其在現(xiàn)代數(shù)字通信系統(tǒng)中的應(yīng)用日漸廣...
關(guān)鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

讓Verilog仿真狀態(tài)機(jī)時可以顯示狀態(tài)名

Situation:我們平時使用Verilog進(jìn)行狀態(tài)機(jī)編碼時，通常使用parameter對狀態(tài)名進(jìn)行定義，這樣寫Case語句的時候...
關(guān)鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

基于Nios的DDS高精度信號源實現(xiàn)

摘要：直接數(shù)字頻率合成器DDS具有極高的分辨率、頻率轉(zhuǎn)換速度快、相位噪聲低等優(yōu)點。以ALTERA公司的CPU軟核Ni...
關(guān)鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

FPGA系統(tǒng)設(shè)計實戰(zhàn)經(jīng)驗分享FPGA系統(tǒng)設(shè)計實戰(zhàn)經(jīng)驗分享

這個帖子主要和大家介紹一些我們在FPGA硬件系統(tǒng)設(shè)計過程中遇到的問題和解決的方法。也歡迎大家一起參與討論...
關(guān)鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

FPGA基礎(chǔ)入門

IP（IntellectualProperty）就是常說的知識產(chǎn)權(quán)。美國Dataquest咨詢公司將半導(dǎo)體產(chǎn)業(yè)的IP定義為用于ASIC、AS...
關(guān)鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

讓生物識別技術(shù)成為FPGA動態(tài)部分重配置功能的“殺手級”應(yīng)用

　　摘要：我們在本項工作中解決的問題是：證實部分重配置適用于基于生物識別特性的復(fù)雜個人識別算法的開發(fā);運(yùn)用二維設(shè)計抽象層對功能進(jìn)行空間和時間的管理。　　關(guān)鍵詞：生物識別;指紋識別;FPGA;部分重配置　　自動指紋識別系統(tǒng) 　　指紋識別是自動個人識別技術(shù)中使用的最常見、最可靠的技術(shù)。大體上，實現(xiàn)的技術(shù)將自動指紋識別(AFAS) 劃分為在不同時間和不同條件下執(zhí)行的兩個階段：登記和識別。
關(guān)鍵字：生物識別 FPGA 201102

全景圖像實時展開在FPGA上的實現(xiàn)

　　摘要：全景攝像機(jī)可以使用一個攝像頭獲取周圍360°的環(huán)境信息，與以往的多攝像機(jī)獲取方法相比大大節(jié)省了硬件資源，并且在還原全景圖時避免了多畫面拼接產(chǎn)生的“鬼影”問題。但由于反射式全景攝像機(jī)獲取的畫面為極坐標(biāo)視圖，為適應(yīng)人眼觀察習(xí)慣需要對其進(jìn)行展開。本文在FPGA上實現(xiàn)了對反射式全景圖像的實時展開，在27MHz系統(tǒng)時鐘的驅(qū)動，生成122萬像素的展開圖像達(dá)到了21.97fps的幀速。　　
關(guān)鍵字： FPGA 全景攝像機(jī)

一種微光視頻處理系統(tǒng)的設(shè)計方案

0 引言　　微光視頻系統(tǒng)在夜視技術(shù)上用途越來越廣泛，然而由于目標(biāo)照度很低、目標(biāo)和背景反射系數(shù)很接近、觀察環(huán)境不好等惡劣的條件下，得到的微光視頻圖像總是得不到滿意的效果。我國現(xiàn)有的硬件生產(chǎn)能力的條件下，
關(guān)鍵字：視頻 ARM DSP LCD

歐勝發(fā)布第一款可編程獨立音頻數(shù)字信號處理器

　　歐勝微電子有限公司日前發(fā)布了其前所未有的第一款完全可編程獨立音頻數(shù)字信號處理器(DSP, 產(chǎn)品編號為WM0010)，以及一系列音效增強(qiáng)軟件，從而在提供完整高清晰度(HD)音頻的征途上又邁出了新的一步。　　WM0010是市面上同類產(chǎn)品中，率先裝備了低功耗、高性能Tensilica HiFi DSP內(nèi)核的產(chǎn)品之一。通過與應(yīng)用處理器前后協(xié)同工作，它將歐勝的低功耗音頻協(xié)處理器與嵌入式系統(tǒng)軟件、算法和軟件支持整合在一起，使智能電話、平板電腦和電視的制造商能夠集成他們自己的軟件部件來構(gòu)建個性化的音頻解決方案，
關(guān)鍵字：歐勝 DSP WM0010

基于DSP實現(xiàn)的PWM整流回饋系統(tǒng)的設(shè)計

基于DSP實現(xiàn)的PWM整流回饋系統(tǒng)的設(shè)計, 摘要：本文主要介紹了基于DSP實現(xiàn)的PWM整流回饋系統(tǒng)的設(shè)計。該設(shè)計可以做到輸入電流正弦、單位功率因數(shù)、直流母線電壓輸出穩(wěn)定，具有良好的動態(tài)性能并可實現(xiàn)能量的雙向流動（即四象限運(yùn)行），最終給出實驗波形，
關(guān)鍵字： DSP 控制器模擬信號采集 CPLD

一種具備遠(yuǎn)程多加載的DSP系統(tǒng)方案設(shè)計

一種具備遠(yuǎn)程多加載的DSP系統(tǒng)方案設(shè)計, 引言　　芯片的燒寫與自加載是一個DSP系統(tǒng)能夠順利運(yùn)行的基本條件。在DSP加載技術(shù)方面已經(jīng)有大量文獻(xiàn)和工作成果，比較好地解決了DSP自加載方面的許多基本問題。而傳統(tǒng)的燒寫／加載方案在調(diào)試、更新程序時需要反復(fù)外
關(guān)鍵字： DSP 控制通信

基于FPGA 的嵌入式塊SRAM 的設(shè)計

摘　要：文章中提出了一種應(yīng)用于FPGA 的嵌入式可配置雙端口的塊存儲器。該存儲器包括與其他電路的布線接口、可配置邏輯、可配置譯碼、高速讀寫電路。在編程狀態(tài)下，可對所有存儲單元進(jìn)行清零，且編程后為兩端口獨立
關(guān)鍵字： FPGA SRAM 嵌入式

FPGA市場潛力無限

　　伴隨著通信、工業(yè)、軍事、汽車，以及消費類電子市場的強(qiáng)勁反彈，幾乎每一家分析機(jī)構(gòu)都毫無例外的預(yù)測FPGA市場2011年以及未來會有較大的增長。來自IC Insight的數(shù)據(jù)顯示，2010年P(guān)LD的市場增長率超過了45%，達(dá)到48億美元。預(yù)計到2014年，總市值將進(jìn)一步增加到70億美元，排名整個半導(dǎo)體行業(yè)增速最快的第三位?！　?/li>
關(guān)鍵字： Xilinx FPGA

基于FPGA的多級小波逆變換實時系統(tǒng)設(shè)計

針對JPEG2000解碼系統(tǒng)中的核心處理模塊――離散小波逆變換(IDWT)，提出了一種基于FPGA的多級小波逆變換的高速、實時的硬件解決方案。仿真驗證表明本方案能夠滿足連續(xù)輸入的數(shù)據(jù)進(jìn)行實時處理的要求，并且所設(shè)計的系統(tǒng)具有功耗低、成本低等優(yōu)點。
關(guān)鍵字： FPGA 多級小波逆變換實時系統(tǒng)

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利用FPGA資源和最小模擬電路發(fā)電進(jìn)行開關(guān)電源設(shè)計的方法
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