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基于FPGA的人工神經(jīng)網(wǎng)絡(luò)系統(tǒng)的實(shí)現(xiàn)方法
- 摘要：為了改變?nèi)斯ど窠?jīng)網(wǎng)絡(luò)的研究?jī)H僅局限于算法，只是在通用的串行或并行計(jì)算機(jī)上模擬實(shí)現(xiàn)的現(xiàn)狀，針對(duì)函數(shù)逼近問(wèn)題，將BP神經(jīng)網(wǎng)絡(luò)的結(jié)構(gòu)分為3個(gè)模塊，采用VHDL語(yǔ)言完成對(duì)各個(gè)模塊的硬件描述，并使用Altera公司的Q
- 關(guān)鍵字： FPGA 人工神經(jīng) 網(wǎng)絡(luò)系統(tǒng) 實(shí)現(xiàn)方法
直接數(shù)字頻率合成DDS原理及基于FPGA的實(shí)現(xiàn)
- 直接數(shù)字頻率合成技術(shù)(DirectDigitalSynthesis，DDS)是一種從相位概念出發(fā)直接合成所需要的波形的新的...
- 關(guān)鍵字： DDS FPGA 數(shù)字通信系統(tǒng)
基于DSP的單兵背負(fù)式短波數(shù)字通信系統(tǒng)
- 基于DSP的單兵背負(fù)式短波數(shù)字通信系統(tǒng),二十一世紀(jì)的戰(zhàn)爭(zhēng)將以數(shù)字化戰(zhàn)場(chǎng)為背景,而數(shù)字化戰(zhàn)場(chǎng)的一個(gè)重要特點(diǎn)是信息可以直達(dá)單個(gè)士兵。采用基于軟件無(wú)線電的思想,應(yīng)用第三代數(shù)字信號(hào)處理器 TMS320C31和數(shù)模轉(zhuǎn)換芯片TLC32044等器件構(gòu)成短波自適應(yīng)調(diào)制解調(diào)器的
- 關(guān)鍵字： DSP 通信 A/D 存儲(chǔ)器 電池
實(shí)時(shí)視頻數(shù)據(jù)采集的FPGA實(shí)現(xiàn)
- 摘 要： 介紹一種在工礦監(jiān)視系統(tǒng)中采用FPGA實(shí)現(xiàn)視頻數(shù)據(jù)實(shí)時(shí)采集和顯示的設(shè)計(jì)方案。系統(tǒng)中采用FPGA和視頻解碼器實(shí)現(xiàn)了高速連續(xù)的視頻數(shù)據(jù)采集與處理。處理后的視頻信號(hào)通過(guò)VGA格式轉(zhuǎn)換，可以在現(xiàn)場(chǎng)VGA顯示器
- 關(guān)鍵字： FPGA 實(shí)時(shí)視頻 數(shù)據(jù)采集
基于DSP的OQPSK調(diào)制器設(shè)計(jì)與實(shí)現(xiàn)
- 針對(duì)OQPSK(偏移正交相移鍵控)調(diào)制原理，提出了在C54系列DSP處理器上實(shí)現(xiàn)OQPSK調(diào)制器的一種新方案，給出了其在CCS(C5000)開(kāi)發(fā)環(huán)境下的仿真波形并在硬件平臺(tái)上進(jìn)行了實(shí)驗(yàn)驗(yàn)證。實(shí)驗(yàn)表明，所設(shè)計(jì)的調(diào)制器具有體積小、功耗低及穩(wěn)定可靠等優(yōu)點(diǎn)。
- 關(guān)鍵字： 設(shè)計(jì) 實(shí)現(xiàn) 調(diào)制器 OQPSK DSP 基于
嵌入式系統(tǒng)設(shè)計(jì)與應(yīng)用 使用SBC和DSP
- 嵌入式系統(tǒng)設(shè)計(jì)與應(yīng)用 使用SBC和DSP,1 引言
嵌入式系統(tǒng)是以應(yīng)用為中心、以計(jì)算機(jī)技術(shù)為基礎(chǔ)、軟硬件可裁剪、適應(yīng)應(yīng)用系統(tǒng)對(duì) 功能、可靠性、成本、體積、功耗等有嚴(yán)格要求的專(zhuān)用計(jì)算機(jī)系統(tǒng)。其主要由嵌入式處理器、 相關(guān)支撐硬件、嵌入式操作系統(tǒng)及應(yīng) - 關(guān)鍵字： DSP
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