fpga：quartusⅡ 文章 進(jìn)入fpga：quartusⅡ技術(shù)社區(qū)
基于FPGA的慢門限恒虛警處理電路設(shè)計及其仿真
- 雷達(dá)信號的檢測多是在干擾背景下進(jìn)行，如何從干擾中提取目標(biāo)信號，不僅要求有一定的信噪比，而且必需有恒虛警處理設(shè)備。恒虛警處理是雷達(dá)信號處理的重要組成部分，慢門限恒虛警處理主要是針對接收機(jī)熱噪聲，文中介紹一種基于FPGA嵌入式設(shè)計的慢門限恒虛警處理電路，給出了仿真模型及仿真結(jié)果，并已將其用于某檢測器中，取得了良好的經(jīng)濟(jì)效益。
- 關(guān)鍵字： 慢門限恒虛警處理電路 內(nèi)部噪聲 FPGA
基于Xilinx FPGA的DCM動態(tài)重配置方法研究及實現(xiàn)
- 介紹了Xilinx FPGA中DCM的結(jié)構(gòu)和相關(guān)特性，提出了一種基于Xilinx FPGA的DCM動態(tài)重配置的原理方法，并給出了一個具體的實現(xiàn)系統(tǒng)。系統(tǒng)僅通過外部和Xilinx XC4VFX100相連的少數(shù)控制線，就可以在輸入100 MHz時鐘源的條件下，對DCM進(jìn)行50～300 MHz范圍內(nèi)準(zhǔn)確、快速地變頻。本設(shè)計系統(tǒng)具有接口簡單、實時性強(qiáng)、穩(wěn)定性高等特點，目前已成功應(yīng)用到某星載系統(tǒng)中。
- 關(guān)鍵字： DCM配置 時鐘源 FPGA
并行CRC算法在FPGA上的實現(xiàn)
- 循環(huán)冗余碼校驗CRC（Cyclic Redundancy Check）廣泛用于通訊領(lǐng)域和數(shù)據(jù)存儲的數(shù)據(jù)檢錯?；贔PGA在通訊領(lǐng)域和數(shù)據(jù)存儲的應(yīng)用越來越廣泛,CRC的編碼解碼模塊已經(jīng)是FPGA上的常用模塊了。采用超前位計算實現(xiàn)CRC在FPGA上的并行運算,通過實際應(yīng)用證明該算法能有效實現(xiàn)硬件的速度與資源合理平衡。
- 關(guān)鍵字： 數(shù)據(jù)檢錯 CRC FPGA
基于FPGA的ISA總線／MMи總線接口轉(zhuǎn)換設(shè)計
- 某型導(dǎo)彈測試設(shè)備控制總線為通用的ISA總線，而通信接口總線為非標(biāo)準(zhǔn)的MMи總線。在此以FPGA為核心設(shè)計了一種ISA總線／MMи總線轉(zhuǎn)換電路，該電路可以完成2種制式的數(shù)據(jù)和控制指令轉(zhuǎn)換。給出了轉(zhuǎn)換電路原理框圖、FPGA配置電路和地址比較電路原理圖。實驗結(jié)果表明該電路具有轉(zhuǎn)換數(shù)據(jù)準(zhǔn)確，工作可靠等優(yōu)點。實際應(yīng)用表明，該電路完全能達(dá)到測試設(shè)備的要求。
- 關(guān)鍵字： MMи總線 測試設(shè)備 FPGA
基于ARM和FPGA的服務(wù)機(jī)器人運動控制系統(tǒng)研究
- 介紹了一種基于ARM和FPGA的嵌入式控制系統(tǒng)，該系統(tǒng)既能獨立運行又能在計算機(jī)輔助下運行，是一種兼具柔性和開放性的系統(tǒng)。利用ARM的強(qiáng)大的數(shù)據(jù)流轉(zhuǎn)換功能和FPGA的快速配置能力，實現(xiàn)硬件可重構(gòu)。給出了系統(tǒng)的總體結(jié)構(gòu)、ARM和FPGA之間的通信設(shè)計，重點給出了基于NiosII的嵌入式可重構(gòu)底層控制設(shè)計，PWM功能模塊在FPGA上的實現(xiàn)。設(shè)計的系統(tǒng)集成度高、靈活。實驗表明系統(tǒng)具有高可靠性，能滿足服務(wù)機(jī)器人外圍器件多樣性控制的要求。ARM和FPGA不僅可以并行運行處理數(shù)據(jù)，其之間又可以互相通信，實現(xiàn)了系統(tǒng)的擴(kuò)展
- 關(guān)鍵字： 硬件可重構(gòu) NiosII FPGA
基于FPGA/SOPC的預(yù)測控制器設(shè)計與實現(xiàn)
- 針對模型預(yù)測控制在微型設(shè)備及嵌入式系統(tǒng)應(yīng)用中的實時性問題,從硬件實現(xiàn)控制算法的角度研究了基于FPGA（field programmable gate array）的預(yù)測控制器的設(shè)計和實現(xiàn)。采用基于Nios II嵌入式軟核處理器的FPGA/SOPC（system on pro-grammable chip,可編程片上系統(tǒng)）方案,在FPGA芯片上構(gòu)建SOPC系統(tǒng),設(shè)計SOPC的硬件及軟件系統(tǒng),實現(xiàn)了基于FPGA的預(yù)測控制器;建立了基于FPGA和dSPACE系統(tǒng)的實時仿真平臺,并進(jìn)行了控制器實時仿真實驗。實時
- 關(guān)鍵字： 模型預(yù)測控制 SOPC FPGA
基于FPGA的數(shù)字視頻接口轉(zhuǎn)換設(shè)備
- 本文從實際應(yīng)用的角度出發(fā)，采用FPGA作為主控芯片，設(shè)計了一款數(shù)字視頻接口轉(zhuǎn)換設(shè)備，該設(shè)備針對于MT9M111這款數(shù)字圖像傳感器產(chǎn)生的ITU-R BT.656格式數(shù)據(jù)進(jìn)行采集、色彩空間變換、分辨率轉(zhuǎn)換等操作，完成了從ITU-R BT.656格式數(shù)據(jù)到DVI格式數(shù)據(jù)的轉(zhuǎn)換，使得MT9M111數(shù)字圖像傳感器的BT656數(shù)據(jù)格式圖像能夠以1280×960(60Hz)和1280×1024(60Hz)兩種顯示格式在DVI-I接口的顯示器上顯示，并且還具有圖像靜止功能，在系統(tǒng)空閑時的待機(jī)狀態(tài)實現(xiàn)了整機(jī)的低功耗，適用于
- 關(guān)鍵字： 圖像分辨率 視頻接口轉(zhuǎn)換 FPGA
基于ATE的FPGA測試
- 隨著集成電路技術(shù)的飛速發(fā)展，F(xiàn)PGA的應(yīng)用越來越廣泛，其測試技術(shù)也得到了廣泛重視和研究。文章簡要介紹了FPGA的發(fā)展及其主要組成部分，提出了一種用ATE對FPGA進(jìn)行測試的方法和具體測試流程。
- 關(guān)鍵字： AutomaticTestEquipment 配置數(shù)據(jù) FPGA
基于FPGA的DDS IP核設(shè)計及仿真
- 以Altera公司的QuartusⅡ7．2作為開發(fā)工具，研究了基于FPGA的DDS IP核設(shè)計，并給出基于Signal TapⅡ嵌入式邏輯分析儀的仿真測試結(jié)果。將設(shè)計的DDS IP核封裝成為SOPC Builder自定義的組件，結(jié)合32位嵌入式CPU軟核NiosII，構(gòu)成可編程片上系統(tǒng)(SOPC)，利用極少的硬件資源實現(xiàn)了可重構(gòu)信號源。該系統(tǒng)基本功能都在FPGA芯片內(nèi)完成，利用SOPC技術(shù)，在一片F(xiàn)PGA芯片上實現(xiàn)了整個信號源的硬件開發(fā)平臺，達(dá)到既簡化電路設(shè)計、又提高系統(tǒng)穩(wěn)定性和可靠性的目的。
- 關(guān)鍵字： 直接數(shù)字頻率合成 IP核 FPGA
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