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          七個訣竅了解如何設(shè)計小型藍(lán)牙可穿戴醫(yī)療設(shè)備

          • 對于開發(fā)人員來說,構(gòu)建小型的藍(lán)牙醫(yī)療設(shè)備不僅僅是從市場上選擇最小的硬件,也需要通過優(yōu)化物料清單(BOM)來減小產(chǎn)品的尺寸和成本。使用Silicon Labs(亦稱“芯科科技”)集成的藍(lán)牙SoC和模塊,除了具備超低功耗和極小封裝的優(yōu)勢外,還能夠提供醫(yī)療應(yīng)用所需的各種外設(shè)功能和特性,從而節(jié)省大量PCB占地面積,增強設(shè)計靈活性并降低成本。幾十年來,芯科科技一直與許多醫(yī)療設(shè)備制造商合作。由于這些成功的合作,我們已經(jīng)開發(fā)了幾個與無線醫(yī)療應(yīng)用相關(guān)的功能,并將它們集成到我們的藍(lán)牙SoC和模塊中。在這篇博客中,我們將解釋
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          Altera MAX10: 交通燈控制

          • 簡易交通燈:本節(jié)將向您介紹Verilog語法之中的精髓內(nèi)容——狀態(tài)機,并且將利用狀態(tài)機實現(xiàn)十字路口的交通燈。====硬件說明與實現(xiàn)項目框圖====上圖為十字路口交通示意圖分之路與主路,要求如下:交通燈主路上綠燈持續(xù)15s的時間,黃燈3s的時間,紅燈10s的時間;交通燈支路上綠燈持續(xù)7s的時間, 黃燈持續(xù)3秒的時間,紅燈18秒的時間;根據(jù)上述要求,狀態(tài)機設(shè)計框架分析如下:S1:主路綠燈點亮,支路紅燈點亮,持續(xù)15s的時間;S2:主路黃燈點亮,支路紅燈點亮,持續(xù)3s的時間;S3:主路紅燈點亮,支路綠燈點亮,持
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          Lattice MXO2: 交通燈控制

          • 簡易交通燈:本節(jié)將向您介紹Verilog語法之中的精髓內(nèi)容——狀態(tài)機,并且將利用狀態(tài)機實現(xiàn)十字路口的交通燈。硬件說明與實現(xiàn)項目框圖上圖為十字路口交通示意圖分之路與主路,要求如下: * 交通燈主路上綠燈持續(xù)15s的時間,黃燈3s的時間,紅燈10s的時間; * 交通燈支路上綠燈持續(xù)7s的時間, 黃燈持續(xù)3秒的時間,紅燈18秒的時間;根據(jù)上述要求,狀態(tài)機設(shè)計框架分析如下: * S1:主路綠燈點亮,支路紅燈點亮,持續(xù)15s的時間; * S2:主路黃燈點亮,支路紅燈點亮,持續(xù)3s的時間; * S3:主路紅燈點亮,支
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          Lattice MXO2: LED呼吸燈

          • 呼吸燈:本節(jié),我們將通過脈寬調(diào)制技術(shù)來實現(xiàn)“呼吸燈”,實現(xiàn)LED的亮度由最暗逐漸增加到最亮,再逐漸變暗的過程。 脈沖寬度調(diào)制(PWM:Pulse Width Modulation),簡稱脈寬調(diào)制。它是利用微控制器的數(shù)字輸出調(diào)制實現(xiàn),是對模擬電路進行控制的一種非常有效的技術(shù),廣泛應(yīng)用于測量、通信、功率控制與變換等眾多領(lǐng)域。硬件說明呼吸燈的設(shè)計較為簡單,我們使用12MHz的系統(tǒng)時鐘作為高頻信號做分頻處理,調(diào)整占空比實現(xiàn)PWM,通過LED燈LD1指示輸出狀態(tài)。實現(xiàn)原理如上圖所示,脈沖信號的周期為T,高電平脈沖寬
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          小而美FPGA為邊緣AI賦能

          • 1? ?小型和中端FPGA服務(wù)嵌入式AI領(lǐng)域?萊迪思經(jīng)過40多年的發(fā)展,目前擁有公司歷史上最強大的產(chǎn)品組合,其針對AI優(yōu)化、低功耗FPGA解決方案主要面向小型和中端FPGA市場。萊迪思旨在滿足客戶對各種網(wǎng)絡(luò)邊緣應(yīng)用日益增長的智能需求,提供超強適應(yīng)性的解決方案,幫助客戶跟進不斷發(fā)展的AI算法。萊迪思提供包括嵌入式AI在內(nèi)的領(lǐng)先的解決方案,服務(wù)于工業(yè)、汽車、通信、計算和消費類應(yīng)用。萊迪思sensAI?解決方案集合幫助客戶實現(xiàn)最新的工廠自動化和工業(yè)機器視覺應(yīng)用,其低功耗FPGA提供
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          創(chuàng)新加速,英特爾以全矩陣FPGA助產(chǎn)業(yè)智能化發(fā)展

          • 近日,以“創(chuàng)新加速,塑造FPGA芯未來”為主題的2023年英特爾? FPGA中國技術(shù)日在北京成功舉行。期間,英特爾不僅披露了包括Agilex? 3系列、Agilex? 5系列在內(nèi)的多款FPGA產(chǎn)品細(xì)節(jié)及其早期驗證計劃,同時亦分享了與產(chǎn)業(yè)伙伴在數(shù)據(jù)中心、AI、網(wǎng)絡(luò)、嵌入式等關(guān)鍵領(lǐng)域的諸多應(yīng)用,旨在以逐步擴大的產(chǎn)品組合進一步滿足廣泛細(xì)分市場需求的同時,深度展示英特爾在加速可編程創(chuàng)新、推動中國行業(yè)數(shù)智化進程上的重要作用。英特爾可編程方案事業(yè)部中國總經(jīng)理葉唯琛表示,“在新場景、新應(yīng)用海量增長的驅(qū)動下,中國本地市場
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          Altera MAX10: 計時控制

          • 計時控制在之前的實驗中我們掌握了如何進行時鐘分頻、如何進行數(shù)碼管顯示與按鍵消抖的處理,那么在本節(jié)實驗之中,我們將會實現(xiàn)一個籃球賽場上常見的24秒計時器。====硬件說明====在之前的實驗中我們?yōu)樽x者詳細(xì)介紹過小腳丫MXO2板卡上的按鍵、數(shù)碼管、LED等硬件外設(shè),在此不再贅述。本節(jié)將實現(xiàn)由數(shù)碼管作為顯示模塊,按鍵作為控制信號的輸入(包含復(fù)位信號和暫停信號),Altera MAX10作為控制核心的籃球讀秒系統(tǒng),實現(xiàn)框圖如下:====Verilog代碼====// *****************
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          Lattice MXO2: 計時控制

          • Warning: file_get_contents(https://www.eetree.cn/wiki/_media/%E8%AE%A1%E6%97%B6%E5%99%A8%E6%A1%86%E5%9B%BE.png?w=800&tok=0acdce): failed to open stream: HTTP request failed! HTTP/1.1 403 Forbidden in /var/www/html/www.edw.com.cn/www/rootapp/controll
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          Altera MAX10: 按鍵消抖

          • 按鍵消抖在之前的實驗中我們學(xué)習(xí)了如何用按鍵作為FPGA的輸入控制,在本實驗中將學(xué)習(xí)如何進行按鍵消抖,用按鍵完成更多的功能。====硬件說明====按鍵是一種常用的電子開關(guān),電子設(shè)計中不可缺少的輸入設(shè)備。當(dāng)按下時使開關(guān)導(dǎo)通,松開時則開關(guān)斷開,內(nèi)部結(jié)構(gòu)是靠金屬彈片來實現(xiàn)通斷。按鍵抖動的原理抖動的產(chǎn)生 :通常的按鍵所用的開關(guān)為機械彈性開關(guān),當(dāng)機械觸點斷開、閉合時,由于機械觸點的彈性作用,一個按鍵開關(guān)在閉合時不會馬上穩(wěn)定地接通,在斷開時也不會一下子斷開。因而在閉合及斷開的瞬間均伴隨有一連串的抖動,為了不產(chǎn)生這種現(xiàn)
          • 關(guān)鍵字: 消抖  FPGA  Lattice Diamond  小腳丫  

          Lattice MXO2: 按鍵消抖

          • 按鍵消抖在之前的實驗中我們學(xué)習(xí)了如何用按鍵作為FPGA的輸入控制,在本實驗中將學(xué)習(xí)如何進行按鍵消抖,用按鍵完成更多的功能。硬件說明按鍵是一種常用的電子開關(guān),電子設(shè)計中不可缺少的輸入設(shè)備。當(dāng)按下時使開關(guān)導(dǎo)通,松開時則開關(guān)斷開,內(nèi)部結(jié)構(gòu)是靠金屬彈片來實現(xiàn)通斷。按鍵抖動的原理抖動的產(chǎn)生 :通常的按鍵所用的開關(guān)為機械彈性開關(guān),當(dāng)機械觸點斷開、閉合時,由于機械觸點的彈性作用,一個按鍵開關(guān)在閉合時不會馬上穩(wěn)定地接通,在斷開時也不會一下子斷開。因而在閉合及斷開的瞬間均伴隨有一連串的抖動,為了不產(chǎn)生這種現(xiàn)象而作的措施就是
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          熱烈祝賀!2023中國大學(xué)生工創(chuàng)賽各地區(qū)選拔賽圓滿結(jié)束

          • 自9月22日開始,2023年中國大學(xué)生工程實踐與創(chuàng)新能力大賽選拔賽在全國各省市陸續(xù)展開,10月29日北京、海南、新疆等區(qū)域選拔賽成功舉辦,也為今年的選拔賽畫上了圓滿的句號。在此,向那些成功晉級國賽的選手們致以熱烈祝賀,同時也期待他們在11月份即將舉辦的國賽中的卓越表現(xiàn)。眾所周知,今年工創(chuàng)賽國賽的賽制有所調(diào)整。從大賽官網(wǎng)中公布的賽制信息我們可以看到,今年增設(shè)了全新的新能源車賽道,要求參賽隊自主創(chuàng)意設(shè)計并制作一臺具有方向控制功能的電動車,該電動車在根據(jù)紅軍長征路線設(shè)計的競賽場地上順序前行,并在規(guī)定的標(biāo)志點進行
          • 關(guān)鍵字: 大學(xué)生工創(chuàng)賽  大學(xué)生工程實踐與創(chuàng)新能力大賽  夢之墨  PCB  

          Altera MAX10: LED流水燈

          • 在時鐘分頻實驗中我們練習(xí)了如何處理時鐘,接下來我們要學(xué)習(xí)如何利用時鐘來完成時序邏輯。====硬件說明====流水燈實現(xiàn)是很常見的一個實驗,雖然邏輯比較簡單,但是里面也包含了實現(xiàn)時序邏輯的基本思想。要用FPGA實現(xiàn)流水燈有很多種方法,在這里我們會用兩種不同的方法實現(xiàn)。1,模塊化設(shè)計:在之前的實驗中我們做了3-8譯碼器和時鐘分頻,如果把這兩個結(jié)合起來,我們就能搭建一個自動操作的流水LED顯示??驁D如下:2,循環(huán)賦值:這是一種很簡潔的實現(xiàn)流水燈效果邏輯,就是定義一個8位的變量,在每個時鐘上升沿將最低位賦值給最高
          • 關(guān)鍵字: 流水燈  FPGA  Lattice Diamond  小腳丫  

          Lattice MXO2: LED流水燈

          • 在時鐘分頻實驗中我們練習(xí)了如何處理時鐘,接下來我們要學(xué)習(xí)如何利用時鐘來完成時序邏輯。硬件說明流水燈實現(xiàn)是很常見的一個實驗,雖然邏輯比較簡單,但是里面也包含了實現(xiàn)時序邏輯的基本思想。要用FPGA實現(xiàn)流水燈有很多種方法,在這里我們會用兩種不同的方法實現(xiàn)。1,模塊化設(shè)計:在之前的實驗中我們做了3-8譯碼器和時鐘分頻,如果把這兩個結(jié)合起來,我們就能搭建一個自動操作的流水LED顯示。框圖如下:2,循環(huán)賦值:這是一種很簡潔的實現(xiàn)流水燈效果邏輯,就是定義一個8位的變量,在每個時鐘上升沿將最低位賦值給最高位,其他位右移一
          • 關(guān)鍵字: 流水燈  FPGA  Lattice Diamond  小腳丫  

          PCB的抄板五大步驟

          • 抄板,就是在已經(jīng)有電子產(chǎn)品和電路板實物的前提下,利用反向技術(shù)手段對電路板進行逆向解析。將原有產(chǎn)品的文件、物料清單、原理圖等技術(shù)文件進行1:1的還原操作,然后再利用這些技術(shù)文件和生產(chǎn)文件進行制板、元件焊接、電路板調(diào)試,完成原電路樣板的整個復(fù)制?!?拿一塊PCB板,首先需要在紙上記錄好所有元氣件的型號、參數(shù)以及位置,尤其是二極管、三級管的方向,IC缺口的方向。用數(shù)碼相機拍兩張元器件位置的照片。· 拆掉所有元件,要將PAD孔里的錫去掉;用酒精將板子擦洗干凈,然后放入掃描儀,在掃描儀掃描的時候要稍調(diào)高一下掃描的像
          • 關(guān)鍵字: PCB  抄板  

          利用搭載全域硬2D NoC的FPGA器件去完美實現(xiàn)智能化所需的高帶寬低延遲計算

          • 隨著大模型、高性能計算、量化交易和自動駕駛等大數(shù)據(jù)量和低延遲計算場景不斷涌現(xiàn),加速數(shù)據(jù)處理的需求日益增長,對計算器件和硬件平臺提出的要求也越來越高。發(fā)揮核心器件內(nèi)部每一個計算單元的作用,以更大帶寬連接內(nèi)外部存儲和周邊計算以及網(wǎng)絡(luò)資源,已經(jīng)成為智能化技術(shù)的一個重要趨勢。這使得片上網(wǎng)絡(luò)(Network-on-Chip)這項已被提及多年,但工程上卻不容易實現(xiàn)的技術(shù)再次受到關(guān)注。作為一種被廣泛使用的硬件處理加速器,F(xiàn)PGA可以加速聯(lián)網(wǎng)、運算和存儲,其優(yōu)點包括計算速度與ASIC相仿,也具備了高度的靈活性,能夠為數(shù)據(jù)
          • 關(guān)鍵字: 2D NoC  FPGA  
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