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一種眼科B型超聲診斷議
- 摘要：介紹一種以Winbond公司的W78E58單片機為控制核心，并采用FPGA和大容量FIFO等器件構(gòu)成的眼科B型超聲診斷儀。闡述了眼科超聲診斷儀的基本原理，使用FIFO作為數(shù)據(jù)共享RAM實現(xiàn)采樣和顯示相對獨立的模塊化設(shè)計方案以及FPGA在該設(shè)計中的具體應(yīng)用。 20世紀50年代初超聲探測開始應(yīng)用于醫(yī)學領(lǐng)域至今，超聲診斷技術(shù)已有了長足的進展。超聲診斷儀更是形式多樣，型號繁多。 超聲診斷儀通常按三種方法分類，它們是：①按圖像信息的獲取方法分類，由此可分為反射法超 聲診斷儀、多普勒法超聲診斷儀和透射法超
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Nios II系統(tǒng)在數(shù)字式心電診監(jiān)測設(shè)備中的應(yīng)用
- （1、武漢科技學院 河北 武漢 430073；2、華中科技大學 同濟醫(yī)學院河北 武漢 430000） 1 引言心電檢測儀是醫(yī)學界運用廣泛的一種心電監(jiān)測設(shè)備，他主要由12導聯(lián)心電傳感器和心電信號處理設(shè)備兩部分組成，目前運用廣泛的數(shù)字式心電檢測儀大都是由DSP處理器外加一個單片機（MCU），通過編寫復雜的并行通訊協(xié)議來完成的，這種結(jié)構(gòu)雖然有較高的精度，但硬件設(shè)計復雜，軟件編寫煩瑣，相應(yīng)的開發(fā)周期長，研制成本高。本設(shè)計采用Altera公司先進的SOPC（可編程片上系統(tǒng)）解決方案--以32位Nios I
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基于FPGA的數(shù)字式心率計
- 心率計是常用的醫(yī)學檢查設(shè)備，實時準確的心率測量在病人監(jiān)控、臨床治療及體育競賽等方面都有著廣泛的應(yīng)用。心率測量包括瞬時心率測量和平均心率測量。瞬時心率不僅能夠反映心率的快慢。同時能反映心率是否勻齊；平均心率雖只能反映心率的快慢，但記錄方便，因此這兩個參數(shù)在測量時都是必要的。 測量心率有模擬和數(shù)字兩種方法。模擬方法是在給定的時間間隔內(nèi)計算R波（或脈搏波）的脈沖個數(shù)，然后將脈沖計數(shù)乘以一個適當?shù)某?shù)測量心率的。這種方法的缺點是測量誤差較大、元件參數(shù)調(diào)試困難、可靠性差。數(shù)字方法是先測量相鄰R波之間的時間，
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PCB電源供電系統(tǒng)的分析與設(shè)計
- 當今，在沒有透徹掌握芯片、封裝結(jié)構(gòu)及pcb的電源供電系統(tǒng)特性時，高速電子系統(tǒng)的設(shè)計是很難成功的。事實上，為了滿足更低的供電電壓、更快的信號翻轉(zhuǎn)速度、更高的集成度和許多越來越具有挑戰(zhàn)性的要求，很多走在電子設(shè)計前沿的公司在產(chǎn)品設(shè)計過程中為了確保電源和信號的完整性，對電源供電系統(tǒng)的分析投入了大量的資金，人力和物力。 電源供電系統(tǒng)(pds)的分析與設(shè)計在高速電路設(shè)計領(lǐng)域，特別是在計算機、半導體、通信、網(wǎng)絡(luò)和消費電子產(chǎn)業(yè)中正變得越來越重要。隨著超大規(guī)模集成電路技術(shù)不可避免的進一步等比縮小，集成電路的供電
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MAX2235的電路板布局優(yōu)化技術(shù)
- max2235是三級功率放大器，工作范圍為800mhz至1000mhz，能夠為gsm和ism設(shè)備提供高達30dbm的輸出功率。但是，實際設(shè)計中要想獲得最佳性能并不容易，前提是必須保證良好的pc板布局。本文提供了經(jīng)過驗證的電路板布局的相關(guān)實踐經(jīng)驗，有助于用戶理解功率放大器特性以及所述方法的基本原理。 概述 max2235是一款三級功率放大器，工作范圍為800mhz至1ghz，能夠為gsm和ism設(shè)備提供高達30dbm的輸出功率。但是，實際應(yīng)用中要想獲得最佳性能并不容易，前提是必須保證良
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正確的電路板布板降低開關(guān)模式轉(zhuǎn)換器的EMI
- 在該降壓轉(zhuǎn)換器原理圖中，互補驅(qū)動信號控制開關(guān)晶體管q1和q2，使其工作在開關(guān)狀態(tài)下，以達到較高的效率。 在圖1b中，開關(guān)節(jié)點電壓vlx以及晶體管電流i1和i2為方波，具有高頻分量。電感電流i3是三角波，也是可能的噪聲源。這些波形能夠?qū)崿F(xiàn)較高的效率，但是從emi的角度看，卻存在很大問題。 圖1b. 降壓轉(zhuǎn)換器的電流和電壓波形。開關(guān)晶體管電流i1和和i2，以及開關(guān)節(jié)點電壓vlx接近方波，是可能的emi輻射源。 一個理想的轉(zhuǎn)換器不會產(chǎn)生外部電磁場，只在輸入端吸收直流電流
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用單片機實現(xiàn)SRAM工藝FPGA的加密應(yīng)用
- 在現(xiàn)代電子系統(tǒng)設(shè)計中，由于可編程邏輯器件的卓越性能、靈活方便的可升級特性，而得到了廣泛的應(yīng)用。由于大規(guī)模高密度可編程邏輯器件多采用SRAM工藝，要求每次上電，對FPGA器件進行重配置，這就使得可以通過監(jiān)視配置的位數(shù)據(jù)流，進行克隆設(shè)計。因此，在關(guān)鍵、核心設(shè)備中，必須采用加密技術(shù)保護設(shè)計者的知識產(chǎn)權(quán)。 1 基于SRAM工藝FPGA的保密性問題 通常，采用SRAM工藝的FPGA芯片的的配置方法主要有三種：由計算機通過下載電纜配置、用專用配置芯片（如Altera公司的EPCX系列芯片）配置、采用存儲器
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射頻電路板設(shè)計技巧
- 成功的RF設(shè)計必須仔細注意整個設(shè)計過程中每個步驟及每個細節(jié)，這意味著必須在設(shè)計開始階段就要進行徹底的、仔細的規(guī)劃，并對每個設(shè)計步驟的進展進行全面持續(xù)的評估。而這種細致的設(shè)計技巧正是國內(nèi)大多數(shù)電子企業(yè)文化所欠缺的。近幾年來，由于藍牙設(shè)備、無線局域網(wǎng)絡(luò)(WLAN)設(shè)備，和移動電話的需求與成長，促使業(yè)者越來越關(guān)注RF電路設(shè)計的技巧。從過去到現(xiàn)在，RF電路板設(shè)計如同電磁干擾(EMI)問題一樣，一直是工程師們最難掌控的部份，甚至是夢魘。若想要一次就設(shè)計成功，必須事先仔細規(guī)劃和注重細節(jié)才能奏效。射頻(RF)電路板設(shè)計
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賽靈思VIRTEX-5 成為全球首個通過所有v1.1標準測試的FPGA
- 通過PCI EXPRESS兼容性測試 - 賽靈思VIRTEX-5 成為全球首個通過所有v1.1標準測試的FPGA 經(jīng)驗證的解決方案使用戶可快速采用業(yè)界速度最快的、內(nèi)建低功耗PCI Express 端點模塊和串行收發(fā)器的65nm FPGA 靈思公司( Xilinx, Inc. (NASDAQ: XLNX))宣布其Virtex™-5&nbs
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賽靈思最新版ISE大幅縮短FPGA設(shè)計周期
- 賽靈思公司（Xilinx, Inc.）推出業(yè)界應(yīng)用最廣泛的集成軟件環(huán)境（ISE）設(shè)計套件的最新版本ISE 9.1i。新版本專門為滿足業(yè)界當前面臨的主要設(shè)計挑戰(zhàn)而優(yōu)化，這些挑戰(zhàn)包括時序收斂、設(shè)計人員生產(chǎn)力和設(shè)計功耗。除了運行速度提高2.5倍以外，ISE 9.1i還新采用了SmartCompile 技術(shù)，因而可在確保設(shè)計中未變更部分實施結(jié)果的同時，將硬件實現(xiàn)的速度再提高多達6倍。同時，ISE 9.1i 還優(yōu)化了其最新65nm Virtex-
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以太網(wǎng)到多路E1適配電路設(shè)計及FPGA實現(xiàn)
- 伴隨著Internet的迅速發(fā)展，IP已經(jīng)成為綜合業(yè)務(wù)通信的首選協(xié)議，其承載的信息量也在成倍增長，如何利用現(xiàn)有的電信資源組建寬帶IP網(wǎng)絡(luò)是近年來研究的熱點。目前，比較成熟的技術(shù)主要有IP over SDH(POS)和IP over ATM（POA）。POS將IP包直接裝入SDH的虛容器中，通道開銷少、實現(xiàn)簡單，具有自動保護切換功能；POA的復接過程比較復雜，可以通過高系統(tǒng)開銷提供較好的服務(wù)質(zhì)量保證（QOS）。從目前的市場看，各大通信設(shè)備商都推出了基于POS/POA的產(chǎn)品，但總體成本較高，主要面向的是一些高
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FPGA:來日方長顯身手--專訪Altera總裁兼CEO John Daane
- Altera是一個團結(jié)緊密的團體，每一個成員都有共同的堅定的信念和為此信念奮斗不息的激情。我從John Daane身上也看到這一點。Daane是一位年輕的CEO，在加入Altera之前，他在LSI Logic公司工作了15年，負責ASIC技術(shù)的研發(fā)。這又是他們的一個共同特點，這些投身FPGA事業(yè)的人物，幾乎都曾是ASIC行業(yè)的專家?？磥硭麄兊拇_是一群志同道合的人，在若干年前看到FPGA行業(yè)發(fā)展的大好前景，所以聚到一起來了。 如果現(xiàn)在讓我歷
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DVB-C解交織器的FPGA實現(xiàn)
- 卷積交織和解交織原理簡介 在DVB-C系統(tǒng)當中，實際信道中的突發(fā)錯誤往往是由脈沖干擾、多徑衰落引起的，在統(tǒng)計上是相關(guān)的，所以一旦出現(xiàn)不能糾正的錯誤時，這種錯誤將連續(xù)存在。因此在DVB-C系統(tǒng)里，采用了卷積交織來解決這種問題。它以一定規(guī)律擾亂源符號數(shù)據(jù)的時間順序，使其相關(guān)性減弱，然后將其送入信道，解交織器按相反規(guī)律恢復出源符號數(shù)據(jù)。 DVB-C的卷積交織和解交織原理為：交織由I=12(I為交織深度)個分支構(gòu)成。每個分支的延時逐漸遞增，遞增的單元數(shù)M=n/I=204/12=17(M為交織基數(shù))。這里的
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