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          EEPW首頁 >> 主題列表 >> ip核

          基于Avalon總線SHT11溫濕度傳感器自定義IP核的開發(fā)流程

          • [導(dǎo)讀]SOPC(SystemOnaProgrammableChip,可編程芯片系統(tǒng))就是在一個可編程芯片上實(shí)現(xiàn)一個電子系統(tǒng)的技...
          • 關(guān)鍵字: Avalon總線  SHT11  溫濕度傳感器  IP核  

          MCU與USB設(shè)備控制器IP核的設(shè)計(jì)

          • [導(dǎo)讀] 在傳統(tǒng)的計(jì)算機(jī)系統(tǒng)上常采用串口(如RS232)和并口連接外圍設(shè)備,但串口和并口都存在著通信速度 慢,接口獨(dú) ...
          • 關(guān)鍵字: MCU  USB設(shè)備控制器  IP核    

          基于SOPC的觸控屏控制器IP核設(shè)計(jì)與實(shí)現(xiàn)

          • 摘要:介紹一款基于SOPC的TFT—LCD觸控屏控制器IP核的設(shè)計(jì)與實(shí)現(xiàn)。采用Verilog HDL作控制器的模塊設(shè)計(jì),并用Mod ...
          • 關(guān)鍵字: SOPC  控制器  IP核  觸控屏  NiosⅡ  

          Leon2處理器IP核技術(shù)(三)

          • 3.2 系統(tǒng)軟件開發(fā)同一般的嵌入式系統(tǒng)的軟件開發(fā)一樣,Leon2應(yīng)用系統(tǒng)的軟件開發(fā)需要采用交叉編譯環(huán)境來 ...
          • 關(guān)鍵字: Leon2  處理器  IP核  

          Leon2處理器IP核技術(shù)(二)

          • 2.2 AMBAAMBA(Advanced Microntroller Bus Architecture)規(guī)范,是一種已制定的、開放的規(guī)范,充當(dāng)著SoC設(shè) ...
          • 關(guān)鍵字: Leon2  處理器  IP核  

          USB系統(tǒng)組成及模塊設(shè)計(jì)

          • 1引言USB,是英文UniversalSerialBUS(通用串行總線)的縮寫,而其中文簡稱為“通串線,是一個外部總線...
          • 關(guān)鍵字: USB系統(tǒng)  通用串行總線  IP核  

          一種高速USB設(shè)備控制器IP核的設(shè)計(jì)與實(shí)現(xiàn)

          • 摘要:文章首先分析USB2.0協(xié)議,然后介紹基于該協(xié)議的一種設(shè)備控制器IP核設(shè)計(jì)實(shí)現(xiàn),著重分析了設(shè)計(jì)中的幾個問...
          • 關(guān)鍵字: 高速USB  設(shè)備控制器  IP核  

          一種嵌入式USB2.0主機(jī)控制器IP核的研究與設(shè)計(jì)

          • 摘要:用硬件描述語言verilogHDL設(shè)計(jì)實(shí)現(xiàn)了一種嵌入式USB2.0主機(jī)控制器IP核,簡要介紹了嵌入式USB主機(jī)...
          • 關(guān)鍵字: USB2.0主  機(jī)控制器  IP核  

          高速USB IP核的設(shè)計(jì)與開發(fā)

          • 1引言USB設(shè)備的開發(fā)可分兩種:直接利用USB控制器芯片和設(shè)計(jì)基于FPGA的USBIP核。前者無需清楚USB的協(xié)議...
          • 關(guān)鍵字: 高速USB  IP核  USB協(xié)議  

          FPGA設(shè)計(jì)經(jīng)驗(yàn)談

          • 從大學(xué)時代第一次接觸FPGA至今已有10多年的時間。至今記得當(dāng)初第一次在EDA實(shí)驗(yàn)平臺上完成數(shù)字秒表,搶答器,密碼鎖等實(shí)驗(yàn)時,那個興奮勁。當(dāng)時由于沒有接觸到HDL硬件描述語言,設(shè)計(jì)都是在MAX+plus II原理圖環(huán)境下用74系列邏輯器件搭建起來的。
          • 關(guān)鍵字: FPGA  EDA  VHDL  Verilog  時鐘  IP核  

          龍芯處理器IP核的FPGA驗(yàn)證平臺設(shè)計(jì)

          • 本文利用Altera公司的FPGA開發(fā)工具對皋于國產(chǎn)龍芯I號處理器IP核的SoC芯片進(jìn)行ASIC流片前的系統(tǒng)驗(yàn)證,全實(shí)時方 ...
          • 關(guān)鍵字: 龍芯  處理器  IP核  FPGA驗(yàn)證  

          MC8051 IP核基本結(jié)構(gòu)及原理

          • MC8051是與MCS一5l系列微處理器指令集完全兼容的8位嵌入式微處理器,通過芯核重用技術(shù),可廣泛應(yīng)用在一些面積要 ...
          • 關(guān)鍵字: MC8051  IP核  基本結(jié)構(gòu)  

          QUARTUS II中IP核的調(diào)用方法(圖文詳解)

          • 很多人都說QUARYUSII中的IP核是收費(fèi)的,不可以直接用的,其實(shí)不然,下面我以FIR濾波器的核的使用來給大家介紹IP核 ...
          • 關(guān)鍵字: QUARTUS  II  IP核  調(diào)用方法  

          基于多IP核復(fù)用SoC芯片的可靠性研究

          • 1 引言隨著半導(dǎo)體工藝技術(shù)的發(fā)展, 愈來愈復(fù)雜的IP核可集成到單顆芯片上, SoC (片上系統(tǒng))技術(shù)正是在集成電路( IC) 向集成系統(tǒng)( IS)轉(zhuǎn)變的大方向下產(chǎn)生的。采用SoC 技術(shù), 可將微處理器、模擬IP核、數(shù)字IP核和存儲器等集
          • 關(guān)鍵字: SoC  IP核  芯片  可靠性研究    

          基于Altera浮點(diǎn)IP核實(shí)現(xiàn)浮點(diǎn)矩陣相乘運(yùn)算的改進(jìn)設(shè)

          • 嵌入式計(jì)算作為新一代計(jì)算系統(tǒng)的高效運(yùn)行方式,應(yīng)用于多個高性能領(lǐng)域,如陣列信號處理、核武器模擬、計(jì)算流體動力學(xué)等。在這些科學(xué)計(jì)算中,需要大量的浮點(diǎn)矩陣運(yùn)算。而目前已實(shí)現(xiàn)的浮點(diǎn)矩陣運(yùn)算是直接使用VHDL語言編
          • 關(guān)鍵字: Altera  浮點(diǎn)  IP核  點(diǎn)矩陣    
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          ip核介紹

          IP核概述   IP核則是一段具有特定電路功能的硬件描述語言程序,該程序與集成電路工藝無關(guān),可以移植到不同的半導(dǎo)體工藝中去生產(chǎn)集成電路芯片。利用IP核設(shè)計(jì)電子系統(tǒng),引用方便,修改基本元件的功能容易。具有復(fù)雜功能和商業(yè)價(jià)值的IP核一般具有知識產(chǎn)權(quán),盡管IP核的市場活動還不規(guī)范,但是仍有許多集成電路設(shè)計(jì)公司從事IP核的設(shè)計(jì)、開發(fā)和營銷工作。IP核有兩種,與工藝無關(guān)的VHDL程序稱為軟核;具有特定電路 [ 查看詳細(xì) ]

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