ip核 文章 進入ip核技術(shù)社區(qū)
Nufront第三代處理器采用Cadence接口IP解決方案
- 全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司 (NASDAQ: CDNS)，日前宣布Nufront(新岸線)的NS115芯片組采用了Cadence可配置的DDR3/3L/LPDDR2存儲控制器與硬化PHY IP核，應用于其雙核ARM Cortex –A9移動應用處理器。TSMC 40LP工藝， 32位DDR3/LPDDR2接口的數(shù)據(jù)傳輸速率最高可達800Mbps，并能提供對超薄筆記本、平板電腦和智能手機等產(chǎn)品至關(guān)重要的基于數(shù)據(jù)流量的自動功耗管理。 Cadence 的DDR3/3L/LPDDR2 IP
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基于Nexys 3開發(fā)板的堆棧處理器的測試
- 堆棧處理器是一種專門面向嵌入式控制領(lǐng)域的處理器，其所有執(zhí)行過程均依賴于兩個硬件支持的堆棧：執(zhí)行數(shù)學表達式的數(shù)據(jù)堆棧(Data Stack)和保存子程序返回地址的返回堆棧(Return Stack)，而不是大量的通用寄存器。堆棧處理器的特征使其相比較于RISC和CISC等通用寄存器處理器，更加適合應用于嵌入式實時控制領(lǐng)域。本文在上述背景下，介紹了一個堆棧處理器的IP核，給出了其在Digilent公司的Nexys 3開發(fā)板上的實現(xiàn)結(jié)果，以及使用ModelSim SE 6.5C仿真測試的結(jié)果。
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基于Wishbone總線的UART IP核的設(shè)計
- 隨著集成電路與嵌入式技術(shù)的發(fā)展與廣泛應用，許多嵌入式系統(tǒng)都需要進行串行通信，因此在片上嵌入式系統(tǒng)芯片中集...
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基于DDR3存儲器接口控制器IP核的視頻數(shù)據(jù)處理
- 引言與過去幾代（DDR和DDR2）器件相比，DDR3存儲器器件有了明顯的進步。DDR3存儲器系統(tǒng)可以大大提升各...
- 關(guān)鍵字： DDR3存儲器接口 IP核 視頻數(shù)據(jù)處理
一種高速I2C總線從器件接口IP核的設(shè)計與實現(xiàn)
- I2C總線作為一種事實上的國際標準，在超過100種不同的IC上實現(xiàn)并且得到超過50家公司的許可。它具有連線少，結(jié)構(gòu)簡單的特點。本文介紹了一種高速I2C從器件接口電路IP核設(shè)計。在系統(tǒng)應用中，單片機作為主控器件，本IP核作為從器件中的接口電路，它們通過I2C總線相連，實現(xiàn)MCU對IC或FPGA中相關(guān)寄存器的訪問。從而代替了MCU通用的地址數(shù)據(jù)接口，大大減少了IC或FPGA的管腳數(shù)量，節(jié)省了I/O資源，這對于I/O資源緊張的IC設(shè)計和FPGA開發(fā)是非常有意義的。
- 關(guān)鍵字： FPGA I2C總線 IP核 201107
ip核介紹
IP核概述
IP核則是一段具有特定電路功能的硬件描述語言程序，該程序與集成電路工藝無關(guān)，可以移植到不同的半導體工藝中去生產(chǎn)集成電路芯片。利用IP核設(shè)計電子系統(tǒng)，引用方便，修改基本元件的功能容易。具有復雜功能和商業(yè)價值的IP核一般具有知識產(chǎn)權(quán)，盡管IP核的市場活動還不規(guī)范，但是仍有許多集成電路設(shè)計公司從事IP核的設(shè)計、開發(fā)和營銷工作。IP核有兩種，與工藝無關(guān)的VHDL程序稱為軟核；具有特定電路 [ 查看詳細 ]
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