ip核 文章 進入ip核技術(shù)社區(qū)
萊迪思半導(dǎo)體與Helion發(fā)布用于視頻安全和監(jiān)控攝像機的IP核
- 萊迪思半導(dǎo)體公司(NASDAQ: LSCC)與Helion今天宣布他們已經(jīng)發(fā)布知識產(chǎn)權(quán)(IP)核用于視頻安全和監(jiān)控攝像機市場。針對LatticeXP2™、LatticeECP2M™和LatticeECP3™FPGA系列,Helion展示了其IONOS流水線型視頻IP和Vesta評估平臺。Helion Vesta評估平臺是一個完全獨立的平臺,能夠開發(fā)和實現(xiàn)針對攝像機系統(tǒng)的圖像流水線技術(shù),尤其是緊湊形式的視頻安全應(yīng)用,如網(wǎng)絡(luò)IP和球型攝像機。 Helion的Ves
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Tensilica靈活配置的DSP助力自主知識產(chǎn)權(quán)
- 亮相IIC-China 2010,聚焦自主知識產(chǎn)權(quán) Tensilica將于3月15-16日亮相上海IIC-China 2010(國際集成電路研討會暨展覽會)。針對金融危機對半導(dǎo)體產(chǎn)業(yè)的影響、半導(dǎo)體廠商在研發(fā)成本方面的問題以及領(lǐng)先的中國半導(dǎo)體廠商對于自主知識產(chǎn)權(quán)的孜孜追求,Tensilica 在本屆展會上將著重展示其可配置處理器在幫助企業(yè)研發(fā)自主知識產(chǎn)權(quán)方面的卓越表現(xiàn)(展位號:8S35)。Tensilica亞太區(qū)總監(jiān)黃啟弘將在高峰論壇做出“Tensilica靈活配置的DSP,幫您實現(xiàn)自主知
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基于FPGA的8段數(shù)碼管動態(tài)顯示IP核設(shè)計
- 設(shè)計基于FPGA的8段數(shù)碼管動態(tài)顯示IP核,介紹8段數(shù)碼管內(nèi)部結(jié)構(gòu)及其驅(qū)動顯示方式和IP核設(shè)計方法,給出8段數(shù)碼管動態(tài)顯示IP核的Verilog HDL程序源代碼及其C語言驅(qū)動程序。此IP核可例化成1~8個共陰極(或共陽極)數(shù)碼管控制器,能方便地控制1~8個數(shù)碼管同時顯示數(shù)字和小數(shù)點位。測試結(jié)果表明,該IP核工作可靠、穩(wěn)定,可直接應(yīng)用于電子設(shè)計中。
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MCU + USB設(shè)備控制器IP核的設(shè)計
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發(fā)展國內(nèi)硅知識產(chǎn)權(quán)若干建議
- 發(fā)展國內(nèi)硅知識產(chǎn)權(quán),首先要重視高端通用IP核研發(fā)、驗證與評估。 SoC實現(xiàn)的重要途徑是復(fù)用高質(zhì)量的成熟IP。而IP設(shè)計和驗證是高質(zhì)量IP開發(fā)流程中兩個不可或缺的部分。應(yīng)該看到,由于國內(nèi)IP供應(yīng)商在產(chǎn)品和技術(shù)上不夠成熟,國外有成熟產(chǎn)品的IP供應(yīng)商難以提供全面的本地技術(shù)支持等因素,SoC設(shè)計者和IP開發(fā)者都提出IP核評測的迫切需求。尤其是隨著工藝的不斷進步及IP復(fù)雜度的不斷提高,IP設(shè)計和驗證也面臨著越來越多的挑戰(zhàn)。所以,根據(jù)SoC/IP系統(tǒng)的特點,提高驗證的效率和驗證的可重用性,創(chuàng)建新的驗證解決方
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ip核介紹
IP核概述
IP核則是一段具有特定電路功能的硬件描述語言程序,該程序與集成電路工藝無關(guān),可以移植到不同的半導(dǎo)體工藝中去生產(chǎn)集成電路芯片。利用IP核設(shè)計電子系統(tǒng),引用方便,修改基本元件的功能容易。具有復(fù)雜功能和商業(yè)價值的IP核一般具有知識產(chǎn)權(quán),盡管IP核的市場活動還不規(guī)范,但是仍有許多集成電路設(shè)計公司從事IP核的設(shè)計、開發(fā)和營銷工作。IP核有兩種,與工藝無關(guān)的VHDL程序稱為軟核;具有特定電路 [ 查看詳細 ]
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