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Cadence為復(fù)雜SoC設(shè)計縮短時序收斂時程
- 在加速復(fù)雜IC開發(fā)更容易的當下，益華電腦(Cadence Design Systems, Inc.)發(fā)表 Tempus 時序 Signoff解決方案(Timing Signoff Solution)，這是嶄新的靜態(tài)時序分析與收斂工具，精心設(shè)計讓系統(tǒng)晶片(System-on-Chip，SoC)開發(fā)人員能夠加速時序收斂，讓晶片設(shè)計更快速地投入制造流程。Tempus 時序Signoff解決方案意謂全新的時序signoff工具作法，讓客戶能夠縮短時序signoff收斂與分析，實現(xiàn)更快速的試產(chǎn)，同時創(chuàng)造良率更高
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Cadence推出Tempus時序簽收解決方案
- 為設(shè)計收斂和簽收提供前所未有的性能和容量 Tempus?時序簽收解決方案提供的性能比傳統(tǒng)的時序分析解決方案提升了一個數(shù)量級。 可擴展性，能夠?qū)哂猩蟽|個實例的設(shè)計進行全扁平化分析。 集成的簽收精度的時序收斂環(huán)境利用創(chuàng)新的考慮物理layout的ECO技術(shù)，可以使設(shè)計閉合提前數(shù)周時間。 為簡化和加速復(fù)雜IC的開發(fā)，Cadence 設(shè)計系統(tǒng)公司推出Tempus? 時序簽收解決方案。這是一款新的靜態(tài)時序分析與收斂工具，旨在幫助系統(tǒng)級芯片 (SoC) 開發(fā)者加速時序收斂，將芯片設(shè)計快速轉(zhuǎn)
- 關(guān)鍵字： Cadence Tempus 時序簽收
Cadence Incisive Enterprise Simulator將低功耗驗證效率提升30%
- 【中國，2013年5月14日】全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ: CDNS)，近日推出新版本Incisive Enterprise Simulator，該版本將復(fù)雜SoC的低功耗驗證效率提高了30%。13.1版的Cadence Incisive Enterprise Simulator致力于解決低功耗驗證的問題，包括高級建模、調(diào)試、功率格式支持，并且為當今最復(fù)雜的SoC提供了更快的驗證方式。 Incisive SimVision Debugger的最新
- 關(guān)鍵字： Cadence SoC
Cadence和GLOBALFOUNDRIES合作改進20及14納米節(jié)點DFM簽收
- 【中國，2013年5月13日】全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ:CDNS)近日宣布，GLOBALFOUNDRIES已攜手Cadence®，為其20和14納米制程提供模式分類數(shù)據(jù)。GLOBALFOUNDRIES之所以采用Cadence模式分類和模式匹配解決方案，是因為它們可以使可制造性設(shè)計(DFM)加快四倍，這對提高客戶硅片成品率和可預(yù)測性非常關(guān)鍵。 “我們已集成了Cadence模式分類技術(shù)，根據(jù)模式相似性將成品率不利因素分成若干模式
- 關(guān)鍵字： Cadence 28納米
Cadence和TSMC為16納米FinFET開發(fā)設(shè)計架構(gòu)
- Cadence設(shè)計系統(tǒng)公司4月9日宣布與TSMC簽訂了一項長期合作協(xié)議，共同開發(fā)16納米FinFET技術(shù)，以其適用于移動、網(wǎng)絡(luò)、服務(wù)器和FPGA等諸多應(yīng)用領(lǐng)域。此次合作非常深入，開始于工藝制造的早期階段，貫穿于設(shè)計分析至設(shè)計簽收，全面有效解決FinFETs設(shè)計存在的問題，從而交付能實現(xiàn)超低功耗、超高性能芯片的設(shè)計方案。 ????在16納米及以下工藝技術(shù)下設(shè)計開發(fā)系統(tǒng)級芯片設(shè)計（SoC），只有FinFET 技術(shù)才具備功率、性能和面積上（PPA）的獨特優(yōu)勢。與平面FE
- 關(guān)鍵字： Cadence 設(shè)計 EDA
ARM攜Cadence開發(fā)Cortex-A57 64位處理器
- ARM (LSE:ARM; Nasdaq: ARMH) 和Cadence (NASDAQ: CDNS) 日前宣布合作細節(jié)，揭示其共同開發(fā)首款基于臺積電16納米FinFET制程的ARM?Cortex?-A57處理器，實現(xiàn)對16納米性能和功耗縮小的承諾。 測試芯片是采用完整的Cadence RTL-to-signoff流程、 Cadence Virtuoso 定制設(shè)計平臺、ARM Artisan?標準單元庫和臺積電的存儲器的宏。
- 關(guān)鍵字： ARM Cadence 處理器 Cortex-A57
Cadence宣布收購Tensilica
- Tensilica公司的數(shù)據(jù)平面處理單元(DPUs)與Cadence公司的設(shè)計IP相結(jié)合，將為移動無線、網(wǎng)絡(luò)基礎(chǔ)設(shè)施、汽車信息娛樂和家庭應(yīng)用等各方面提供更優(yōu)化的IP解決方案。 作為業(yè)界標準處理器架構(gòu)的補充，Tensilica公司的IP提供了應(yīng)用優(yōu)化的子系統(tǒng)，以提高產(chǎn)品的辨識度和更快地進入市場。 全球持有Tensilica公司IP授權(quán)許可的公司超過200個，包括系統(tǒng)OEM制造商及世界前10大半導(dǎo)體公司中的7家。Tensilica的IP核在全球的總出貨量已超過20億枚。 2013年3月1
- 關(guān)鍵字： Cadence IP
Cadence宣布收購Tensilica
- ? · Tensilica公司的數(shù)據(jù)平面處理單元(DPUs)與Cadence公司的設(shè)計IP相結(jié)合，將為移動無線、網(wǎng)絡(luò)基礎(chǔ)設(shè)施、汽車信息娛樂和家庭應(yīng)用等各方面提供更優(yōu)化的IP解決方案。 · 作為業(yè)界標準處理器架構(gòu)的補充，Tensilica公司的IP提供了應(yīng)用優(yōu)化的子系統(tǒng)，以提高產(chǎn)品的辨識度和更快地進入市場。 · 全球持有Tensilica公司IP授權(quán)許可的公司超過200個，包括系統(tǒng)OEM制造商及世界前10大半導(dǎo)體公司中的7家。Tensilic
- 關(guān)鍵字： Cadence Tensilica 嵌入式
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