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毫米波5G接收機(jī)多速率數(shù)據(jù)設(shè)計與研究
- 針對5G毫米波通信宏基站、微基站等設(shè)備的研發(fā)、生產(chǎn)、預(yù)認(rèn)證、維修保障等測試需求，設(shè)計一款可應(yīng)用于“5G新基建”通信設(shè)備產(chǎn)業(yè)鏈多環(huán)節(jié)所需儀表的高效多速率信號接收機(jī)處理模塊。采用先進(jìn)的并行多相濾波技術(shù)和任意速率比FFT處理技術(shù)，基于FPGA算法平臺實現(xiàn)毫米波5G接收機(jī)多路信號接收時域/頻域并行變速率處理邏輯電路，提高5G復(fù)雜波形接收機(jī)信號解析的實時性。實驗結(jié)果表明，該電路能高效完成5G復(fù)雜波形接收機(jī)信號的時域/頻域解析，適合作為毫米波5G接收機(jī)多速率數(shù)據(jù)處理實施方案，滿足毫米波5G接收機(jī)的功能設(shè)計要求。
- 關(guān)鍵字： FPGA 5G 毫米波 接收機(jī) 202105
基于EG4A20BG256和AD7403的電流采樣電路設(shè)計
- AD7403是一種Σ-Δ型模數(shù)轉(zhuǎn)換器，廣泛應(yīng)用于需要電氣隔離的伺服控制電機(jī)相電流采集場合。EG4A20BG256是一種國產(chǎn)FPGA，適用于伺服控制系統(tǒng)信號采集﹑接口擴(kuò)展等應(yīng)用場景。本文基于EG4A20BG256 FPGA設(shè)計了AD7403模數(shù)轉(zhuǎn)換器接口電路，采集永磁同步電機(jī)相電流，并與伺服控制電路內(nèi)霍爾電流傳感器和DSP采樣結(jié)果進(jìn)行了對比。結(jié)果表明，EG4A20BG256 FPGA可以通過AD7403模數(shù)轉(zhuǎn)換器實現(xiàn)對永磁同步電機(jī)相電流的準(zhǔn)確采集。
- 關(guān)鍵字： AD7403 EG4A20BG256 FPGA DSP 永磁同步電機(jī) 202105
一種BiSS協(xié)議的編碼器數(shù)據(jù)讀取方法
- 摘要：針對目前BiSS協(xié)議編碼器數(shù)據(jù)讀取多采用FPGA實現(xiàn)的實際情況，文中介紹一種基于XMC4500微控制器的BiSS協(xié)議編碼器數(shù)據(jù)讀取實現(xiàn)方案。采用該方案，可將使用BiSS協(xié)議編碼器的伺服系統(tǒng)控制電路常用的DSP+FPGA雙控制器架構(gòu)方式簡化為XMC4500單控制器方式，在一定程度上降低了硬件成本和開發(fā)難度。用該方案采集BiSS協(xié)議編碼器數(shù)據(jù)的實物平臺，使用LabVIEW顯示對讀取的數(shù)據(jù)，并與電機(jī)自帶增量編碼器值進(jìn)行對比，同時記錄BiSS協(xié)議編碼器實際數(shù)據(jù)波形圖，結(jié)果表明，該方案具有較高的采樣速率和較好
- 關(guān)鍵字： 202106 BiSS XMC4500 DSP FPGA LabVIEW
5G NR小區(qū)搜索算法的研究及FPGA實現(xiàn)
- 隨著移動通信的高速發(fā)展，5G NR通信已經(jīng)進(jìn)入我們的日常生活，5G系統(tǒng)對信息傳輸制訂了全新標(biāo)準(zhǔn)，基于5G NR的小區(qū)搜索相對于長期演進(jìn)（LTE）而言，對同步信號進(jìn)行了重新定義。文章詳細(xì)分析了5G NR系統(tǒng)的主輔同步信號（PSS&SSS），對其新增內(nèi)容進(jìn)行了研究，提出了適用于5G NR系統(tǒng)的小區(qū)搜索算法，使用MATLAB軟件對該算法的性能進(jìn)行了仿真分析，最后在FPGA上實現(xiàn)開發(fā)應(yīng)用。
- 關(guān)鍵字： 5G NR FPGA 小區(qū)搜索 PSS SSS 202105
賽靈思：以更高AI效能功耗比 支持邊緣運算自主
- 邊緣運算主要包含以下四個部分，低時延、AI算力、低功耗以及安全和保密，這四者是邊緣自主非常重要的組成部分，也是邊緣區(qū)別于工業(yè)和IoT的一個主要特點，也就是用運算資源來支持邊緣的自主，使它能夠獨立于云端。 賽靈思Versal AI Edge系列資深產(chǎn)品線經(jīng)理 Rehan Tahir賽靈思Versal AI Edge系列高級產(chǎn)品線經(jīng)理Rehan Tahir指出，當(dāng)賽靈思在2018年引入Versal ACAP的時候，首先推出的是Versal Core和Prime系列，用于云端和網(wǎng)絡(luò)，然后推出了Vers
- 關(guān)鍵字： 賽靈思 FPGA ADAS
5G毫米波基帶數(shù)據(jù)傳輸?shù)难芯颗c實現(xiàn)
- 隨著通信技術(shù)的快速發(fā)展，5G已經(jīng)正式商用，5G的6G以下波段對傳輸有很高的要求，在6G以上的毫米波段要求的信號帶寬更大，數(shù)據(jù)傳輸速率更高，高速大帶寬信號要求基帶信號處理的速度將大大增加，對極高速數(shù)據(jù)流的實時處理和解析使測試變得更加困難，本文主要是研究與設(shè)計毫米波基帶數(shù)據(jù)的傳輸與實現(xiàn)：前端DA的研究與設(shè)計、傳輸鏈路的FPGA實現(xiàn)以及毫米波數(shù)據(jù)的DSP接收處理過程，最后把實現(xiàn)流程成功應(yīng)用到5G測試儀表之中，驗證了設(shè)計的正確性。
- 關(guān)鍵字： 202104 毫米波 FPGA 基帶數(shù)據(jù) DSP
基于FPGA的數(shù)字和模擬信號合成的彩色液晶顯示器
- 本文介紹了一款智能型高速模擬與數(shù)字信號合成的液晶顯示器。該顯示器采用雙FPGA作為主控芯片，利用視頻解碼芯片ADV7180將模擬信號解析為可供液晶屏顯示的RGB信號。
- 關(guān)鍵字： 202104 FPGA ADV7180 模擬與數(shù)字信號
可穿戴設(shè)備SoC的動向與Nordic解決方案
- 1? ?可穿戴設(shè)備SoC的動向Nordic Semiconductor看到市場對公司無線藍(lán)牙5 (BLE) 系統(tǒng)級芯片(SoC)產(chǎn)品的需求激增，尤其是在可穿戴運動產(chǎn)品領(lǐng)域。隨著消費者對于產(chǎn)品功能和電池使用壽命越來越挑剔，使用具有充足的處理能力的高功效SoC 變得越來越重要。此外，還有一種趨勢是增加更多的醫(yī)療級傳感器來測量血氧飽和度(SPO2)、血壓、心電圖(EKG)等，這對SoC 提出了更高的處理性能要求。具有超低功耗LTE-M 和NB-IoT 網(wǎng)絡(luò)的蜂窩物聯(lián)網(wǎng)的推出，開始推動可穿戴設(shè)
- 關(guān)鍵字： SoC 可穿戴 202105
輕松有趣地提高安全性：SoC組件協(xié)助人們保持健康
- 我們需要透過智慧的預(yù)防措施來恢復(fù)正常生活。當(dāng)人們必須估量并遵守1.5至2公尺的強(qiáng)制社交距離，很難想象購物、學(xué)習(xí)或工作如何變得輕松起來。在忘記保持安全社交距離時略帶驚恐地跳開，這已經(jīng)見怪不怪。盡管存在著所有的預(yù)防措施，我們?nèi)砸M快恢復(fù)常態(tài)的生活：企業(yè)需要再次提高產(chǎn)量，商店迫切需要營業(yè)，兒童和青少年需要上學(xué)，以及安排各項休閑活動。但我們還缺乏一個有效、通用和能快速實施這個衛(wèi)生理念的方法。為此，政府發(fā)起了圍繞「距離/衛(wèi)生/日常戴口罩」的運動，目前該運動為遏制新的感染提供了行動綱要，例如受惠于現(xiàn)代科技，企業(yè)和公共
- 關(guān)鍵字： SoC 可穿戴 物聯(lián)網(wǎng)
基于數(shù)字集成電路的智能監(jiān)控與識別追蹤系統(tǒng)*
- 本設(shè)計基于FPGA硬件平臺實現(xiàn)了對一個區(qū)域場景的入侵檢測與追蹤識別，對檢測到的運動物體作出人與動物的區(qū)分，能夠通過無線方式發(fā)送警報，且系統(tǒng)檢測具有較高的魯棒性。本系統(tǒng)以FPGA為核心單元，主要由五個模塊構(gòu)成：OV5640攝像頭模塊，DDR3數(shù)據(jù)儲存模塊、圖像數(shù)據(jù)處理模塊、蜂鳥E203 RISC-V SoC片上系統(tǒng)。系統(tǒng)整合與調(diào)試結(jié)果顯示，本設(shè)計在FPGA上采用了合適的算法搭建系統(tǒng)，能對視頻圖像中的運動目標(biāo)進(jìn)行實時、準(zhǔn)確的識別與追蹤。
- 關(guān)鍵字： Robei FPGA 動態(tài)目標(biāo)追蹤 實時圖像處理 背景差分法 202103
小尺寸高分辨率的微顯示系統(tǒng)設(shè)計及FPGA實現(xiàn)
- 尺寸與性能是微顯示系統(tǒng)的重要衡量指標(biāo)，為了實現(xiàn)微顯示系統(tǒng)的小尺寸與高性能，通過對視頻圖像數(shù)據(jù)的實時處理計算，實現(xiàn)圖像的動態(tài)子像素融合，在FPGA上實現(xiàn)了電路，配合顯示芯片完成視頻圖像顯示。點屏的對比效果顯示，在節(jié)省了FPGA中74%存儲資源的同時提高了顯示芯片接近四倍的顯示分辨率，等效到顯示系統(tǒng)中能減少80%的芯片面積。這種微顯示系統(tǒng)同時解決了微型化與高分辨率的技術(shù)難關(guān)，非常適合應(yīng)用于微顯示相關(guān)領(lǐng)域。
- 關(guān)鍵字： 微顯示系統(tǒng) 微顯示芯片 分辨率 子像素融合 FPGA 202103
加快早期設(shè)計探索和驗證，縮短上市時間
- 芯片級驗證的挑戰(zhàn)鑒于先進(jìn)工藝設(shè)計的規(guī)模和復(fù)雜性，而且各方為 搶先將產(chǎn)品推向市場而不斷競爭，片上系統(tǒng) (SoC) 設(shè)計團(tuán)隊沒有時間等到所有芯片模塊都全 部完成后才開始組裝芯片。因此，SoC 設(shè)計人員 通常會在模塊開發(fā)的同時開始芯片集成工作，以 便在設(shè)計周期的早期捕獲并糾正任何布線違規(guī)， 從而幫助縮短至關(guān)重要的上市時間。錯誤在早期 階段更容易修復(fù)，而且對版圖沒有重大影響，設(shè) 計人員在此階段消除錯誤，可以減少實現(xiàn)流片所 需的設(shè)計規(guī)則檢查 (DRC) 迭代次數(shù)（圖 1）。但是，早期階段芯片級物理驗證面臨許多挑 戰(zhàn)
- 關(guān)鍵字： 芯片 soc 設(shè)計人員
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