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          采用FPGA的可編程電壓源系統(tǒng)原理及設(shè)計(jì)

          • 采用FPGA的可編程電壓源系統(tǒng)原理及設(shè)計(jì),概述:介紹一種基于FPGA的可編程電壓源系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)。采用FPGA為控制芯片,應(yīng)用QuartusⅡ軟件和硬件描述語(yǔ)言為工具,通過(guò)數(shù)/模轉(zhuǎn)換和運(yùn)放把數(shù)字信號(hào)轉(zhuǎn)換成模擬電壓信號(hào)。實(shí)驗(yàn)表明,該系統(tǒng)操作靈活方便,穩(wěn)定性強(qiáng)
          • 關(guān)鍵字: 原理  設(shè)計(jì)  系統(tǒng)  電壓  FPGA  可編程  采用  

          基于EDA仿真技術(shù)解決FPGA設(shè)計(jì)開(kāi)發(fā)中故障的方法

          • 基于EDA仿真技術(shù)解決FPGA設(shè)計(jì)開(kāi)發(fā)中故障的方法, FPGA近年來(lái)在越來(lái)越多的領(lǐng)域中應(yīng)用,很多大通信系統(tǒng)(如通信基站等)都用其做核心數(shù)據(jù)的處理。但是過(guò)長(zhǎng)的編譯時(shí)間,在研發(fā)過(guò)程中使得解決故障的環(huán)節(jié)非常令人頭痛。本文介紹的就是一種用仿真方法解決故障從而減少研
          • 關(guān)鍵字: 設(shè)計(jì)開(kāi)發(fā)  故障  方法  FPGA  解決  EDA  仿真技術(shù)  基于  

          采用FPGA技術(shù)的智能導(dǎo)盲犬設(shè)計(jì)方案

          • 采用FPGA技術(shù)的智能導(dǎo)盲犬設(shè)計(jì)方案,眾所周知眼晴是“心靈之窗”,而對(duì)于突然失去或從未擁有過(guò)“心靈之窗”的盲人來(lái)說(shuō),生活上的困難與心理上的痛苦是可想而知的。他們的衣食住行存在諸多不便,而在出行與人際交往中遇到的困難更加突出,基于此設(shè)計(jì)了智
          • 關(guān)鍵字: 設(shè)計(jì)  方案  智能  技術(shù)  FPGA  采用  

          采用CPLD/FPGA的VHDL語(yǔ)言電路優(yōu)化原理設(shè)計(jì)

          • 采用CPLD/FPGA的VHDL語(yǔ)言電路優(yōu)化原理設(shè)計(jì),VHDL(Very High Speed Integrated Circuit Hardware Description Language)是IEEE工業(yè)標(biāo)準(zhǔn)硬件描述語(yǔ)言,是隨著可編程邏輯器件(PLD)的發(fā)展而發(fā)展起來(lái)的。它是一種面向設(shè)計(jì)、多層次的硬件描述語(yǔ)言,是集行為描述、RTL
          • 關(guān)鍵字: 優(yōu)化  原理  設(shè)計(jì)  電路  語(yǔ)言  CPLD/FPGA  VHDL  采用  

          高清晰LCD HDTV中使用Cyclone III FPGA技術(shù)

          • 高清晰LCD HDTV中使用Cyclone III FPGA技術(shù),當(dāng)今的液晶顯示(LCD) 技術(shù)在高清晰電視(HDTV) 領(lǐng)域得到了廣泛應(yīng)用,其挑戰(zhàn)在于如何獲得更高的分辨率,實(shí)現(xiàn)更快的數(shù)據(jù)速率。提高數(shù)據(jù)速率需要專業(yè)圖像處理算法來(lái)支持快速移動(dòng)的視頻。業(yè)界遇到的主要問(wèn)題是:怎樣實(shí)現(xiàn)這
          • 關(guān)鍵字: III  FPGA  技術(shù)  Cyclone  使用  LCD  HDTV  高清晰  

          MATLAB DSP在無(wú)傳感器矢量控制中的應(yīng)用

          • MATLAB DSP在無(wú)傳感器矢量控制中的應(yīng)用,1.引言   Matlab是一個(gè)強(qiáng)大的分析、計(jì)算和可視化工具,特別適用于控制系統(tǒng)的分析和模擬,但由于其依賴的平臺(tái)是計(jì)算機(jī)及其 CPU,因而由于 CPU系統(tǒng)功耗的原因,使得 MATLAB程序的執(zhí)行速度相對(duì)于高速信號(hào)的輸入/輸出顯
          • 關(guān)鍵字: 控制  應(yīng)用  矢量  傳感器  DSP  MATLAB  

          采用JTAG仿真器的DSP中斷檢測(cè)處理技術(shù)方案

          • 采用JTAG仿真器的DSP中斷檢測(cè)處理技術(shù)方案, 1、引言  4、DSP/BIOS 應(yīng)用及實(shí)時(shí)性分析   4.1 DSP/ BIOS的分析特性:  程序跟蹤:顯示寫(xiě)入目標(biāo)日志的事件并在程序執(zhí)行過(guò)程忠反映動(dòng)態(tài)控制流程?! ⌒阅鼙O(jiān)控:跟蹤、統(tǒng)計(jì)目標(biāo)板資源的使用情況?! ∥募鳎簩?/li>
          • 關(guān)鍵字: 處理  技術(shù)  方案  檢測(cè)  中斷  JTAG  仿真器  DSP  采用  

          采用DSP的聲音采集系統(tǒng)硬件原理及設(shè)計(jì)

          • 采用DSP的聲音采集系統(tǒng)硬件原理及設(shè)計(jì),聲音信號(hào)無(wú)處不在,同時(shí)也包含著大量的信息。在日常的生產(chǎn)生活中,我們分析聲音信號(hào),便可以簡(jiǎn)化過(guò)程,得到我們想要的結(jié)果。隨著 DSP芯片的性價(jià)比不斷攀升,使 DSP得以從軍用領(lǐng)域拓展到民用領(lǐng)域,由于 TI公司 DSP500
          • 關(guān)鍵字: 硬件  原理  設(shè)計(jì)  系統(tǒng)  采集  DSP  聲音  采用  

          DSP核信號(hào)采集系統(tǒng)通訊接口原理及設(shè)計(jì)

          • DSP核信號(hào)采集系統(tǒng)通訊接口原理及設(shè)計(jì), 數(shù)字信號(hào)處理器的發(fā)展也是日新月異,不僅行指令速度越來(lái)越快,而且其功耗也越來(lái)越低。許多儀器或檢測(cè)設(shè)備都不約而同地將DSP 應(yīng)用到那些數(shù)據(jù)量龐大而且需實(shí)時(shí)傳送數(shù)據(jù)的系統(tǒng)中。核信號(hào)數(shù)據(jù)采集系統(tǒng)也不例外,利用 D
          • 關(guān)鍵字: 接口  原理  設(shè)計(jì)  通訊  系統(tǒng)  信號(hào)  采集  DSP  

          基于FPGA快速A 律壓縮編碼的設(shè)計(jì)與實(shí)現(xiàn)

          • 摘要:本文針對(duì)A律13折線法的算法特點(diǎn),提出一種并行數(shù)據(jù)處理算法,實(shí)現(xiàn)了編碼的流水線操作。運(yùn)用VHDL語(yǔ)言將其在FPGA中實(shí)現(xiàn),借助quartus II6.0平臺(tái)進(jìn)行驗(yàn)證,并對(duì)驗(yàn)證結(jié)果進(jìn)行分析,評(píng)估了系統(tǒng)的性能,證實(shí)了該算法的
          • 關(guān)鍵字: FPGA  壓縮編碼    

          基于ARM和FPGA的微加速度計(jì)數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)

          • 摘要:基于常用的MEMS慣性器件微型加速度計(jì),介紹一種采用ARM和FPGA架構(gòu)來(lái)采集加速度數(shù)值的設(shè)計(jì)方案,微加速度計(jì)的模擬輸出信號(hào)經(jīng)A/D芯片轉(zhuǎn)換后由FPGA進(jìn)行處理和緩存,然后ARM接收FPGA的輸出數(shù)據(jù)并對(duì)數(shù)據(jù)進(jìn)行顯示和
          • 關(guān)鍵字: FPGA  ARM  微加速度計(jì)  數(shù)據(jù)采集    

          艾科瑞德推出超高速數(shù)據(jù)采集處理平臺(tái)DSPEED-ADC_S4000

          •   北京艾科瑞德科技日前宣布,其采用業(yè)界頂級(jí)超高速10bit 2GSPS ADC的數(shù)據(jù)采集處理平臺(tái)DSPEED-ADC_S4000正式上市。該平臺(tái)采用兩片10bit 2GSPS ADC完成前端超高速模數(shù)轉(zhuǎn)換,配合兩片Xilinx Virtex-5系列高密度FPGA以及一顆TI高性能定點(diǎn)DSP TMS320C6455作為運(yùn)算核心,集成大容量DDR2、FIFO等高速動(dòng)態(tài)存儲(chǔ)器,可完成諸如數(shù)字下變頻、多級(jí)濾波、數(shù)據(jù)抽取、傅立葉變換等各種復(fù)雜的數(shù)字信號(hào)處理應(yīng)用及算法評(píng)估。平臺(tái)尺寸為6U cPCI工業(yè)標(biāo)準(zhǔn),接插件上
          • 關(guān)鍵字: 艾科瑞德  ADC  FPGA  數(shù)據(jù)采集處理平臺(tái)  

          基于DSP的高速激光標(biāo)記控制系統(tǒng)設(shè)計(jì)

          • 基于DSP的高速激光標(biāo)記控制系統(tǒng)設(shè)計(jì), 0 引言  振鏡掃描式激光標(biāo)記技術(shù)就是通過(guò)控制兩片高速振鏡的偏轉(zhuǎn)角, 改變激光的傳播方向, 經(jīng)過(guò)F-Theata透鏡在工件表面的聚焦, 在工件表面作標(biāo)記。與傳統(tǒng)的標(biāo)記技術(shù)相比, 它具有適用面廣(對(duì)不同材料、形狀的加工表
          • 關(guān)鍵字: 控制系統(tǒng)  設(shè)計(jì)  標(biāo)記  激光  DSP  高速  基于  

          IntegrIT加盟Tensilica Xtensions合作伙伴網(wǎng)絡(luò)

          •   Tensilica今日宣布,業(yè)界領(lǐng)先的DSP(數(shù)字信號(hào)處理)軟件設(shè)計(jì)解決方案供應(yīng)商IntegrIT公司,加盟Tensilica Xtensions合作伙伴網(wǎng)絡(luò),提供關(guān)鍵的軟件組件,包括用于ConnX基帶引擎、HiFi音頻DSP以及ConnX D2通信DSP的高性能Nature DSP Signal+ 函數(shù)庫(kù)。IntegrIT Nature DSP Signal+是協(xié)助實(shí)現(xiàn)典型DSP算法的一套信號(hào)處理函數(shù)庫(kù)。Nature DSP Signal+ 函數(shù)庫(kù)針對(duì)ConnX 系列DSP進(jìn)行優(yōu)化,能夠充分利用Co
          • 關(guān)鍵字: Tensilica  DSP  

          Altera和Apical交付首個(gè)HD WDR FPGA監(jiān)控應(yīng)用解決方案

          •   Altera公司和Apical有限公司今天宣布,為視頻監(jiān)控?cái)z像機(jī)提供世界上第一個(gè)高清晰寬動(dòng)態(tài)范圍(WDR) CMOS圖像傳感器處理解決方案。在內(nèi)華達(dá)洲拉斯維加斯3月24號(hào)到26號(hào)舉行的國(guó)際安防大會(huì)(ISC)西部博覽會(huì)上,Altera展示了這一解決方案。Altera和Apical全面的解決方案保證了各種照明條件下優(yōu)異的視頻圖像質(zhì)量,而這是前幾代監(jiān)控?cái)z像機(jī)面臨的主要瓶頸問(wèn)題。結(jié)合Altera的 Cyclone® III和Cyclone IV FPGA以及Apical的知識(shí)產(chǎn)權(quán)(IP),這一解決方案
          • 關(guān)鍵字: Altera  FPGA  視頻監(jiān)控  CMOS  
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