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UWB - 智能物聯(lián)的未來之星，你怎么看他？低功耗Wi-Fi解決方案在智能家居的應(yīng)用和發(fā)展結(jié)合超寬帶測(cè)距和雷達(dá)功能以實(shí)現(xiàn)高級(jí)IoT應(yīng)用來這里瞧瞧NXP技術(shù)培訓(xùn)視頻吧>>

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基于DSP的CAN總線系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)

基于DSP的CAN總線系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn),摘要：介紹了基于DSP的CAN控制器的設(shè)計(jì)及應(yīng)用方法，利用該方法可以在波特率高達(dá)lMb／s的條件下穩(wěn)定、可靠地傳輸數(shù)據(jù)，而且延遲時(shí)間很少。實(shí)驗(yàn)證明，利用TMS320F2812內(nèi)嵌的CAN模塊來構(gòu)成的硬件電路和軟件設(shè)計(jì)十分簡(jiǎn)單
關(guān)鍵字：設(shè)計(jì) 實(shí)現(xiàn) 系統(tǒng) 總線 DSP CAN 基于

ISPl362在基于FPGA的紅外成像系統(tǒng)中的應(yīng)用

摘要：ISPl362是飛利浦推出的一款USB可編程控制芯片，其內(nèi)部集成了一個(gè)高級(jí)主控制器，一個(gè)外設(shè)控制器，主機(jī)和設(shè)備控制器兼容USB 2．O協(xié)議，支持12 Mb／s的全速傳輸和1．5 Mb／s的低速傳輸；芯片有三種工作模式，即主
關(guān)鍵字： ISPl FPGA 362 紅外成像系統(tǒng)

一種基于FPGA的可編程電壓源系統(tǒng)設(shè)計(jì)

0引言可編程電源指某些功能或參數(shù)可以通過計(jì)算機(jī)軟件編程進(jìn)行控制的電源。可編程電源的實(shí)現(xiàn)方法...
關(guān)鍵字： FPGA 可編程電壓源設(shè)計(jì) Cyclone

Altera量產(chǎn)發(fā)售低成本低功耗Cyclone IV FPGA

　　Altera公司今天宣布，開始批量發(fā)售Cyclone® IV FPGA。公司還宣布開始提供基于Cyclone IV GX的收發(fā)器入門開發(fā)套件。Altera的Cyclone IV FPGA設(shè)計(jì)用于無線、固網(wǎng)、廣播、工業(yè)和消費(fèi)類市場(chǎng)等低成本、小型封裝應(yīng)用。與前一代Cyclone產(chǎn)品相比，這些器件前所未有的同時(shí)實(shí)現(xiàn)了低成本和高性能，功耗降低25%，滿足了大批量低成本串行協(xié)議解決方案的需求。　　Altera器件市場(chǎng)資深總監(jiān)Luanne Schirrmeister評(píng)論說：“我們比競(jìng)爭(zhēng)產(chǎn)品
關(guān)鍵字： Altera FPGA Cyclone 開發(fā)套件

基于FPGA的TDI-CCD時(shí)序電路設(shè)計(jì)

摘要：介紹TDI-CCD的特點(diǎn)、工作原理，根據(jù)項(xiàng)目所使用的TDI-CCD的使用要求，設(shè)計(jì)一種基于Altera公司的現(xiàn)場(chǎng)可編程門陣列(FPGA)EP3C-25Q240的TDI-CCD驅(qū)動(dòng)時(shí)序電路，驅(qū)動(dòng)時(shí)序使用VHDL語言編寫，在QuartusⅡ平臺(tái)上進(jìn)行時(shí)序
關(guān)鍵字： TDI-CCD FPGA 時(shí)序電路設(shè)計(jì)

基于H．264視頻編解碼DSP實(shí)現(xiàn)與優(yōu)化

基于H．264視頻編解碼DSP實(shí)現(xiàn)與優(yōu)化,摘要：H．264是最新的視頻編碼國(guó)際標(biāo)準(zhǔn)，是圖像通信研究領(lǐng)域的熱點(diǎn)問題之一，利用高性能數(shù)字信號(hào)處理器來實(shí)現(xiàn)H．264：實(shí)時(shí)編解碼是一種快速有效的方法，有助于H．264視頻標(biāo)準(zhǔn)的迅速推廣和應(yīng)用。TI公司生產(chǎn)的DM64X系列
關(guān)鍵字：實(shí)現(xiàn) 優(yōu)化 DSP 解碼視頻基于

基于FPGA快速A 律壓縮編碼的設(shè)計(jì)與實(shí)現(xiàn)

摘要:本文針對(duì)A律13折線法的算法特點(diǎn)，提出一種并行數(shù)據(jù)處理算法，實(shí)現(xiàn)了編碼的流水線操作。運(yùn)用VHDL語言將其在FPGA中實(shí)現(xiàn)，借助quartus II6.0平臺(tái)進(jìn)行驗(yàn)證，并對(duì)驗(yàn)證結(jié)果進(jìn)行分析，評(píng)估了系統(tǒng)的性能，證實(shí)了該算法的
關(guān)鍵字： FPGA 壓縮編碼

基于ARM和FPGA的微加速度計(jì)數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)

摘要：基于常用的MEMS慣性器件微型加速度計(jì)，介紹一種采用ARM和FPGA架構(gòu)來采集加速度數(shù)值的設(shè)計(jì)方案，微加速度計(jì)的模擬輸出信號(hào)經(jīng)A／D芯片轉(zhuǎn)換后由FPGA進(jìn)行處理和緩存，然后ARM接收FPGA的輸出數(shù)據(jù)并對(duì)數(shù)據(jù)進(jìn)行顯示和
關(guān)鍵字： FPGA ARM 微加速度計(jì) 數(shù)據(jù)采集

采用FPGA的可編程電壓源系統(tǒng)原理及設(shè)計(jì)

采用FPGA的可編程電壓源系統(tǒng)原理及設(shè)計(jì),概述：介紹一種基于FPGA的可編程電壓源系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)。采用FPGA為控制芯片，應(yīng)用QuartusⅡ軟件和硬件描述語言為工具，通過數(shù)／模轉(zhuǎn)換和運(yùn)放把數(shù)字信號(hào)轉(zhuǎn)換成模擬電壓信號(hào)。實(shí)驗(yàn)表明，該系統(tǒng)操作靈活方便，穩(wěn)定性強(qiáng)
關(guān)鍵字：原理設(shè)計(jì) 系統(tǒng) 電壓 FPGA 可編程采用

基于EDA仿真技術(shù)解決FPGA設(shè)計(jì)開發(fā)中故障的方法

基于EDA仿真技術(shù)解決FPGA設(shè)計(jì)開發(fā)中故障的方法,　FPGA近年來在越來越多的領(lǐng)域中應(yīng)用，很多大通信系統(tǒng)（如通信基站等）都用其做核心數(shù)據(jù)的處理。但是過長(zhǎng)的編譯時(shí)間，在研發(fā)過程中使得解決故障的環(huán)節(jié)非常令人頭痛。本文介紹的就是一種用仿真方法解決故障從而減少研
關(guān)鍵字：設(shè)計(jì)開發(fā) 故障方法 FPGA 解決 EDA 仿真技術(shù) 基于

采用FPGA技術(shù)的智能導(dǎo)盲犬設(shè)計(jì)方案

采用FPGA技術(shù)的智能導(dǎo)盲犬設(shè)計(jì)方案,眾所周知眼晴是“心靈之窗”，而對(duì)于突然失去或從未擁有過“心靈之窗”的盲人來說，生活上的困難與心理上的痛苦是可想而知的。他們的衣食住行存在諸多不便，而在出行與人際交往中遇到的困難更加突出，基于此設(shè)計(jì)了智
關(guān)鍵字：設(shè)計(jì) 方案智能技術(shù) FPGA 采用

采用CPLD/FPGA的VHDL語言電路優(yōu)化原理設(shè)計(jì)

采用CPLD/FPGA的VHDL語言電路優(yōu)化原理設(shè)計(jì),VHDL(Very High Speed Integrated Circuit Hardware Description Language)是IEEE工業(yè)標(biāo)準(zhǔn)硬件描述語言，是隨著可編程邏輯器件(PLD)的發(fā)展而發(fā)展起來的。它是一種面向設(shè)計(jì)、多層次的硬件描述語言，是集行為描述、RTL
關(guān)鍵字：優(yōu)化原理設(shè)計(jì) 電路語言 CPLD/FPGA VHDL 采用

高清晰LCD HDTV中使用Cyclone III FPGA技術(shù)

高清晰LCD HDTV中使用Cyclone III FPGA技術(shù),當(dāng)今的液晶顯示(LCD) 技術(shù)在高清晰電視(HDTV) 領(lǐng)域得到了廣泛應(yīng)用，其挑戰(zhàn)在于如何獲得更高的分辨率，實(shí)現(xiàn)更快的數(shù)據(jù)速率。提高數(shù)據(jù)速率需要專業(yè)圖像處理算法來支持快速移動(dòng)的視頻。業(yè)界遇到的主要問題是：怎樣實(shí)現(xiàn)這
關(guān)鍵字： III FPGA 技術(shù) Cyclone 使用 LCD HDTV 高清晰

MATLAB DSP在無傳感器矢量控制中的應(yīng)用

MATLAB DSP在無傳感器矢量控制中的應(yīng)用,1.引言　　Matlab是一個(gè)強(qiáng)大的分析、計(jì)算和可視化工具，特別適用于控制系統(tǒng)的分析和模擬，但由于其依賴的平臺(tái)是計(jì)算機(jī)及其 CPU，因而由于 CPU系統(tǒng)功耗的原因，使得 MATLAB程序的執(zhí)行速度相對(duì)于高速信號(hào)的輸入/輸出顯
關(guān)鍵字：控制應(yīng)用矢量傳感器 DSP MATLAB

采用JTAG仿真器的DSP中斷檢測(cè)處理技術(shù)方案

采用JTAG仿真器的DSP中斷檢測(cè)處理技術(shù)方案, 1、引言　4、DSP/BIOS 應(yīng)用及實(shí)時(shí)性分析　　4.1 DSP/ BIOS的分析特性：　　程序跟蹤：顯示寫入目標(biāo)日志的事件并在程序執(zhí)行過程忠反映動(dòng)態(tài)控制流程。　　性能監(jiān)控：跟蹤、統(tǒng)計(jì)目標(biāo)板資源的使用情況?！　∥募鳎簩?/li>
關(guān)鍵字：處理技術(shù) 方案檢測(cè) 中斷 JTAG 仿真器 DSP 采用

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利用FPGA資源和最小模擬電路發(fā)電進(jìn)行開關(guān)電源設(shè)計(jì)的方法
一種基于DSP和USB的指紋識(shí)別系統(tǒng)設(shè)計(jì)
基于FPGA的機(jī)載顯示系統(tǒng)架構(gòu)設(shè)計(jì)與優(yōu)化
基于FPGA+DSP遠(yuǎn)程監(jiān)控器設(shè)計(jì)與實(shí)現(xiàn)

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如何使用FPGA和PCI總線實(shí)現(xiàn)天文圖像實(shí)時(shí)采集與處理系統(tǒng)的設(shè)計(jì)
如何使用FPGA實(shí)現(xiàn)多通道高速CMOS圖像采集系統(tǒng)的設(shè)計(jì)
如何使用FPGA實(shí)現(xiàn)新型高速CCD圖像數(shù)據(jù)采集系統(tǒng)
基于FPGA的數(shù)字存儲(chǔ)示波器設(shè)計(jì)與實(shí)現(xiàn)
基于DSP和PC的農(nóng)業(yè)機(jī)器人控制系統(tǒng)
基于DSP的工業(yè)機(jī)器人控制器的設(shè)計(jì)與實(shí)現(xiàn)
基于DSP的高壓訓(xùn)線機(jī)器人數(shù)字化控制器
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