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          FPGA 時序收斂

          • 您編寫的代碼是不是雖然在仿真器中表現(xiàn)正常,但是在現(xiàn)場卻斷斷續(xù)續(xù)出錯?要不然就是有可能在您使用更高版本的工...
          • 關(guān)鍵字: FPGA  

          采用FPGA實現(xiàn) DisplayPort

          基于SmartFusion的光伏逆變控制和功率管理方案

          • 本文主要介紹基于Actel SmartFusion系列FPGA在光伏應(yīng)用中的逆變控制和功率管理方案。隨著社會的發(fā)展,可再生能源的應(yīng)用越來越受青睞,光伏應(yīng)用作為一項新興技術(shù)正在高速發(fā)展。在基于光電流的系統(tǒng)中,電源逆變器控制著太陽能板和電池,以及負(fù)載之間的電流,將太陽能板輸出的變化幅度很大的直流電壓轉(zhuǎn)換成干凈的50Hz或60Hz的正弦電流,輸出給負(fù)載或回饋到電網(wǎng)中去,整個系統(tǒng)如圖1所示,其中A為太陽能電池板,B為逆變 器控制和功率管理單元,C為功率開關(guān)管和DC-DC轉(zhuǎn)換器,D是功率監(jiān)控。
          • 關(guān)鍵字: Actel  DC-DC轉(zhuǎn)換器  FPGA  201108  

          基于FPGA的智能超市手推車及應(yīng)用

          • 本作品設(shè)計并實現(xiàn)了一種基于多傳感器、RFID標(biāo)簽與PWM控制的智能超市手推車系統(tǒng),在Degilent公司最初級的開發(fā)板Basys上完成了設(shè)計的全部功能。通過安裝在小車頂部的紅外線傳感器與超聲波傳感器,實時感知小車與用戶的距離信息,并反饋給PWM來控制電機(jī)的轉(zhuǎn)速與小車的姿態(tài),通過利用RFID標(biāo)簽作為啟動小車的電子鑰匙,增強(qiáng)了用戶使用時的安全可靠性。
          • 關(guān)鍵字: Degilent  FPGA  RFID  201108  

          Micro/sys采用賽靈思Spartan-6 FPGA推出單板計算機(jī)

          • 2011 年 9 月 22 日,中國北京 — 全球可編程平臺領(lǐng)導(dǎo)廠商賽靈思公司 (Xilinx, Inc. (NASDAQ:XLNX) )今天宣布,Micro/sys 公司采用集成了MicroBlaze 處理器子系統(tǒng)的Spartan-6 FPGA 和 ARM Cortex-A8 處理器推出了一款小型低功耗高穩(wěn)健型計算機(jī)板。該最新商用 Micro/sys SBC1651 單板計算機(jī) (SBC) 使嵌入式用戶不僅能夠用一個單板處理各種應(yīng)用的不同 I/O(輸入/輸出)配置任務(wù),同時還可降低生產(chǎn)成本,縮短產(chǎn)品上市
          • 關(guān)鍵字: 賽靈思  FPGA  

          基于FPGA的高光效LCD投影機(jī)設(shè)計

          • 基于FPGA的高光效LCD投影機(jī)設(shè)計,引言
            顯示技術(shù)正朝著大屏幕、高清晰度、高亮度和高分辨率的方向發(fā)展。通常說來,將屏幕顯示面對角線尺寸在1米(40英寸)以上的顯示稱為大屏幕顯示。投影機(jī)作為一種重要的顯示設(shè)備,已經(jīng)廣泛地應(yīng)用到了金融、教育、企業(yè)
          • 關(guān)鍵字: 投影機(jī)  設(shè)計  LCD  高光  FPGA  基于  

          浮點LMS算法的FPGA實現(xiàn)

          • 浮點LMS算法的FPGA實現(xiàn),引言
              LMS(最小均方)算法因其收斂速度快及算法實現(xiàn)簡單等特點在自適應(yīng)濾波器、自適應(yīng)天線陣技術(shù)等領(lǐng)域得到了十分廣泛的應(yīng)用。為了發(fā)揮算法的最佳性能,必須采用具有大動態(tài)范圍及運算精度的浮點運算,而浮點運算的
          • 關(guān)鍵字: 實現(xiàn)  FPGA  算法  LMS  浮點  

          FPGA+MCU實現(xiàn)VGA圖象信號發(fā)生器

          • FPGA+MCU實現(xiàn)VGA圖象信號發(fā)生器,1、引言  VGA(視頻圖形陣列)作為一種標(biāo)準(zhǔn)的顯示接口在視頻和計算機(jī)領(lǐng)域得到了廣泛的應(yīng)用。VGA圖像信號發(fā)生器是電視臺、電視機(jī)生產(chǎn)企業(yè)、電視維修人員常用的儀器,其主要功能就是產(chǎn)生標(biāo)準(zhǔn)的圖像測試信號。
              本
          • 關(guān)鍵字: 圖象  信號發(fā)生器  VGA  實現(xiàn)  MCU  FPGA  

          基于FPGA的UART接口模塊設(shè)計

          • 基于FPGA的UART接口模塊設(shè)計,UART(UniversalAnynchronousReceiverTransmitter,通用異步接收發(fā)送器)是廣泛應(yīng)用的串行數(shù)據(jù)傳輸協(xié)議之一,其應(yīng)用范圍遍及計算機(jī)外設(shè)、工控自動化等場合。雖然USB傳輸協(xié)議比UART協(xié)議有更高的性能,但電路復(fù)雜開發(fā)難
          • 關(guān)鍵字: 模塊  設(shè)計  接口  UART  FPGA  基于  

          基于RF芯片nRF401的無線數(shù)傳模塊設(shè)計

          • 所設(shè)計的無線數(shù)傳模塊由單片射頻收發(fā)芯片NRF401、AT89C52微控制器和MAX3316接口芯片構(gòu)成,工作在433.92/434.33MHz頻段;可方便地嵌入在各種測量和控制系統(tǒng)中進(jìn)行無線數(shù)據(jù)傳輸,在車輛監(jiān)控、無線抄表、無線232數(shù)據(jù)通
          • 關(guān)鍵字: 模塊  設(shè)計  無線  nRF401  RF  芯片  基于  

          直擴(kuò)系統(tǒng)PN碼捕獲和跟蹤的FPGA實現(xiàn)

          • 摘要:在數(shù)字匹配濾波器和超前滯后鑒相環(huán)路的理論基礎(chǔ)上,采用VHDL編程,在FPGA芯片上實現(xiàn)PN碼捕獲和跟蹤的電路。詳細(xì)討論了各電路模塊的設(shè)計實現(xiàn)方法。完成電路的仿真驗證,給出了仿真波形。結(jié)果表明電路工作正???/li>
          • 關(guān)鍵字: FPGA  直擴(kuò)系統(tǒng)  PN碼    

          基于FPGA的電梯控制系統(tǒng)設(shè)計

          • 摘要:介紹了基于FPGA的四層電梯控制系統(tǒng)的設(shè)計。該系統(tǒng)采用Altera公司的CycloneⅡ系列FPGA芯片EP2C5T144作為主控制芯片,采用Verilog-HDL編程描述,實現(xiàn)對電梯的智能控制,經(jīng)仿真驗證,完成所要求功能。該設(shè)計采用模
          • 關(guān)鍵字: FPGA  電梯控制  系統(tǒng)設(shè)計    

          用LabVIEW FPGA模塊實現(xiàn)不同時鐘域的數(shù)據(jù)連續(xù)傳輸

          • 摘要:為了解決基于LabVIEWFPGA模塊的DMAFIFO深度設(shè)定不當(dāng)帶來的數(shù)據(jù)不連續(xù)問題,結(jié)合LabVIEWFPGA的編程特點和DMA FIFO的工作原理,提出了一種設(shè)定FIFO深度的方法。對FIFO不同深度的實驗表明,采用該方法設(shè)定的FIFO深
          • 關(guān)鍵字: LabVIEW  FPGA  模塊  傳輸    

          基于FPGA的高速自適應(yīng)格型濾波器的實現(xiàn)

          • 摘要:針對高速高靈敏度數(shù)字信號處理時對于自適應(yīng)濾波器的數(shù)值特性和實時性的要求,在一種自適應(yīng)格型聯(lián)合濾波器的基礎(chǔ)上提出算法改進(jìn),采用馳豫超前流水線技術(shù)和時序重構(gòu)技術(shù),在損失較小濾波性能的情況下,在FPGA中
          • 關(guān)鍵字: FPGA  濾波器    

          cpld fpga 區(qū)別

          • 系統(tǒng)的比較,與大家共享:盡管FPGA和CPLD都是可編程ASIC器件,有很多共同特點,但由于CPLD和FPGA結(jié)構(gòu)上的差異,具有各自的特點:①CPLD更適 ...
          • 關(guān)鍵字: cpld  fpga  
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