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          <label id="pryje"></label>
          


          
	
  	
          
	
          
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	verilog-xl
          

          
	
          
    	
          
    	  	
          
              	
                                
          
                  

                                
          
                    
          HDLC協(xié)議控制器的IP核方案及其實現(xiàn)
          
                                                            
            
                    	
          •  介紹了HDLC協(xié)議控制器的IP核方案及實現(xiàn)方法，分別對發(fā)送和接收模塊進行了分析，給出了仿真波形圖。該設計采用Verilog HDL語言進行描述，用ModelSim SE 6.0進行了功能仿真。
            • 
                    	                        
          • 關鍵字：
                        IP核  Verilog  HDLC協(xié)議控制器                          
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          Verilog HDL基礎之：Verilog HDL語言簡介
          
                                                            
            
                    	
          • Verilog HDL是硬件描述語言的一種，用于數(shù)字電子系統(tǒng)設計。它允許設計者用它來進行各種級別的邏輯設計，可以用它進行數(shù)字邏輯系統(tǒng)的仿真驗證、時序分析、邏輯綜合。它是目前應用最廣泛的一種硬件描述語言之一。Verilog HDL是在1983年由GDA公司的Phil Moorby首創(chuàng)的。
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          • 關鍵字：
                        VerilogHDL  VHDL  Verilog-XL  華清遠見                          
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          采用Verilog的數(shù)字跑表設計及實驗
          
                                                            
            
                    	
          • 本節(jié)通過Verilog HDL語言編寫一個具有“百分秒、秒、分”計時功能的數(shù)字跑表，可以實現(xiàn)一個小時以內(nèi)精確至百分之一秒的計時。
            • 
                    	                        
          • 關鍵字：
                        計數(shù)器  數(shù)字跑表  Verilog                          
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          基于FPGA光電容積脈搏波參數(shù)檢測的IP核設計
          
                                                            
            
                    	
          •  文章簡要介紹了從光電容積脈搏波中提取出的特征值有助于在醫(yī)學領域中分析人體的病理特征。為了檢測脈搏波的血流參數(shù),整個系統(tǒng)采用Altera公司cyclone系列的FPGA開發(fā)平臺,運用硬件語言Verilog HDL編程設計了波形參數(shù)的檢測模塊,通過設計IP核進行數(shù)據(jù)處理并實現(xiàn)了脈搏波的實時檢測。使用了QuartusⅡ、Icarus verilog和GTKwave軟件進行綜合仿真,并通過FPGA原型驗證。創(chuàng)新點在于采用FPGA通過硬件的方式提高了實時檢測的速度,降低了開發(fā)成本,增強了可攜帶性。
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          • 關鍵字：
                        病理特征  Verilog  原型驗證                          
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          基于Verilog HDL的I2C總線功能的實現(xiàn)
          
                                                            
            
                    	
          • 簡述了I2C總線的特點;介紹了開發(fā)FPGA時I2C總線模塊的設計思路;給出并解釋了用Verilog HDL實現(xiàn)部分I2C總線功能的程序,以及I2C總線主從模式下的仿真時序圖。
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          • 關鍵字：
                        Verilog  I2C  仿真時序                          
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          基于Verilog的SMBus總線控制器的設計與實現(xiàn)
          
                                                            
            
                    	
          • SMBus是一種高效的同步串行總線。通過分析SMBus總線協(xié)議，提出了一種運行于基于PCI-Express技術的橋接芯片上的SMBus控制器的設計方案，并且用Verilog語言描述，最后在Altera公司的FPGA上得以實現(xiàn)。通過仿真測試，證明該方法是穩(wěn)定有效的。
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          • 關鍵字：
                        SMBus總線  Verilog  有限狀態(tài)機                          
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          基于FPGA的3D圖像處理器IP核的實現(xiàn)
          
                                                            
            
                    	
          • LCD顯示屏的應用越來越廣，數(shù)量越來越多。LCD顯示屏應用廣泛,無處不在。如家庭各種電器設備。更常見是用于各種公共場合如體育館、廣場等商業(yè)用途。給我們傳遞一種更為直觀、生動的信息。從此我們的生活發(fā)生了巨大改變。巨大的應用巨大的市場帶來了巨大的商機?；贔PGA的LCD顯示的3D影像是為了LCD顯示屏的信息量更多，滿足人需求。
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          • 關鍵字：
                        IP核  3D圖像處理器  FPGA  LCD  Verilog                          
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          基于至簡設計法實現(xiàn)的PWM調(diào)制verilog
          
                                                            
                                        
            
                    	
          • 　　一、 功能描述　　脈沖寬度調(diào)制(pulse width modelation)簡稱PWM，利用微處理器的數(shù)字輸出來對模擬電路進行控制的一種非常有效的技術，廣泛應用在從測量、通信到功率控制與變換的許多領域中脈沖寬度調(diào)制是利用微處理器的數(shù)字輸出來對模擬電路進行控制的一種非常有效的技術，廣泛應用在從測量、通信到功率控制與變換的許多領域中?！　≡诒菊碌膽弥锌梢哉J為PWM就是一種方波。如圖所示：　　  
　　PWM波形圖　　上圖是一個周期為10ms，高電平為
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          • 關鍵字：
                        PWM  verilog                          
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          基于FPGA的自適應均衡器的研究與設計
          
                                                            
            
                    	
          • 摘要：近年來，自適應均衡技術在通信系統(tǒng)中的應用日益廣泛，利用自適應均衡技術在多徑環(huán)境中可以有效地提高數(shù)字接收機的性能。為了適應寬帶數(shù)字接收機的高速率特點，本文闡述了自適應均衡器的原理并對其進行改進。最
            • 
                    	                        
          • 關鍵字：
                        自適應均衡器  寬帶數(shù)字接收機  FPGA  Verilog HDL                          
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          Verilog HDL設計進階：有限狀態(tài)機的設計原理及其代碼風格
          
                                                            
            
                    	
          • 由于Verilog HDL和 VHDL 行為描述用于綜合的歷史還只有短短的幾年，可綜合風格的Verilog HDL  和VHDL的語法只是它們各自語言的一個子集。又由于HDL的可綜合性研究近年來非常活躍，可綜合子集的國際標準目前尚未最后形
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          • 關鍵字：
                        Verilog  HDL  進階  代碼                            
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          Verilog HDL硬件描述語言：task和function說明語句的區(qū)別
          
                                                            
            
                    	
          • task和function說明語句的區(qū)別task和function說明語句分別用來定義任務和函數(shù)。利用任務和函數(shù)可以把一個很大的程序模塊分解成許多較小的任務和函數(shù)便于理解和調(diào)試。輸入、輸出和總線信號的值可以傳入或傳出任務和函
            • 
                    	                        
          • 關鍵字：
                        function  Verilog  task  HDL                            
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          對 Verilog 和 VHDL 說再見！
          
                                                            
            
                    	
          •  上周我跟我同事說，“ 兩種語言阻礙了嵌入式系統(tǒng)開發(fā)人員和軟件工程師借助Zynq SOCs來提升系統(tǒng)性能。”那就是“Verilog” 和  “VHDL”正如期待那樣，這已經(jīng)得到了解決—因為SD
            • 
                    	                        
          • 關鍵字：
                        Verilog    VHDL    SDSoC                          
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          基于FPGA的高速長線陣CCD驅(qū)動電路
          
                                                            
            
                    	
          •  高速長線陣CCD(電荷耦合器)具有低功耗，小體積，高精度等優(yōu)勢，廣泛應用于航天退掃系統(tǒng)中的圖像數(shù)據(jù)采集。而CCD驅(qū)動電路設計是CCD正常工作的關鍵問題之一，CCD驅(qū)動信號時序是一組相位要求嚴格的脈沖信號，只有時序信
            • 
                    	                        
          • 關鍵字：
                        CCD  線陣  FPGA  verilog HDL                          
            • 
                   	
          
                    
          
                
          
                                
          
                    
          基于Verilog HDL的SVPWM算法的設計與仿真
          
                                                            
            
                    	
          • 摘要：空間矢量脈寬調(diào)制算法是電壓型逆變器控制方面的研究熱點，廣泛應用于三相電力系統(tǒng)中?；谟布腇PGA/CPLD芯片能滿足該算法對處理速度、實時性、可靠性較高的要求，本文利用Verilog  HDL實現(xiàn)空間矢量脈寬調(diào)制算
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          • 關鍵字：
                        同步電動機  電壓型逆變器  Verilog HDL                          
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          一種高效網(wǎng)絡接口的設計
          
                                                            
            
                    	
          • 為了得到比傳統(tǒng)片上網(wǎng)絡的網(wǎng)絡資源接口(NI)更高的數(shù)據(jù)傳輸效率和更加穩(wěn)定的數(shù)據(jù)傳輸效果，提出了一種新的高效網(wǎng)絡接口的設計方法，并采用Verilog HDL語言對相關模塊進行編程，實現(xiàn)了高效傳輸功能，同時又滿足核內(nèi)路由的設計要求。最終通過仿真軟件Xilinx ISE Design Suite 12．3和ModelSim SE 6．2b得到了滿足設計要求的仿真結果。
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          • 關鍵字：
                        片上網(wǎng)絡  網(wǎng)絡資源接口  核內(nèi)路由  Verilog HDL                          
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