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xilinx fpga 文章 進(jìn)入xilinx fpga技術(shù)社區(qū)
基于FPGA的空間電場(chǎng)信號(hào)數(shù)據(jù)采集與處理系統(tǒng)設(shè)計(jì)
- 提出一種基于FPGA的空間電場(chǎng)信號(hào)數(shù)據(jù)采集與處理系統(tǒng)的設(shè)計(jì)方案，F(xiàn)PGA為主控制器控制A／D采樣和同步422發(fā)送。X，Y，Z三個(gè)方向的空間電場(chǎng)信號(hào)經(jīng)過(guò)信號(hào)處理和A／D采樣，在FPGA片內(nèi)濾波劃分為不同的頻段，通過(guò)同步422接口發(fā)送到后續(xù)設(shè)備。該系統(tǒng)性能可靠穩(wěn)定，致力于應(yīng)用在探空火箭有效載荷——箭載電場(chǎng)儀上，對(duì)其他電場(chǎng)信號(hào)采集與處理系統(tǒng)也有
- 關(guān)鍵字： 空間電場(chǎng) 數(shù)據(jù)采集 FPGA
高速定點(diǎn)FFT算法的FPGA設(shè)計(jì)方案
- 著重討論基于FPGA的64點(diǎn)高速FFT算法的實(shí)現(xiàn)方法。采用高基數(shù)結(jié)構(gòu)和流水線結(jié)構(gòu)，大大提高了FFT處理器的運(yùn)行速度。同時(shí)塊浮點(diǎn)結(jié)構(gòu)的引入，也大幅減少了浮點(diǎn)操作占用FPGA器件的資源數(shù)目，兼顧了FPGA高精度、低資源、低功耗的特點(diǎn)。
- 關(guān)鍵字： 高速FFT算法 高基數(shù)結(jié)構(gòu) FPGA 流水線結(jié)構(gòu)
基于Nios II的多媒體廣告系統(tǒng)
- 電子屏的出現(xiàn)，不僅可以使企業(yè)更全面的展示產(chǎn)品，推廣企業(yè)文化，而且可以滿足不同讀者的需求，改善城市環(huán)境，提升人民生活質(zhì)量，更重要的是廣告能夠更及時(shí)、更準(zhǔn)確、更全面的展示自己的新產(chǎn)品，第一時(shí)間與消費(fèi)者進(jìn)行溝通，贏得市場(chǎng)，獲取利潤(rùn)，以及根據(jù)市場(chǎng)動(dòng)態(tài)更及時(shí)更全面的做出市場(chǎng)決策?；谝陨显颍覀儾捎肗ios II軟核設(shè)計(jì)了能及時(shí)發(fā)布戶外廣告、電子公告的多媒體廣告系統(tǒng)。
- 關(guān)鍵字： NiosII處理器 多媒體廣告 FPGA
基于FPGA的實(shí)時(shí)視頻信號(hào)處理平臺(tái)的設(shè)計(jì)與實(shí)現(xiàn)
- 提出一種基于FPGA 的實(shí)時(shí)視頻信號(hào)處理平臺(tái)的設(shè)計(jì)方法，該系統(tǒng)接收低幀率數(shù)字YCbCr 視頻信號(hào)，對(duì)接收的視頻信號(hào)進(jìn)行格式和彩色空間轉(zhuǎn)換、像素和，利用片外SDRAM 存儲(chǔ)器作為幀緩存且通過(guò)時(shí)序控制器進(jìn)行幀率提高，最后通過(guò)VGA 控制模塊對(duì)圖像信號(hào)進(jìn)行像素放大并在VGA 顯示器上實(shí)時(shí)顯示。整個(gè)設(shè)計(jì)使用Verilog HDL 語(yǔ)言實(shí)現(xiàn)，
- 關(guān)鍵字： 實(shí)時(shí)視頻信號(hào)處理 CCD圖像傳感器 FPGA YCbCr
FPGA設(shè)計(jì)者需要練好5項(xiàng)基本功
- 在我看來(lái)，成為一名說(shuō)得過(guò)去的FPGA設(shè)計(jì)者，需要練好5項(xiàng)基本功：仿真、綜合、時(shí)序分析、調(diào)試、驗(yàn)證。
- 關(guān)鍵字： 設(shè)計(jì)流程 仿真 FPGA 綜合 時(shí)序分析
面向FPGA應(yīng)用的電源設(shè)計(jì)
- 近幾年，F(xiàn)PGA 產(chǎn)業(yè)迅速擴(kuò)張，有越來(lái)越多的工程師從事著與 FPGA 相關(guān)的設(shè)計(jì)和研發(fā)工作。作為任何一款產(chǎn)品都不可或缺的電源，也面臨來(lái)自FPGA應(yīng)用的要求和挑戰(zhàn)。一方面是需求的增多，另一方面的技術(shù)指標(biāo)要求的不斷提升，如何幫助工程師輕松完成FPGA產(chǎn)品的電源設(shè)計(jì)，讓他們得以將更多的精力投入到核心部分的設(shè)計(jì)中，從而縮短設(shè)計(jì)周期，成了每個(gè)電源廠商要面對(duì)的問(wèn)題。為此，筆者采訪了來(lái)自優(yōu)質(zhì)電源產(chǎn)品供應(yīng)商凌力爾特公司的DC/DC μModule 產(chǎn)品市場(chǎng)經(jīng)理Afshin Odabaee，來(lái)聽(tīng)一聽(tīng)他對(duì)面向FPGA應(yīng)用的電
- 關(guān)鍵字： 靜態(tài)電流 散熱 FPGA
基于EDA技術(shù)的FPGA設(shè)計(jì)
- 對(duì)傳統(tǒng)電子系統(tǒng)設(shè)計(jì)方法與現(xiàn)代電子系統(tǒng)設(shè)計(jì)方法進(jìn)行了比較，引出了基于EDA技術(shù)的現(xiàn)場(chǎng)可編程門陣列（FPGA）電路，提出現(xiàn)場(chǎng)可編程門陣列（FPGA）是近年來(lái)迅速發(fā)展的大規(guī)模可編程專用集成電路（ASIC），在數(shù)字系統(tǒng)設(shè)計(jì)和控制電路中越來(lái)越受到重視。介紹了這種電路的基本結(jié)構(gòu)、性能特點(diǎn)、應(yīng)用領(lǐng)域及使用中的注意事項(xiàng)。對(duì)基于EDA技術(shù)的FPGA進(jìn)行了展望。指出EDA技術(shù)將是未來(lái)電子產(chǎn)品設(shè)計(jì)技術(shù)發(fā)展的主要方向。
- 關(guān)鍵字： 自動(dòng)化設(shè)計(jì) EDA FPGA
基于FPGA的多通道頻率檢測(cè)
- 多通道頻率檢測(cè)是當(dāng)前數(shù)字接收機(jī)的一種常用的頻率測(cè)量方案,該方法可以較好地解決頻率截獲概率與頻率分辨力的矛盾,并在復(fù)雜的電磁環(huán)境中具有處理多個(gè)同時(shí)到達(dá)信號(hào)的能力。文中給出了基于FPGA來(lái)實(shí)現(xiàn)多信道頻率測(cè)量的具體方案。該方案能夠充分發(fā)揮FP-GA硬件資源豐富的特點(diǎn),并且易于實(shí)現(xiàn)并行處理,可大幅度提高系統(tǒng)的處理速度。
- 關(guān)鍵字： 多信道頻率檢測(cè) 頻率截獲 FPGA
實(shí)時(shí)圖像小波無(wú)損壓縮系統(tǒng)的FPGA實(shí)現(xiàn)
- 將Altera 公司的DE2 多媒體開(kāi)發(fā)平臺(tái)與Terasic 公司的D5M 數(shù)碼相機(jī)開(kāi)發(fā)套件相結(jié)合，設(shè)計(jì)了一套基于小波無(wú)損壓縮的實(shí)時(shí)圖像處理系統(tǒng)。系統(tǒng)采用便于可編程邏輯器件靈活實(shí)現(xiàn)的二維整數(shù)5 /3 提升小波變換實(shí)現(xiàn)壓縮。為保證圖像的無(wú)損壓縮，對(duì)邊界數(shù)據(jù)進(jìn)行對(duì)稱周期延拓處理。并針對(duì)實(shí)時(shí)處理過(guò)程中的大容量數(shù)據(jù)流的存儲(chǔ)問(wèn)題，應(yīng)用片外存儲(chǔ)資源保存采集和處理過(guò)程中的圖像數(shù)據(jù)，有效地降低了片上存儲(chǔ)資源的消耗。測(cè)試結(jié)果表明: 系統(tǒng)滿足實(shí)時(shí)圖像采集、預(yù)處理及無(wú)損壓縮的要求。
- 關(guān)鍵字： 圖像處理 無(wú)損壓縮 FPGA
基于FPGA的H.264幀內(nèi)預(yù)測(cè)模塊設(shè)計(jì)
- 提出一種能實(shí)時(shí)處理的H.264/AVC幀內(nèi)預(yù)測(cè)硬件結(jié)構(gòu)。通過(guò)對(duì)H.264/AVC各個(gè)預(yù)測(cè)模式的分析，設(shè)計(jì)了一個(gè)通用運(yùn)算單元，提高了硬件資源的可重用性。采用4個(gè)并行運(yùn)算單元計(jì)算預(yù)測(cè)值，對(duì)運(yùn)算比較復(fù)雜的plane模式預(yù)處理，并設(shè)計(jì)模式預(yù)測(cè)器，加快了系統(tǒng)處理速度。硬件電路結(jié)構(gòu)已通過(guò)RTL級(jí)仿真及綜合，并在Altera公司的Cyclone II FPGA平臺(tái)上進(jìn)行了驗(yàn)證和測(cè)試。
- 關(guān)鍵字： H.264幀內(nèi)預(yù)測(cè) 視頻解碼器 FPGA
基于FPGA/Nios-Ⅱ的矩陣運(yùn)算硬件加速器設(shè)計(jì)
- 針對(duì)復(fù)雜算法中矩陣運(yùn)算量大,計(jì)算復(fù)雜,耗時(shí)多,制約算法在線計(jì)算性能的問(wèn)題,從硬件實(shí)現(xiàn)角度,研究基于FPGA/Nios-Ⅱ的矩陣運(yùn)算硬件加速器設(shè)計(jì),實(shí)現(xiàn)矩陣并行計(jì)算。首先根據(jù)矩陣運(yùn)算的算法分析,設(shè)計(jì)了矩陣并行計(jì)算的硬件實(shí)現(xiàn)結(jié)構(gòu),并在Modelsim中進(jìn)行功能模塊的仿真,然后將功能模塊集成一個(gè)自定制組件,并通過(guò)Avalon總線與NiosⅡ主處理器通信,作為硬件加速器。最后在FPGA芯片中構(gòu)建SoPC系統(tǒng),并在Altera DE3開(kāi)發(fā)板中進(jìn)行矩陣實(shí)時(shí)計(jì)算測(cè)試。測(cè)試結(jié)果驗(yàn)證了基于FPGA/Nios-Ⅱ矩陣運(yùn)算硬件
- 關(guān)鍵字： 硬件加速器 矩陣運(yùn)算 FPGA
TD-LTE綜合測(cè)試儀表關(guān)鍵模塊的研究與實(shí)現(xiàn)
- 在對(duì)OFDM調(diào)制以及FPGA、DSP、中頻接口進(jìn)行深入研究的基礎(chǔ)上，提出了一種TD-LTE系統(tǒng)中下行鏈路基帶信號(hào)發(fā)送的實(shí)現(xiàn)方案，在系統(tǒng)的設(shè)計(jì)思路和硬件資源上進(jìn)行了優(yōu)化。在實(shí)際的硬件環(huán)境下，通過(guò)大量測(cè)試，驗(yàn)證了該方案的可行性和有效性。
- 關(guān)鍵字： TD-LTE 基帶信號(hào)發(fā)送 FPGA
基于FPGA的腦機(jī)接口實(shí)時(shí)系統(tǒng)
- 給出了以FPGA為核心，實(shí)現(xiàn)基于瞬態(tài)視覺(jué)誘發(fā)電位的腦機(jī)接口實(shí)時(shí)系統(tǒng)的方案。該方案包括腦電采集電路、基于FPGA的VGA視覺(jué)刺激器和FPGA開(kāi)發(fā)板三部分。用FPGA取代計(jì)算機(jī)，作為腦機(jī)接口的控制和信息處理器。利用VHDL編程，在FPGA中實(shí)時(shí)處理采集的腦電信號(hào)，提取并識(shí)別瞬態(tài)視覺(jué)誘發(fā)電位信號(hào)，轉(zhuǎn)換為控制命令，反饋給視覺(jué)刺激器。實(shí)驗(yàn)結(jié)果表明，本方案可以有效地實(shí)現(xiàn)腦機(jī)接口實(shí)時(shí)系統(tǒng)，并達(dá)到較高的正確率和通信速度。
- 關(guān)鍵字： 腦機(jī)接口 VGA視覺(jué)刺激器 FPGA
xilinx fpga介紹
Xilinx FPGA
Xilinx FPGA主要分為兩大類，一種側(cè)重低成本應(yīng)用，容量中等，性能可以滿足一般的邏輯設(shè)計(jì)要求，如Spartan系列；還有一種側(cè)重于高性能應(yīng)用，容量大，性能能滿足各類高端應(yīng)用，如Virtex系列，用戶可以根據(jù)自己實(shí)際應(yīng)用要求進(jìn)行選擇。 在性能可以滿足的情況下，優(yōu)先選擇低成本器件。
Xilinx FPGA可編程邏輯解決方案縮短了電子設(shè)備制造商開(kāi)發(fā)產(chǎn)品的時(shí)間 [ 查看詳細(xì) ]
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