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          FPGA跨時(shí)鐘域異步時(shí)鐘設(shè)計(jì)的幾種同步策略

          • 實(shí)際的工程中,純粹單時(shí)鐘系統(tǒng)設(shè)計(jì)的情況很少,特別是設(shè)計(jì)模塊與外圍芯片的通信中,跨時(shí)鐘域的情況經(jīng)常不可避免。如果對(duì)跨時(shí)鐘域帶來(lái)的亞穩(wěn)態(tài)、采樣丟失、潛在邏輯錯(cuò)誤等等一系列問(wèn)題處理不當(dāng),將導(dǎo)致系統(tǒng)無(wú)法運(yùn)行。本文總結(jié)出了幾種同步策略來(lái)解決跨時(shí)鐘域問(wèn)題。
          • 關(guān)鍵字: 跨時(shí)鐘域  同步時(shí)序  FPGA  

          基于SPI Flash實(shí)現(xiàn)FPGA的復(fù)用配置

          • SPI(Serial Peripheral Interface,串行外圍設(shè)備接口)是一種高速、全雙工、同步的通信總線,在芯片的引腳上只占用4根線,不僅節(jié)約了芯片的引腳,同時(shí)在PCB的布局上還節(jié)省空間。正是出于這種簡(jiǎn)單、易用的特性,現(xiàn)在越來(lái)越多的芯片集成了這種通信協(xié)議。
          • 關(guān)鍵字: 復(fù)用編程  SPIFlash  FPGA  

          基于FPGA的數(shù)字化變電站計(jì)量?jī)x表研究與設(shè)計(jì)

          • 提出一種基于IEC61850和SoPC的數(shù)字化變電站計(jì)量?jī)x表設(shè)計(jì)方案。在DE2—70開(kāi)發(fā)板的基礎(chǔ)上,首先依據(jù)IEC61850標(biāo)準(zhǔn)對(duì)數(shù)字化變電站計(jì)量?jī)x表進(jìn)行了總體設(shè)計(jì);其次對(duì)基于FPGA的電量參數(shù)算法進(jìn)行了研究;最后完成了光纖通信電路、快速以太網(wǎng)接口電路、雙軟核SoPC系統(tǒng)等硬件電路的設(shè)計(jì)。基于FPGA的數(shù)字化變電站計(jì)量?jī)x表設(shè)計(jì)方案具有設(shè)計(jì)
          • 關(guān)鍵字: 數(shù)字化變電站  SOPC  FPGA  

          利用FPGA的M4K作為移位寄存器的邏輯分析儀設(shè)計(jì)

          • 采用Altera公司的Cyclone系列EPlC3T144C8作為控制芯片,QuartusⅡ?yàn)檐浖脚_(tái),用硬件描速語(yǔ)言設(shè)計(jì)了一個(gè)具有變頻采樣時(shí)鐘和16路采樣通道,基于VGA顯示的邏輯分析僅.該設(shè)計(jì)方案利用FPGA內(nèi)部的M4K決作為移位寄存器不斷地進(jìn)行讀進(jìn)數(shù)據(jù)的方式,提高了工作速度、性能穩(wěn)定性以及分析的范圍和質(zhì)量。該邏輯分析儀實(shí)現(xiàn)簡(jiǎn)單,價(jià)格低,具有較高的使用價(jià)值。
          • 關(guān)鍵字: 采樣模式  邏輯分析儀  FPGA  

          基于FPGA的生物電阻抗成像系統(tǒng)設(shè)計(jì)

          • 根據(jù)電阻抗斷層成像技術(shù)要求,設(shè)計(jì)了以Spartan3E系列XC3S500E FPGA為核心的16電極生物電阻抗成像系統(tǒng),系統(tǒng)嵌入8 bit微處理器PicoBlaze實(shí)現(xiàn)邏輯控制并產(chǎn)生激勵(lì)信號(hào)實(shí)現(xiàn)高速A/D采集及實(shí)現(xiàn)數(shù)字解調(diào),通過(guò)RS232將采集數(shù)據(jù)傳輸?shù)絇C機(jī),重建人體內(nèi)部的電阻率分布或其變化圖像。為廣泛應(yīng)用研究電阻抗斷層成像技術(shù)提供一種
          • 關(guān)鍵字: Spartan3E  生物電阻抗成像系統(tǒng)  FPGA  

          基于FPGA的VLIW微處理器的設(shè)計(jì)與實(shí)現(xiàn)

          • 超長(zhǎng)指令字VLIW微處理器架構(gòu)采用了先進(jìn)的清晰并行指令設(shè)計(jì)。VLIW微處理器的最大優(yōu)點(diǎn)是簡(jiǎn)化了處理器的結(jié)構(gòu),刪除了處理器內(nèi)部許多復(fù)雜的控制電路,它能從應(yīng)用程序中提取高度并行的指令數(shù)據(jù),并把這些機(jī)器指
          • 關(guān)鍵字: VLIW微處理器  并行指令控制  FPGA  

          FPGA的雙緩沖模式PCI Express總線設(shè)計(jì)

          • 介紹了軟件無(wú)線電平臺(tái)中基于FPGA的雙緩沖模式PCI Express(PCIE)總線的設(shè)計(jì)與實(shí)現(xiàn)。設(shè)計(jì)了基于Xilinx Virtex6 FPGA的通用軟件無(wú)線電平臺(tái),開(kāi)發(fā)了基于Linux系統(tǒng)的驅(qū)動(dòng)程序和PCIE硬核的DMA控制器。雙緩沖提高了數(shù)據(jù)傳輸速度,節(jié)約了硬件資源。測(cè)試結(jié)果顯示,該系統(tǒng)工作穩(wěn)定可靠,讀寫(xiě)速度可達(dá)402 MB/s。
          • 關(guān)鍵字: PCIExpress總線  雙緩沖模式  FPGA  

          基于FPGA的模糊控制交通燈控制方案設(shè)計(jì)

          • 針對(duì)目前交叉路口交通控制信號(hào)燈的綠信比固定不變的問(wèn)題,提出一種模糊控制的方案。根據(jù)當(dāng)前相位的車(chē)流量和當(dāng)前相位與下一相位車(chē)流量之差,實(shí)時(shí)控制相位綠信比,縮減車(chē)輛在交叉路口的排隊(duì)長(zhǎng)度。綠信比可在FPGA上模擬實(shí)現(xiàn),采用EElements ISE Development Kit開(kāi)發(fā)套件,使用ISE10.1軟件設(shè)計(jì)工具,對(duì)上述控制方案進(jìn)行仿真。
          • 關(guān)鍵字: 模糊控制  交通燈控制方案  FPGA  

          基于FPGA的PUSCH信道估計(jì)仿真與實(shí)現(xiàn)

          • 基于最小平方 (LS) 算法,利用FPGA實(shí)現(xiàn)了一種適用于TD-LTE系統(tǒng)的上行信道估計(jì)算法。主要研究了如何利用FPGA實(shí)現(xiàn)LS算法,包括算法的介紹、方案的形成、FPGA實(shí)現(xiàn)的處理流程、FPGA實(shí)現(xiàn)結(jié)果及分析。以Virtex-5芯片為硬件平臺(tái),完成了仿真、綜合、板級(jí)驗(yàn)證等工作。實(shí)現(xiàn)結(jié)果表明,該信道估計(jì)算法應(yīng)用到TD-LTE系統(tǒng)具有良好的穩(wěn)
          • 關(guān)鍵字: PUSCH  信道估計(jì)仿真  FPGA  

          FPGA設(shè)計(jì)系統(tǒng)時(shí)鐘的影響因素及其分析

          • 時(shí)鐘是整個(gè)電路最重要、最特殊的信號(hào),系統(tǒng)內(nèi)大部分器件的動(dòng)作都是在時(shí)鐘的跳變沿上進(jìn)行, 這就要求時(shí)鐘信號(hào)時(shí)延差要非常小, 否則就可能造成時(shí)序邏輯狀態(tài)出錯(cuò);因而明確FPGA設(shè)計(jì)中決定系統(tǒng)時(shí)鐘的因素,盡量較小時(shí)鐘的延時(shí)對(duì)保證設(shè)計(jì)的穩(wěn)定性有非常重要的意義。
          • 關(guān)鍵字: 信號(hào)時(shí)延  系統(tǒng)時(shí)鐘  FPGA  

          一種基于FPGA技術(shù)的紅外視頻采集系統(tǒng)設(shè)計(jì)

          • 介紹了一種基于FPGA技術(shù)的紅外視頻采集系統(tǒng)組成架構(gòu),給出了各功能模塊的實(shí)現(xiàn)方法,包括主要的HDL代碼、SignaltapII波形以及QuartusII頂層原理,并制作電路板進(jìn)行調(diào)試,最終的紅外圖像通過(guò)VGA實(shí)時(shí)顯示。結(jié)果表明該系統(tǒng)能充分利用FPGA技術(shù)的優(yōu)勢(shì),具有擴(kuò)展性好、控制靈活、開(kāi)發(fā)周期短等特點(diǎn)。
          • 關(guān)鍵字: 紅外視頻采集系統(tǒng)  ADV7181B  FPGA  

          JavaCard指令處理器的FPGA設(shè)計(jì)和實(shí)現(xiàn)

          • 給出了一種基于微碼的JavaCard指令處理器的FPGA設(shè)計(jì)和實(shí)現(xiàn),以此JavaCard CPU為核心搭建的測(cè)試平臺(tái)已集成在一塊FPGA上實(shí)現(xiàn)。
          • 關(guān)鍵字: JavaCard  復(fù)雜指令集  FPGA  

          基于FPGA的LBS控制器設(shè)計(jì)

          • 通過(guò)對(duì)LBS控制器的控制信號(hào)、LBS總線讀寫(xiě)操作時(shí)序、LBS狀態(tài)機(jī)進(jìn)行分析,設(shè)計(jì)并實(shí)現(xiàn)了一個(gè)高效、可靠的LBS控制器來(lái)實(shí)現(xiàn)FPGA和PEX8311的通信系統(tǒng),在PEX8311和FPGA接口中運(yùn)行狀態(tài)正常,穩(wěn)定性強(qiáng),成功應(yīng)用于某視頻采集卡、某PCIe數(shù)據(jù)采集卡等,基于FPGA設(shè)計(jì)的LBS控制器具有靈活性強(qiáng)、可編程能力強(qiáng)、適應(yīng)性強(qiáng)等優(yōu)點(diǎn)。
          • 關(guān)鍵字: LBS控制器  PEX8311  FPGA  

          FPGA設(shè)計(jì)流程及其布線資源解析

          • 電路設(shè)計(jì)與輸入是指通過(guò)某些規(guī)范的描述方式,將工程師電路構(gòu)思輸入給EDA工具。常用的設(shè)計(jì)方法有硬件描述語(yǔ)言(HDL)和原理圖設(shè)計(jì)輸入方法等。原理圖設(shè)計(jì)輸入法在早期應(yīng)用得比較廣泛,它根據(jù)設(shè)計(jì)要求,選用器件、繪制原理圖、完成輸入過(guò)程。這種方法的有點(diǎn)是直觀、便于理解、元器件庫(kù)資源豐富。但是在大型設(shè)計(jì)中,這種方法的可維護(hù)性較差,不利于模塊構(gòu)造與重用
          • 關(guān)鍵字: 布線資源  功能仿真  FPGA  

          基于FPGA的海量數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)

          • 最近幾年,F(xiàn)PGA以其應(yīng)用的靈活方便蓬勃發(fā)展,在通信、航空航天、醫(yī)療設(shè)備、消費(fèi)類電子產(chǎn)品等領(lǐng)域一展身手。使用FPGA控制CF的技術(shù)到目前為止還沒(méi)有成熟,本文從硬件和軟件角度出發(fā),介紹了FPGA與CF卡的接口設(shè)計(jì)、給出了用雙RAM訪問(wèn)CF卡的編程,并且利用FPGA作為FIFO對(duì)AD采集的數(shù)據(jù)進(jìn)行緩沖,然后存儲(chǔ)到大容量的CF卡中。
          • 關(guān)鍵字: 海量數(shù)據(jù)采集  THS4052  MAX4125  FPGA  
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          xilinx fpga介紹

            Xilinx FPGA   Xilinx FPGA主要分為兩大類,一種側(cè)重低成本應(yīng)用,容量中等,性能可以滿足一般的邏輯設(shè)計(jì)要求,如Spartan系列;還有一種側(cè)重于高性能應(yīng)用,容量大,性能能滿足各類高端應(yīng)用,如Virtex系列,用戶可以根據(jù)自己實(shí)際應(yīng)用要求進(jìn)行選擇。 在性能可以滿足的情況下,優(yōu)先選擇低成本器件。   Xilinx FPGA可編程邏輯解決方案縮短了電子設(shè)備制造商開(kāi)發(fā)產(chǎn)品的時(shí)間 [ 查看詳細(xì) ]

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