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          <label id="pryje"></label>
          


          
	
  	
          
	
          
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          零基礎學FPGA（八）手把手解析時序邏輯乘法器代碼
          
                                                            
                                        
            
                    	
          • 　　上次看了一下關于乘法器的Verilog代碼，有幾個地方一直很迷惑，相信很多初學者看這段代碼一定跟我當初一樣，看得一頭霧水，在網上也有一些網友提問，說這段代碼不好理解，今天小墨同學就和大家一起來看一下這段代碼，我會親自在草稿紙上演算，盡量把過程寫的詳細些，讓更多的人了解乘法器的設計思路。
　　下面是一段16位乘法器的代碼，大家可以先瀏覽一下，之后我再做詳細解釋
　　module mux16(
　　clk,rst_n,
　　start,ain,bin,yout,done
　　);
　　inpu
            • 
                    	                        
          • 關鍵字：
                        FPGA  Verilog  時序邏輯                          
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          20個Nios Ⅱ的經典設計，提供軟硬件架構、流程、算法
          
                                                            
            
                    	
          • 　　Nios Ⅱ嵌入式處理器是ALTERA公司推出的采用哈佛結構、具有32位指令集的第二代片上可編程的軟核處理器, 其最大優(yōu)勢和特點是模塊化的硬件結構, 以及由此帶來的靈活性和可裁減性。本文基于Nios Ⅱ介紹20款經典設計方案，供大家參考。
　　基于NiosⅡ的U盤安全控制器設計
　　本文針對U盤的安全隱患，分析目前較為常見的解決方法，利用SoPC技術，設計實現(xiàn)了一款基于NiosⅡ處理器的U盤安全控制器。該控制器位于PC機和U盤之間，通過對U盤進行扇區(qū)級的加解密操作，將普通U盤升級為安全U盤，保證U
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          • 關鍵字：
                        ALTERA  FPGA  SoPC                          
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          基于NiosⅡ的直流電機PID調速控制系統(tǒng)設計與應用方案
          
                                                            
                                        
            
                    	
          • 　　引言
　　以往的直流電機調速系統(tǒng)通常采用單片機或DSP進行控制，而單片機需要使用大量的外圍電路，且系統(tǒng)的可升級性差，如更換控制器，往往要對整個軟硬件進行重新設計，可重用性不高。而采用DSP作為主要控制器，如果碰到處理多任務系統(tǒng)時，一片DSP不能勝任，這時就需要再擴展一片DSP或者FPGA芯片來輔助控制，從而實行雙芯片控制模式。但這樣做，既增加了兩個處理器之間同步和通信的負擔，又使系統(tǒng)實時性變壞，延長系統(tǒng)開發(fā)時間?；谝陨洗祟悊栴}，本文提出了采用Altera公司推出的NiosⅡ軟核來控制直流電機調速系
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          • 關鍵字：
                        PID  NiosⅡ  FPGA                          
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          一種基于NiosⅡ的可重構DSP系統(tǒng)設計
          
                                                            
            
                    	
          • 　　引言
　　為了解決傳統(tǒng)DSP所面臨的速度低、硬件結構不可重構、開發(fā)升級周期長和不可移植等問題，本文應用Altera公司推出的NiosII嵌入式軟核處理器，提出了一種具有常規(guī)DSP的NiosII系統(tǒng)功能SOPC解決方案。由于可編程的NiosII核含有許多可配置的接口模塊，用戶可根據(jù)設計要求，利用QuartusII和SOPC Builder對NiosII及其外圍系統(tǒng)進行構建。用戶還可通過Matlab和DSP Builder，或直接用VHDL等硬件描述語言，為NiosII嵌入式處理器設計各類硬件模塊，并以
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          • 關鍵字：
                        DSP  NiosII  SOPC                           
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          基于NiosⅡ處理器的多功能計數(shù)器系統(tǒng)設計
          
                                                            
            
                    	
          • 　　系統(tǒng)以FPGA為核心,通過對正弦信號進行濾波、放大整形后得到標準的方波,由FPGA對其頻率、周期及相位差進行測量。頻率、周期測量采用等精度測量法,其具有精度高的特點;相位差測量采用鑒相器分辨出相位差后測量其高電平所占比例測量。摒棄傳統(tǒng)的FPGA+單片機方案,利用SOPC Builder在FPGA上構建Nios Ⅱ處理器對測量的數(shù)據(jù)進行數(shù)據(jù)處理及顯示,實現(xiàn)了頻率、周期、相位差測量的片上系統(tǒng)(SOPC),提高了系統(tǒng)的穩(wěn)定性、降低了布線難度。
　　基于Nios_處理器的多功能計數(shù)器系統(tǒng)設計.pdf
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          • 關鍵字：
                        NiosⅡ  多功能計數(shù)器  FPGA                          
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          基于NiosⅡ的1553B總線通訊模塊設計與開發(fā)
          
                                                            
                                        
            
                    	
          • 　　自2005年9月LXI總線推出以來，已經顯示出其組建測試系統(tǒng)的眾多優(yōu)點?；贚XI總線組建測試系統(tǒng)具有易于使用、靈活性高、模塊化和可擴縮性、實現(xiàn)更快的系統(tǒng)吞吐率、可分布式應用、長壽命、低成本、通過IEEE1588時鐘同步、機架空間小、合成儀器等諸多優(yōu)點。
　　1553B總線的全名為“時分制指令/響應式多路傳輸數(shù)據(jù)總線”，國內多型戰(zhàn)斗機、軍艦等武器平臺都采用其作為傳輸總線。因此研制基于LXI總線的1553B通訊模塊，不僅能滿足多型武器裝備對1553B總線的測試需求，也對LXI總
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          • 關鍵字：
                        NiosⅡ  1553B  FPGA                          
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          晶振的作用—有用就是任性
          
                                                            
                                        
            
                    	
          • 1. 晶振的作用--晶振的基本概念
　　晶振是電路中常用用的時鐘元件，全稱是叫晶體震蕩器，它是利用具有壓電效應的石英晶體片制成的。其作用在于產生原始的時鐘頻率，這個頻率經過頻率發(fā)生器的放大或縮小后就成了電腦中各種不同的總線頻率。由于石英諧振器具有體積小、重量輕、可靠性高、頻率穩(wěn)定度高等優(yōu)點，被應用于家用電器和通信設備中。石英諧振器因具有極高的頻率穩(wěn)定性，故主要用在要求頻率十分穩(wěn)定的振蕩電路中作諧振元件。

2. 晶振的作用--晶振的符號表示
　　晶振在結構上分為兩只腳的晶振和三只腳的晶振，它們在電
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          • 關鍵字：
                        晶振  DSP  datasheet  晶振的作用                          
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          京微雅格FPGA的仿真方法
          
                                                            
                                        
            
                    	
          • 　　京微雅格是世界上除美國硅谷以外唯一自主研發(fā)并成功量產現(xiàn)場可編程邏輯(FPGA)芯片的公司，目前擁有數(shù)百項技術專利和近百款產品。目前，已經有越來越多的用戶都開始使用國產FPGA來做自己的設計，然而在FPGA的開發(fā)過程中，免不了要對設計進行仿真。京微雅格的FPGA是支持在modelsim中進行仿真的。
　　京微雅格的FPGA需要在Primace軟件中進行開發(fā)，為了便于客戶進行仿真設計，在Primace5.0及以上版本都支持在工程中直接調用仿真工具Modelsim。同時，也支持在modelsim中直接進行
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          • 關鍵字：
                        京微雅格  FPGA  仿真                          
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          上海盈方微電子獲得CEVA-TeakLite-4 音頻/語音DSP內核授權許可
          
                                                            
            
                    	
          • 　　全球領先的硅產品知識產權(SIP)平臺解決方案和數(shù)字信號處理器(DSP)內核授權廠商CEVA公司宣布，上海盈方微電子(Shanghai InfoTM Microelectronics)已經獲得CEVA-TeakLite-4 DSP授權許可，在面向智能手機、平板電腦和其它移動設備的下一代應用處理器中支持先進的音頻功能。
　　上海盈方微電子產品總監(jiān)Kurt Zhang介紹說：“經過詳細的篩選過程，CEVA-TeakLite-4 DSP證明是實現(xiàn)下一代應用處理器所需高性能音頻處理功能的最低功耗
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          • 關鍵字：
                        DSP  CEVA  內核                          
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          利用Spartan-3 FPGA實現(xiàn)高性能DSP功能
          
                                                            
            
                    	
          • 　　Spartan-3 FPGA能以突破性的價位點實現(xiàn)嵌入式DSP功能。本文闡述了Spartan-3 FPGA針對DSP而優(yōu)化的特性，并通過實現(xiàn)示例分析了它們在性能和成本上的優(yōu)勢。
　　所有低成本的FPGA都以頗具吸引力的價格提供基本的邏輯性能，并能滿足廣泛的多用途設計需求。然而，當考慮在FPGA構造中嵌入DSP功能時，必須選擇高端FPGA以獲得諸如嵌入式乘法器和分布式存儲器等平臺特性。
　　Spartan-3 FPGA的面世改變了嵌入式DSP的應用前景。雖然Spartan-3系列器件的價位可能較低，
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          • 關鍵字：
                        賽靈思  FPGA  Spartan-3                          
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          意法半導體(ST)與米蘭理工大學通過PFGA合作開發(fā)FASTER 3D圖形應用系統(tǒng)
          
                                                            
            
                    	
          • 　　橫跨多重電子應用領域、全球領先的半導體供應商意法半導體(STMicroelectronics，簡稱ST)宣布對基于射線跟蹤 (ray-tracing) 技術的實驗性3D圖形應用系統(tǒng)進行測試驗證。該解決方案采用一顆與現(xiàn)場可編程門陣列 (FPGA, Field-Programmable Gate Array) 相連、基于ARM®處理器的測試芯片。FASTER 研發(fā)項目以“簡化分析合成技術，實現(xiàn)有效配置”為目標，是意法半導體與米蘭理工大學 (Politecnico di Mi
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          • 關鍵字：
                        意法半導體  FPGA  GPU                          
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          【從零開始走進FPGA】創(chuàng)造平臺——Quartus II 11.0 套件安裝指南
          
                                                            
                                        
            
                    	
          • 　　一、Altera Quartus II 11.0套件介紹
　　所謂巧婦難為無米之炊，再強的軟硬件功底，再多的思維創(chuàng)造力，沒有軟件的平臺，也只是徒勞。因此，一切創(chuàng)造的平臺——Quartus II 軟件安裝，由零開啟的世界，便從此開始。
　　自從Bingo 2009年開始接觸FPGA，Quartus II 版本的軟件從n年前的5.1版本到今天的最新發(fā)布的11.0，都使用過;當然對于軟件核心構架而言，萬變不離其宗。雖然多多少少有點bug，但這10多個版本發(fā)展到了現(xiàn)在，能看到Alt
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          • 關鍵字：
                        FPGA  Quartus II                           
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          零基礎學FPGA（七）淺談狀態(tài)機
          
                                                            
                                        
            
                    	
          • 　　今天我們來寫狀態(tài)機。
　　關于狀態(tài)機呢，想必大家應該都接觸過，通俗的講就是數(shù)電里我們學的狀態(tài)轉換圖。狀態(tài)機分為兩中類型，一種叫Mealy型，一種叫Moore型。前者就是說時序邏輯的輸出不僅取決于當前的狀態(tài)，還取決于輸入，而后者就是時序邏輯的輸出僅僅取決于當前的狀態(tài)。下面兩個圖分別表示兩種不同的狀態(tài)機。
　　

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　　下面我們就通過代碼來寫一下狀態(tài)機，以下面的狀態(tài)轉換圖為例
　　

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　　首先，是一種典型的狀態(tài)機寫法，這種寫法我們稱為
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          • 關鍵字：
                        FPGA  狀態(tài)機  Mealy  Moore                          
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          零基礎學FPGA（六）今天講習題
          
                                                            
                                        
            
                    	
          • 　　習題呢，來自夏雨聞老師的那本教材，就挑幾個感覺自己做著有點難度的寫寫吧
　　

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　　這個題呢剛開始我是沒看明白，記得書上只講了我們習慣上的用法，這種用法我是沒見過，問了下別人才知道，Verilog中一般是左高右低。第一個沒問題，第二個，input [0:2] IP,習慣上我們這樣寫 input [2:0] IP，這里兩個是等價的，即表示第0 .1 .2 三位。第三個，wire [16:23] A,也是，左高右低，表示第16.17.....22. 23位，左高右低就這樣記就好了。

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                        FPGA  夏雨聞  寄存器                          
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          基于MicroBlaze軟核的FPGA片上系統(tǒng)設計
          
                                                            
                                        
            
                    	
          • 　　Xilinx公司的MicroBlaze 32位軟處理器核是支持CoreConnect總線的標準外設集合。MicroBlaze處理器運行在150MHz時鐘下，可提供125 D-MIPS的性能，非常適合設計針對網絡、電信、數(shù)據(jù)通信和消費市場的復雜嵌入式系統(tǒng)。
　　1 MicroBlaze的體系結構
　　MicroBlaze 是基于Xilinx公司FPGA的微處理器IP核，和其它外設IP核一起，可以完成可編程系統(tǒng)芯片(SOPC)的設計。MicroBlaze 處理器采用RISC架構和哈佛結構的32位指令和
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          • 關鍵字：
                        MicroBlaze  Xilinx  FPGA                          
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          fpga+dsp介紹
          
      			
          
		      	
          
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