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基于MAX7000系列CPLD的數(shù)據(jù)采集系統(tǒng)
- CPLD是復(fù)雜的PLD，專指那些集成規(guī)模大于1000門以上的可編程邏輯器件。它由與陣列、或陣列、輸入緩沖電路...
- 關(guān)鍵字： CPLD MAX7000 數(shù)據(jù)采集 FPGA
基于CPLD技術(shù)的槍械電磁扳機(jī)控制儀設(shè)計(jì)
- 針對(duì)目前靶場測試領(lǐng)域尤其是外彈道測試通常采用人工擊發(fā)槍械的方式，存在安全性差、無法精確控制等問題，設(shè)計(jì)一種基于CPLD技術(shù)的槍械電磁扳機(jī)控制儀。采用步進(jìn)電機(jī)作為執(zhí)行單元，CPLD作為主控制器實(shí)現(xiàn)邏輯控制、通信功能。設(shè)計(jì)中著重考慮了電磁兼容及安全性，通過機(jī)械及電氣兩部分聯(lián)鎖確?？刂苾x無誤觸發(fā)。通過靶場試驗(yàn)，該控制儀能夠適應(yīng)靶場電磁環(huán)境，而且對(duì)其他儀器無干擾，其通信功能還可實(shí)現(xiàn)整體測試系統(tǒng)的同步性、自動(dòng)化、網(wǎng)絡(luò)化及遠(yuǎn)程控制。
- 關(guān)鍵字： CPLD 槍械 電磁 控制儀
基于AVR和CPLD的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)
- 輸入系統(tǒng)的信息大多數(shù)是模擬量，為使計(jì)算機(jī)能夠處理這些模擬量，必須經(jīng)由數(shù)據(jù)采集系統(tǒng)將模擬量轉(zhuǎn)化為數(shù)字量...
- 關(guān)鍵字： AVR CPLD 高速數(shù)據(jù)采集
基于VHDL的矩陣鍵盤及顯示電路設(shè)計(jì)
- 為了有效防止機(jī)械式鍵盤按鍵抖動(dòng)帶來的數(shù)據(jù)錯(cuò)誤，這里在QuartusⅡ開發(fā)環(huán)境下，采用VHDL語言設(shè)計(jì)了一種能夠?qū)C(jī)械式4×4矩陣鍵盤的按鍵值依次顯示到8個(gè)7段數(shù)碼管上的矩陣鍵盤及顯示電路。仿真結(jié)果表明，所設(shè)計(jì)的矩陣鍵盤及顯示電路成功地實(shí)現(xiàn)了按鍵防抖和按鍵數(shù)據(jù)的準(zhǔn)確顯示。以ACEXlK系列EPlK30QC208芯片為硬件環(huán)境，驗(yàn)證了各項(xiàng)設(shè)計(jì)功能的正確性。
- 關(guān)鍵字： 顯示 電路設(shè)計(jì) 鍵盤 矩陣 VHDL 基于
基于VHDL 的矩陣鍵盤及顯示電路設(shè)計(jì)
- 摘 要:為了有效防止機(jī)械式鍵盤按鍵抖動(dòng)帶來的數(shù)據(jù)錯(cuò)誤,這里在Quartus Ⅱ開發(fā)環(huán)境下,采用VHDL 語言設(shè)計(jì)了一種能夠?qū)C(jī)械式4 times;4 矩陣鍵盤的按鍵值依次顯示到8 個(gè)7 段數(shù)碼管上的矩陣鍵盤及顯示電路。仿真結(jié)果表
- 關(guān)鍵字： FPGA/ CPLD 鍵盤 電路
基于VHDL的16路可調(diào)速彩燈控制器設(shè)計(jì)
- 彩燈作為一種常見的裝飾，在生活中應(yīng)用廣泛。為了使彩燈變得更加絢麗多彩，這里在QuartusⅡ開發(fā)環(huán)境下，用VIIDL語言設(shè)計(jì)了一種可用于控制16路彩燈，具有4種彩燈變換模式，且變換速度可調(diào)的彩燈控制器。仿真結(jié)果表明，所設(shè)計(jì)的彩燈控制器成功地實(shí)現(xiàn)了4種變換模式的循環(huán)和各種變換速度的調(diào)節(jié)。最后，以ACEXlK系列EPlK30QC208芯片為硬件環(huán)境，驗(yàn)證了各項(xiàng)設(shè)計(jì)功能的正確性。
- 關(guān)鍵字： 控制器 設(shè)計(jì) 彩燈 調(diào)速 VHDL 路可 基于
基于CPLD內(nèi)部的反向器實(shí)現(xiàn)振蕩器應(yīng)用
- 摘要：使用CPLD內(nèi)部的資源施密特觸發(fā)器和反相器,只需外加一個(gè)RC就可以設(shè)計(jì)出一個(gè)穩(wěn)定的振蕩器，為CPLD或外圍器件提供時(shí)鐘源。靈活方便的設(shè)計(jì)及低成本的特性，使之具有很好的產(chǎn)品商業(yè)使用價(jià)值。 關(guān)鍵字：CPLD;施密特觸發(fā)器;振蕩器 前言 電子技術(shù)的飛速發(fā)展，尤其是消費(fèi)類電子產(chǎn)品在成本、產(chǎn)品功能及品質(zhì)的更高要求，使消費(fèi)類電子產(chǎn)品的設(shè)計(jì)不是簡單地要求設(shè)計(jì)出來，而是要考慮低成本高品質(zhì)。 CPLD的成本低，占用PCB面積小，功耗低和靈活的后期可編程特性在嵌入式設(shè)計(jì)中得到越來越廣泛的應(yīng)用。
- 關(guān)鍵字： CPLD 施密特觸發(fā)器 201009
FPGA/CPLD狀態(tài)機(jī)的穩(wěn)定性設(shè)計(jì)
- FPGA/CPLD狀態(tài)機(jī)的穩(wěn)定性設(shè)計(jì), 隨著大規(guī)模和超大規(guī)模FPGA/CPLD器件的誕生和發(fā)展,以HDL(硬件描述語言)為工具、FPGA/CPLD器件為載體的EDA技術(shù)的應(yīng)用越來越廣泛.從小型電子系統(tǒng)到大規(guī)模SOC(Systemonachip)設(shè)計(jì),已經(jīng)無處不在.在FPGA/CPLD設(shè)計(jì)中,狀
- 關(guān)鍵字： 設(shè)計(jì) 穩(wěn)定性 狀態(tài) FPGA/CPLD
基于AVR和CPLD的高速數(shù)據(jù)采集系統(tǒng)
- 為了提高數(shù)據(jù)采集卡的速度，同時(shí)降低成本，設(shè)計(jì)一種并行數(shù)據(jù)采集系統(tǒng)，要求并行采集速度大于10 Mb／s。整個(gè)系統(tǒng)由AVR與CPLD控制實(shí)現(xiàn)，通過MAXl308完成模數(shù)轉(zhuǎn)換，并設(shè)計(jì)搭建了其外圍電路。采用12路數(shù)據(jù)存儲(chǔ)模式存儲(chǔ)高速采集的數(shù)據(jù)。實(shí)驗(yàn)依據(jù)存儲(chǔ)要求搭建硬件電路并調(diào)試，示波器顯示的波形結(jié)果8組脈沖序列完全對(duì)齊，沒有出現(xiàn)時(shí)序混亂，同時(shí)并行處理過程中不相互影響，實(shí)現(xiàn)了低成本高速多路采集的設(shè)計(jì)要求。
- 關(guān)鍵字： CPLD AVR 高速數(shù)據(jù) 采集系統(tǒng)
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