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VHDL-AMS在控制系統(tǒng)分析與設(shè)計中的應(yīng)用
- 1 引 言EDA是現(xiàn)代電子系統(tǒng)設(shè)計的關(guān)鍵技術(shù)。硬件描述語言VHDL以其“代碼復(fù)用”(code re-use)遠(yuǎn)高于傳統(tǒng)的原理圖輸入法等諸多優(yōu)點，逐漸成為EDA技術(shù)中主要的輸入工具。然而，基于IEEE VHDL Std 1076-1993標(biāo)準(zhǔn)
- 關(guān)鍵字： VHDL-AMS 控制系統(tǒng) 分析 中的應(yīng)用
全同步數(shù)字頻率計的 VHDL設(shè)計與仿真
- 1 引 言
頻率測量不僅在工程應(yīng)用中有非常重要的意義，而且在高精度定時系統(tǒng)中也處于核心地位，plusmn;1個計數(shù)誤差通常是限制頻率測量精度進(jìn) 一步提高的重要原因。由于測頻技術(shù)的重要性，使測頻方法也有了很大的發(fā) - 關(guān)鍵字： VHDL 數(shù)字頻率計 仿真
vhdl-ams介紹
即IEEE 1076.1標(biāo)準(zhǔn)。
VHDL-AMS是VHDL的一個分支，它支持模擬、數(shù)字、數(shù)?；旌想娐废到y(tǒng)的建模與仿真。
http://www.eda.org/vhdl-ams/
Verilog-AMS與之類似。支持模擬、數(shù)字、數(shù)?；旌想娐废到y(tǒng)的建模與仿真。
http://www.eda.org/verilog-ams/
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